The invention relates to a semiconductor device, a manufacturing method and an electronic device. The semiconductor device includes a fin; a gate structure is positioned above the fin and surrounds the fins arranged; virtual fins positioned outside the gate structure on both sides of the source drain region and the fins are arranged at intervals; the source drain epitaxial layer, located in the source drain region and extends along the gate structure and the direction of the source drain epitaxial layer covers the fin and the virtual. Outside the gate structure on both sides of the semiconductor devices in the source drain region is provided with a plurality of virtual fins, the virtual channel portion of the fin located position cutting removal, retaining only the source and drain regions of the lateral part, thereby increasing the epitaxial region source drain, drain epitaxial layer through the source can be set increase the contact structure of the area, thereby significantly reducing the contact resistance and the performance of the semiconductor device and the yield have been greatly improved.
【技术实现步骤摘要】
一种半导体器件及其制造方法、电子装置
本专利技术涉及半导体
,具体而言涉及一种半导体器件及其制造方法、电子装置。
技术介绍
随着半导体技术的不断发展,集成电路性能的提高主要是通过不断缩小集成电路器件的尺寸以提高它的速度来实现的。目前,由于高器件密度、高性能和低成本的需求,半导体工业已经进步到纳米技术工艺节点,半导体器件的制备受到各种物理极限的限制。随着CMOS器件尺寸的不断缩小,来自制造和设计方面的挑战促使了三维设计如鳍片场效应晶体管(FinFET)的发展。相对于现有的平面晶体管,FinFET是用于20nm及以下工艺节点的先进半导体器件,其可以有效控制器件按比例缩小所导致的难以克服的短沟道效应,还可以有效提高在衬底上形成的晶体管阵列的密度,同时,FinFET中的栅极环绕鳍片(鳍形沟道)设置,因此能从三个面来控制静电,在静电控制方面的性能也更突出。随着3DFinFET器件的不断缩小,接触电阻的减小成为器件性能提高的主要挑战,其中,所述接触孔区域中接触电阻的减小是非常关键的,但是这会降低半导体器件的寄生电容,并且如果增加接触孔的尺寸,则会造成接触孔和多晶硅的桥连。因此,目前需要对目前所述半导体器件的制备方法做进一步的改进,以便消除上述问题。
技术实现思路
在
技术实现思路
部分中引入了一系列简化形式的概念,这将在具体实施方式部分中进一步详细说明。本专利技术的
技术实现思路
部分并不意味着要试图限定出所要求保护的技术方案的关键特征和必要技术特征,更不意味着试图确定所要求保护的技术方案的保护范围。为了克服目前存在的问题,本专利技术提供了一种半导体器件,所述半导体器件包括 ...
【技术保护点】
一种半导体器件,其特征在于,所述半导体器件包括:鳍片;栅极结构,位于所述鳍片的上方并环绕所述鳍片设置;虚拟鳍片,位于所述栅极结构两侧的源漏区域的外侧并且与所述鳍片间隔设置;源漏外延层,位于所述源漏区域上且沿所述栅极结构的方向延伸,所述源漏外延层同时覆盖所述鳍片和所述虚拟鳍片。
【技术特征摘要】
1.一种半导体器件,其特征在于,所述半导体器件包括:鳍片;栅极结构,位于所述鳍片的上方并环绕所述鳍片设置;虚拟鳍片,位于所述栅极结构两侧的源漏区域的外侧并且与所述鳍片间隔设置;源漏外延层,位于所述源漏区域上且沿所述栅极结构的方向延伸,所述源漏外延层同时覆盖所述鳍片和所述虚拟鳍片。2.根据权利要求1所述的半导体器件,其特征在于,所述半导体器件包括分别位于源极区域两侧的第一虚拟鳍片和第二虚拟鳍片。3.根据权利要求2所述的半导体器件,其特征在于,所述半导体器件包括分别位于漏极区域两侧的第三虚拟鳍片和第四虚拟鳍片。4.根据权利要求3所述的半导体器件,其特征在于,所述第一虚拟鳍片和第三虚拟鳍片位于所述鳍片的同一侧,两者通过将同一虚拟鳍片结构位于鳍片沟道区域的部分去除形成。5.根据权利要求3所述的半导体器件,其特征在于,所述第二虚拟鳍片和第四虚拟鳍片位于所述鳍片的同一侧,两者通过将同一虚拟鳍片结构位于鳍片沟道区域的部分去除形成。6.根据权利要求1所述的半导体器件,其特征在于,所述半导体器件还包括半导体衬...
【专利技术属性】
技术研发人员:周飞,
申请(专利权)人:中芯国际集成电路制造上海有限公司,中芯国际集成电路制造北京有限公司,
类型:发明
国别省市:上海,31
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