一种栅极侧墙减薄工艺制造技术

本发明专利技术提供了一种栅极侧墙减薄工艺，包括：首先在半导体衬底上形成栅极和栅极侧墙之后，在整个半导体衬底上覆盖一层抗反射层，然后，采用光刻和刻蚀工艺，图案化抗反射层，再利用抗反射层为掩膜，采用干法刻蚀工艺，向下刻蚀侧墙，从而实现侧墙宽度的减薄；抗反射层覆盖在栅极和侧墙顶部，在减薄过程中，可以保护栅极和侧墙顶部不受到损伤，从而可以扩大工艺窗口，增加减薄的宽度，提高侧墙减薄效果。

【技术实现步骤摘要】
一种栅极侧墙减薄工艺
本专利技术涉及半导体
，特别涉及一种栅极侧墙减薄工艺。
技术介绍
随着工艺尺寸不断缩小，特别是65nm及其以下，为了增强器件的性能，通常采用应力接近技术(StressProximityTechnique,SPT)减薄栅极两侧侧墙的宽度，从而使后续具有一定应力的膜层沉积在更接近沟道(channel)的区域，以增强器件驱动电流。通常采用SPT工艺来减薄栅极侧墙的过程包括：在侧墙以及硅化物形成后，直接进行一步干法刻蚀，从而减薄侧墙的宽度。采用上述方法，在干法刻蚀中，把侧墙水平方向减薄的同时，也不可避免地刻蚀到侧墙的顶部，请参阅图1，图1为采用现有的栅极侧墙减薄方法之后形成的衬底截面结构示意图。1表示栅极，2表示栅极侧墙。侧墙顶部在刻蚀过程中由于没有受到保护而遭到等离子损伤，如图1中虚线之间的高度即为侧墙顶部的损失高度。栅极侧墙顶部的损伤会导致器件漏电，并最终使器件的性能恶化。实际工艺中，为了减小栅极侧墙顶部的损伤，不得不限制水平方向的刻蚀量，这样，侧墙水平方向的刻蚀受制于垂直方向的限制，工艺窗口非常小，从而影响栅极侧墙减薄的效果。因此，需要改进现有的栅极侧墙减薄工艺，在减薄栅极侧墙的过程中，使栅极侧墙的顶部和栅极的顶部不受到等离子体刻蚀的损伤。
技术实现思路
为了克服以上问题，本专利技术旨在提供一种栅极侧墙减薄工艺，在减薄侧墙的过程中，不损伤侧墙顶部和栅极顶部，从而扩大刻蚀工艺窗口，提高栅极侧墙的减薄效果。本专利技术提供了一种栅极侧墙减薄工艺，其包括：步骤S01：在半导体衬底上依次形成栅极和栅极侧墙；步骤S02：在所述半导体衬底上覆盖一层抗反射层；步骤S03：采用光刻和干法刻蚀工艺，图案化所述抗反射层；步骤S04：以图案化的所述抗反射层为掩膜，经干法刻蚀工艺，减薄所述栅极侧墙。优选地，所述步骤S03中，采用HBr和O2的混合气体作为刻蚀气体。优选地，所述HBr与所述O2的流量比例为1：1至15:2。优选地，所述HBr的流量为10-30sccm,所述O2的流量为4-10sccm。优选地，所述步骤S03中，所采用的压强为5-10mTorr，所采用的上电极功率为300-500瓦，反应时间为10-80秒。优选地，所述步骤S04中，采用氟系气体刻蚀所述栅极侧墙。优选地，所述氟系气体为CH2F2和CHF3的混合气体。优选地，所述CH2F2与所述CHF3的流量比例为1:1至4:1。优选地，所述CH2F2的流量为60-120sccm，所述CHF3的流量为30-60sccm。优选地，所述步骤S04中，所采用的压强为20-40mTorr，所采用的上电极功率为500-800瓦，所采用的下电极电压为0，反应时间为10-40秒。本专利技术的一种栅极侧墙减薄工艺，首先在形成侧墙之后，在整个半导体衬底上覆盖一层抗反射层，该抗反射层包裹住栅极和栅极侧墙这样使衬底表面趋于平坦；然后，采用光刻和刻蚀工艺，图案化抗反射层，再利用抗反射层为掩膜，采用干法刻蚀工艺，向下刻蚀侧墙，从而实现侧墙宽度的减薄；抗反射层覆盖在栅极和侧墙顶部，在减薄过程中，可以保护栅极和侧墙顶部不受到损伤，从而可以扩大工艺窗口，增加减薄的宽度，提高侧墙减薄效果。附图说明图1为采用现有的栅极侧墙减薄方法之后形成的衬底截面结构示意图图2为本专利技术的一个较佳实施例的栅极侧墙减薄方法的流程示意图图3-6为本专利技术的上述较佳实施例的栅极侧墙减薄方法的各个步骤所对应的衬底截面结构示意图具体实施方式为使本专利技术的内容更加清楚易懂，以下结合说明书附图，对本专利技术的内容作进一步说明。当然本专利技术并不局限于该具体实施例，本领域内的技术人员所熟知的一般替换也涵盖在本专利技术的保护范围内。以下将结合具体实施例和附图2-6对本专利技术的栅极侧墙减薄方法作进一步详细说明。其中，图2为本专利技术的一个较佳实施例的栅极侧墙减薄方法的流程示意图，图3-6为本专利技术的上述较佳实施例的栅极侧墙减薄方法的各个步骤所对应的衬底截面结构示意图。如前所述，现有的减薄栅极侧墙的方法，在对栅极和侧墙顶部无保护措施的情况下，直接采用干法刻蚀工艺刻蚀侧墙，最终导致侧墙顶部受到刻蚀损伤；并且，由于栅极和侧墙顶部也同时被刻蚀到，这进一步限制了对侧墙宽度的刻蚀，即刻蚀工艺窗口较小。因此，本专利技术改进了现有的工艺，在对侧墙进行减薄刻蚀之前，增加了对侧墙和栅极顶部的保护措施，不仅可以保护侧墙顶部不受刻蚀损伤，而且可以克服减薄侧墙宽度受限的弊端，扩大了刻蚀工艺窗口，提高了侧墙宽度减薄的效果。请参阅图2，本专利技术的本实施例的栅极侧墙减薄方法，包括以下步骤：步骤S01：请参阅图3，在半导体衬底101上依次形成栅极102和栅极侧墙103；这里，可以采用现有的常规工艺来形成栅极和栅极侧墙，还可以但不限于包括源漏区的离子掺杂注入、半导体衬底表面硅化物的形成等工艺来形成本专利技术的半导体衬底。本实施例中，半导体衬底101可以但不限于为硅衬底，半导体衬底101的表面具有一层氧化膜，其成分可以为热氧化生成的氧化硅材料，栅极102和栅极侧墙103位于该氧化膜的表面上，本专利技术对此不再赘述。栅极侧墙103的材料可以为氮化硅、氧化硅等，较佳的，本实施例中，采用氮化硅作为栅极侧墙103的材料。步骤S02：请参阅图4，在半导体衬底101上覆盖一层抗反射层104；具体的，可以采用机械法在半导体衬底101上涂覆一层抗反射层104，较佳的，抗反射层104可以为底部抗反射层，比如可以为有机抗反射层，这是由于在后续的工艺中，要在抗反射层上涂覆光刻胶进行光刻胶的光刻工艺，底部抗反射层可以有效减小在光刻胶曝光过程中光刻胶底部对光线的反射，提高曝光质量。这里，抗反射层104包裹住栅极102和栅极侧墙103，不仅可以保护栅极102和侧墙103顶部在后续的减薄刻蚀过程中不受到刻蚀损伤，还可以确保半导体衬底101表面的平坦，提高后续光刻和刻蚀工艺的精度。较佳的，在本实施例中，在涂覆过程中，确保所覆盖的抗反射层104的顶部趋于平坦。步骤S03：请参阅图5，采用光刻和干法刻蚀工艺，图案化抗反射层104；具体的，本实施例中，图案化抗反射层104的过程可以但不限于包括以下步骤：步骤A01：在抗反射层上涂覆一层光刻胶；步骤A02：采用光刻工艺，图案化光刻胶；这里，可以根据实际工艺要求来选择合适的光刻版，对光刻胶进行曝光，在光刻胶中形成曝光后的图案，光刻版中关键尺寸的大小可以尽量增大，从而使得光刻后的光刻胶的宽度较大，足以遮挡住侧墙顶部，这样使得后续的图案化后的抗反射层104能够遮挡住侧墙103的顶部区域，使其不会受到后续减薄工艺的损伤。步骤A03：以图案化的光刻胶为掩膜，采用刻蚀工艺，图案化抗反射层。这里，可以但不限于采用等离子体干法刻蚀工艺，以上述图案化的光刻胶为掩膜，刻蚀抗反射层，从而暴露出部分栅极侧墙。当然，图案化后的抗反射层104的具体宽度则可以根据实际工艺要求来设定，比如，图案化后的抗反射层也可以覆盖住栅极侧墙顶部的一部分，如图4中左边的栅极两边的虚线a与a’之间的宽度；也可以将栅极侧墙顶部全部覆盖住，如图4中右边的栅极两边的虚线b与b’之间的宽度等。本实施例中，采用图4中虚线b与b’之间的宽度作为覆盖在栅极侧墙顶部的图案化后的抗反射层宽度。需要说明的是，本专利技术中，对于刻蚀过程中所采用的工艺参数可以本文档来自技高网...

【技术保护点】
一种栅极侧墙减薄工艺，其特征在于，包括：步骤S01：在半导体衬底上依次形成栅极和栅极侧墙；步骤S02：在所述半导体衬底上覆盖一层抗反射层；步骤S03：采用光刻和干法刻蚀工艺，图案化所述抗反射层；步骤S04：以图案化的所述抗反射层为掩膜，经干法刻蚀工艺，减薄所述栅极侧墙。

【技术特征摘要】
1.一种栅极侧墙减薄工艺，其特征在于，包括：步骤S01：在半导体衬底上依次形成栅极和仅位于栅极两侧的栅极侧墙；步骤S02：在所述半导体衬底上覆盖一层抗反射层；步骤S03：采用光刻和干法刻蚀工艺，图案化所述抗反射层；图案化后的所述抗反射层将栅极侧墙顶部全部覆盖住或覆盖住栅极侧墙顶部的第一部分；步骤S04：仅以图案化的所述抗反射层为掩膜，经干法刻蚀工艺，采用CH2F2和CHF3的混合气体，所述CH2F2与所述CHF3的流量比例为1:1至4:1，使得对栅极侧墙的刻蚀速率大于对抗反射层的刻蚀速率，从而减薄所述栅极侧墙。2.根据权利要求1所述的栅极侧墙减薄工艺，其特征在于，所述步骤S03中，采用HBr和O2的混合气体作为刻蚀气体。3.根据权利要求2所述的栅极侧墙减薄工艺，其特征在...

【专利技术属性】
技术研发人员：崇二敏，黄君，毛志彪，
申请(专利权)人：上海华力微电子有限公司，
类型：发明
国别省市：上海;31