This application reveals a CMOS output buffer circuit that supports cold backup applications, and belongs to the I/O port design field of integrated circuits. The CMOS output buffer circuit by using the ordinary PMOS and NMOS as well as the reasonable circuit design, the CMOS output buffer circuit in cold backup ports I/O realize at the same time, to avoid the possibility of losing power in the process of the output port to power leakage, improve the use of safety circuit.
【技术实现步骤摘要】
支持冷备份应用的CMOS输出缓冲电路
本申请属于集成电路I/O端口设计领域,尤其涉及一种支持冷备份应用的CMOS输出电路。
技术介绍
输入/输出(“I/O”)缓冲电路广泛应用于各种应用领域。输出缓冲电路通常是与外部总线(即公共的数字总线)相连,数字总线通常是由数据线和地址线等各种信号线组成的。这些数字总线连接了各种器件的I/O端口。一种典型的CMOS输出缓冲电路通常由一个PMOS管和一个NMOS管组成,在正电源VDD(如5V或3.3V)和负电源GND(通常是0V)之间串联连接,见图1。PMOS管P0和NMOS管N0的栅极分别连接到内部电路。内部电路控制着两个MOS管的栅极电压,决定了它们的开关状态,导致了输出缓冲电路的三种状态。一种状态是PMOS管P0导通和NMOS管N0关闭,输出缓冲电路的输出端口out输出高电平到外部。第二种状态是NMOS管N0导通和PMOS管P0关闭,输出缓冲电路的输出端口out输出低电平到外部。第三种状态是高阻态,此时两个MOS管都处于关闭状态,在这种状态下,输出缓冲电路与外部总线开路。除了与外部总线通讯外,CMOS输出缓冲电路还通常有其他功能。一种功能是保护内部电路免受静电放电(ESD)损伤。一般来讲,静电可能来自于人,当一个人拿着电子设备,静电电荷可以传输到电路内部,损伤电路上的MOS管等器件。解决静电损伤问题的一种常用方法是把输出缓冲电路的尺寸做大,减小静电放电时的导通电阻,让静电迅速泄放到VDD、GND或其他I/O端口。当一个连接外部总线的电路处于“冷备份”状态,即没有加电的状态时,冷备份的电路必须使与外部总线连接的端口保持 ...
【技术保护点】
一种支持冷备份应用的CMOS输出缓冲电路,其特征在于,所述CMOS输出缓冲电路包括第一NMOS管、第二NMOS管、第三NOMS管、第四NMOS管、第五NMOS管、第一PMOS管、第二PMOS管、第三PMOS管、第四PMOS管、第五PMOS管、第六PMOS管、第七PMOS管、第八PMOS管和与非门,其中:所述第一PMOS管的源极以及所述第四PMOS管的源极与所述CMOS输出缓冲电路的电源电性相连;所述第一NMOS管的栅极与所述与非门的输出端电性连接,所述第一NMOS管的源极接地,所述第一NMOS管的漏极、所述第二PMOS管的漏极、所述第一PMOS管的漏极以及所述第七PMOS管的源极均与所述CMOS输出缓冲电路的输出端口电性连接;所述第一PMOS管、所述第二PMOS管、所述第四PMOS管、所述第五PMOS管、所述第六PMOS管、所述第七PMOS管的衬底与所述第四PMOS管的漏极、所述第五PMOS管的源极、所述第六PMOS管的源极电性连接;所述第三PMOS管的源极、栅极和衬底与所述第一PMOS管的栅极电性连接;所述第七PMOS管的漏极与所述第八PMOS管的源极电性相连,所述第八PMOS管的漏 ...
【技术特征摘要】
1.一种支持冷备份应用的CMOS输出缓冲电路,其特征在于,所述CMOS输出缓冲电路包括第一NMOS管、第二NMOS管、第三NOMS管、第四NMOS管、第五NMOS管、第一PMOS管、第二PMOS管、第三PMOS管、第四PMOS管、第五PMOS管、第六PMOS管、第七PMOS管、第八PMOS管和与非门,其中:所述第一PMOS管的源极以及所述第四PMOS管的源极与所述CMOS输出缓冲电路的电源电性相连;所述第一NMOS管的栅极与所述与非门的输出端电性连接,所述第一NMOS管的源极接地,所述第一NMOS管的漏极、所述第二PMOS管的漏极、所述第一PMOS管的漏极以及所述第七PMOS管的源极均与所述CMOS输出缓冲电路的输出端口电性连接;所述第一PMOS管、所述第二PMOS管、所述第四PMOS管、所述第五PMOS管、所述第六PMOS管、所述第七PMOS管的衬底与所述第四PMOS管的漏极、所述第五PMOS管的源极、所述第六PMOS管的源极电性连接;所述第三PMOS管的源极、栅极和衬底与所述第一PMOS管的栅极电性连接;所述第七PMOS管的漏极与所述第八PMOS管的源极电性相连,所述第八PMOS管的漏极、栅极和衬底与所述第四PMOS管的栅极、所述第四NMOS管的漏极电性相连;所述第四NMOS管的源极与所述第五NMOS管的漏极电性相连,所述第五NMOS管的衬底与所述第四NMOS管的衬底、所述第五NMOS管的源极电性相连,所述第五NMOS管的源极接地;所述第五PMOS管的漏极、所述第六PMOS管的漏极以及所述第二NMOS管的漏极均与所述第一PMOS管的栅极电性相连;所述第二NMOS管的源极与所述第三NMOS管的漏极电性相连,所...
【专利技术属性】
技术研发人员:高国平,贺凌炜,罗静,王栋,
申请(专利权)人:中国电子科技集团公司第五十八研究所,
类型:发明
国别省市:江苏,32
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