【技术实现步骤摘要】
本专利技术涉及一种内连线结构及其开口的形成方法,尤其涉及一种单镶 嵌结构与双镶嵌结构及其开口的形成方法。
技术介绍
随着半导体技术的进步,半导体元件的尺寸也不断的缩小,而进入深亚微米(DeepSub-Micron)的领域中。当集成电路的集成度增加时,晶片的表 面无法提供足够的面积来制作所需的内连线(Interconnect),因此为了配合半 导体元件缩小后所增加的内连线,多层导体连线的设计,便成为超大型集 成电路技术所必须采用的方式。一般而言,多重内连线大多是利用镶嵌工艺来形成,其中包括单镶嵌 (single-damascene)工艺或双镶嵌(dual-damascene)工艺。目前,镶嵌工艺于介 电层中定义出沟渠(或开口)的方式是,先在介电层上形成氮化钛层(TiN)。然 后,在氮化钛层上形成具有沟渠(或开口)图案的光致抗蚀剂层。接着,将光 致抗蚀剂层的沟渠(或开口)图案转移至氮化钛层。接着,以具有沟渠(或开 口)图案的氮化钛层当作硬掩模,于介电层中定义出沟渠(或开口)。而且, 由于光刻工艺的限制,在镶嵌工艺中通常会在氮化钛层上形成有一层等离 子体增强式氧化层(plasma-enhanced oxide, PE-oxide),以提高工艺窗口 (process window),并以氮化钛层与等离子体增强式氧化层作为镶嵌工艺中 的硬掩模层。然而,在镶嵌工艺中仍有一些问题待解决。举例来说,在介电层中定 义出沟渠(或开口)的步骤前,必须经过二次蚀刻步骤,才能够在硬掩;f莫层中 定义出沟渠(或开口)图案。所谓二次蚀刻步骤包括第一次蚀刻步骤以及第 二次蚀刻步骤。其中 ...
【技术保护点】
一种单镶嵌开口的形成方法,包括:提供基底,该基底中已形成有导线;于该基底上依序形成阻障层、介电层、金属硬掩模层、氮氧化硅层、底部抗反射层以及图案化光致抗蚀剂层; 直接移除未被该图案化光致抗蚀剂层覆盖住的该底部抗反射层 、该氮氧化硅层以及该金属硬掩模层,至暴露出部分该介电层表面;移除该图案化光致抗蚀剂层以及该底部抗反射层;以及以该氮氧化硅层与该金属硬掩模层为掩模,移除部分的该介电层以及部分的该阻障层,以形成暴露出该导线的表面的镶嵌开口。
【技术特征摘要】
1.一种单镶嵌开口的形成方法,包括提供基底,该基底中已形成有导线;于该基底上依序形成阻障层、介电层、金属硬掩模层、氮氧化硅层、底部抗反射层以及图案化光致抗蚀剂层;直接移除未被该图案化光致抗蚀剂层覆盖住的该底部抗反射层、该氮氧化硅层以及该金属硬掩模层,至暴露出部分该介电层表面;移除该图案化光致抗蚀剂层以及该底部抗反射层;以及以该氮氧化硅层与该金属硬掩模层为掩模,移除部分的该介电层以及部分的该阻障层,以形成暴露出该导线的表面的镶嵌开口。2. 如4又利要求1所述的单镶嵌开口的形成方法,其中于形成该氮氧化 硅层之后,以及于形成该底部抗反射层之前,还包括于该氮氧化硅层上 形成氧化硅层。3. 如权利要求1所述的单镶嵌开口的形成方法,其中于形成该氮氣化 硅层之后,以及形成该底部抗反射层之前,还包括对该氮氧化硅层进行 表面 文质工艺,以于该氮氧化硅层上形成氧化层。4. 如权利要求3所述的单镶嵌开口的形成方法,其中该表面 文质工艺 包括以含氧气体进行等离子体工艺。5. 如权利要求1所述的单镶嵌开口的形成方法,其中该金属硬掩模层 的材料包括钽、氮化钽、钛、氮化钛、钨或氮化钨。6. 如权利要求1所述的单镶嵌开口的形成方法,其中该介电层的材料 包括低介电常数材料。7. 如权利要求1所述的单镶嵌开口的形成方法,其中该导线的材料包 括铜。8. —种单镶嵌结构,包括 基底,该基底中配置有导线; 阻障层,位于该基底上; 介电层,位于该阻障层上; 金属硬掩模层,位于该介电层上; 氮氧化硅层,位于该金属硬掩模层上, 其中该氮氧化硅层、该金属硬掩模层、该介电层以及该阻障层中具有暴露部分该导线的表面的镶嵌开口;以及 导体层,配置于该镶嵌开口中。9. 如权利要求8所述的单镶嵌结构,还包括氧化硅层,配置于该氮氧 化硅层上。10. 如权利要求8所述的单镶嵌结构,还包括氧化层,配置于该氮氧 化硅层上。11. 如权利要求8所述的单镶嵌结构,其中该介电层的材料包括低介 电常数材料。12. 如权利要求8所述的单镶嵌结构,其中该金属硬掩模层的材料包 括钽、氮化钽、钛、氮化钛、鴒或氮化钩。13. 如权利要求8所述的单镶嵌结构,其中该导线的材料包括铜。14. 一种双镶嵌开口的形成方法,包括 提供基底,该基底中已形成有导线;于该基底上依序形成阻障层、介电层、金属硬掩模层、氮氧化硅层、 第 一底部抗反射层与第 一 图案化光致抗蚀剂层;直接移除未被该第 一 图案化光致抗蚀剂层覆盖住的该第 一底部...
【专利技术属性】
技术研发人员:刘名馨,余佳勋,
申请(专利权)人:联华电子股份有限公司,
类型:发明
国别省市:71[中国|台湾]
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