支持新能力的可配置集成电路制造技术

技术编号:24205935 阅读:25 留言:0更新日期:2020-05-20 14:40
本公开涉及使集成电路(IC)能够适应更新的高速外围组件互连(PCIe)技术规范的新的PCIe能力。创建IC的跨越寄存器和功能编号的目标范围以适应新能力的固件可编程寄存器。主机向IC发出配置请求,包括新能力的寄存器和功能编号。当寄存器编号和功能编号处于目标范围内时,IC返回目标寄存器的值。主机更新该值并触发固件中断,将新能力添加到现有能力的列表中。

Configurable integrated circuits supporting new capabilities

【技术实现步骤摘要】
支持新能力的可配置集成电路相关申请的交叉引用本申请要求于2018年11月13日提交的申请号为62/760,107的美国临时申请的权益,该申请的全部内容通过引用并入本文。
本公开的实施例涉及一种集成电路(IC),该集成电路可配置以支持可由具有该IC作为组件的装置的新技术规范或更新的技术规范所需的新能力(capability)。
技术介绍
计算机环境范例已经转变为可在任何时间和任何地点使用的普适计算系统。因此,诸如移动电话、数码相机和笔记本计算机的便携式电子装置的使用已经快速增长。这些便携式电子装置通常使用具有存储器装置的存储器系统,即数据存储装置。数据存储装置用作便携式电子装置的主存储器装置或辅助存储器装置。用作存储器装置的数据存储装置因不具有移动部件而提供优良的稳定性、耐用性、高信息存取速度以及低功耗。具有这种优点的数据存储装置的示例包括通用串行总线(USB)存储器装置、具有各种接口的存储卡以及固态驱动器(SSD)。SSD可包括闪速存储器组件和控制器,该控制器包括将闪速存储器组件桥接到SSD输入/输出(I/O)接口的电子器件。SSD控制器可包括执行诸如固件的功能组件的嵌入式处理器。SSD功能组件通常是装置特定的,并且在大多数情况下可进行更新。两种主要类型的闪速存储器以NAND和NOR逻辑门命名。NAND型闪速存储器可以块(或页面)写入和读取,这些块(或页面)通常比整个存储空间小得多。NAND型闪速存储器主要在存储卡、USB闪存驱动器、固态驱动器(SSD)和类似产品中操作以用于数据的一般存储和传送。如上所述可进行集成的数据存储装置的控制器通常具有主机接口,该主机接口通过例如高速外围组件互连(PCIe)的接口协议与主机装置通信。这种协议由时时变化的技术规范进行定义。较新版本的技术规范可能加入了较新的能力,这些较新的能力可能需要新的逻辑以正确执行。在这种背景下,提出了本专利技术的实施例。
技术实现思路
本专利技术的实施例提供了一种可配置集成电路(IC),该集成电路能够支持其IC作为组件的新的或更新的装置技术规范所需的新能力。本专利技术的一个方面涉及用于向集成电路配置新能力的方法。一种这样的方法包括:针对集成电路创建固件可编程寄存器的组,寄存器的组跨越寄存器编号和功能编号的目标范围以适应新能力;由主机向集成电路发出配置操作请求,配置操作请求包括新能力的寄存器编号和功能编号;检查寄存器编号和功能编号是否处于目标范围内;当寄存器编号和功能编号处于目标范围内时,由集成电路向主机返回该组的目标寄存器的值;由主机更新该值;并且触发固件中断以将该新能力添加到现有能力列表中。本专利技术的另一方面包括一种为端点内核启用新能力的系统。该系统包括:固件能力模块,针对新能力定义寄存器空间;以及根联合体(rootcomplex),配置与端点内核的写入和读取事务,包括发出新能力的寄存器编号和功能编号。端点内核被配置成检查寄存器编号和功能编号是否处于寄存器空间内,并且将寄存器空间内的目标寄存器的值返回到根联合体。根联合体被进一步配置成更新该值,并且触发固件中断以将新能力添加到现有能力列表中。本专利技术的其它方面包括用于向高速外围组件互连(PCIe)控制器添加新能力的方法,该控制器当前实施由各个主机地址指向的多个能力,最后的能力指向空(null)。一种这样的方法包括:利用固件来重新编程多个能力中的一个,以指向由主机地址定义的地址范围内的新地址;根据新能力的技术规范,利用固件来对与新地址相关联的新定义的寄存器值进行编程;利用固件对位进行编程以定义多个条件;利用固件对目标功能进行编程以对应于物理功能;并且启用主机访问的配置空间以执行配置读取和写入操作并更新新能力的寄存器值。从以下描述中,本专利技术另外的方面将变得显而易见。附图说明图1是示出根据本专利技术的实施例的存储器系统的框图。图2是示出根据本专利技术的实施例的存储器系统的框图。图3是示出根据本专利技术的实施例的存储器系统的存储器装置的存储块的电路图。图4是示出根据本专利技术的实施例的高速外围组件互连(PCIe)拓扑的示意图。图5示出根据本专利技术的实施例的链接PCI/PCIe能力并使集成电路(IC)能够支持新定义的能力。图6是示出根据本专利技术的实施例的使IC能够支持新定义的能力的步骤的流程图。具体实施方式以下参照附图更详细地描述各个实施例。然而,本专利技术可以不同形式实施,因此不应被解释为限于本文阐述的实施例。相反地,提供这些实施例以使本公开是彻底且充分的,并且将本专利技术的范围全面地传达给本领域技术人员。此外,本文中对“实施例”、“另一实施例”等的参考不一定仅针对一个实施例,并且对任何这种短语的不同参考不一定针对相同的实施例。在整个公开中,相同的附图标记在本专利技术的附图和实施例中表示相同的部件。本专利技术可以多种方式实施,包括作为进程;设备;系统;物质的组成;呈现在计算机可读存储介质上的计算机程序产品;和/或处理器,诸如适于执行存储在联接到处理器的存储器上的指令和/或由联接到处理器的存储器提供的指令的处理器。在本说明书中,这些实施方式或本专利技术可能采取的任何其它形式可被称为技术。通常,所公开进程的步骤的顺序可在本专利技术的范围内改变。除非另有说明,否则被描述为适于执行任务的诸如处理器或者存储器的组件可被实施为暂时配置成在给定时间执行任务的一般组件或被制造为执行任务的特定组件。如本文所使用的,术语“处理器”等指适于处理诸如计算机程序指令的数据的一个或多个装置、电路和/或处理内核。下面提供了本专利技术的实施例的详细描述以及示出本专利技术各方面的附图。结合这些实施例描述本专利技术,但是本专利技术不限于任何实施例。本专利技术的范围仅由权利要求限定。本专利技术包括处于权利要求范围内的许多替换、修改和等同物。为了提供对本专利技术的全面理解,在下面的描述中阐述了许多具体细节。为了示例的目的提供这些细节,并且可在没有一些或所有这些具体细节的情况下,根据权利要求实施本专利技术。为了清楚,没有详细描述与本专利技术相关的
中公知的
技术实现思路
,以免不必要地模糊本专利技术。图1是示意性地示出根据本专利技术的实施例的存储器系统的框图。参照图1,存储器系统10可包括存储器控制器100和半导体存储器装置200,该半导体存储器装置200可代表多于一个这种装置。半导体存储器装置200可以是闪速存储器装置,特别是NAND型的闪速存储器装置。为了简洁,有时将存储器控制器100简称为控制器100,并且有时将半导体存储器装置200简称为存储器装置200。如图1所示,主机装置5可联接到存储器系统10。存储器控制器100可控制存储器装置200的全部操作。存储器装置200可在存储器控制器100的控制下执行一个或多个擦除操作、编程操作和读取操作。存储器装置200可通过输入/输出(I/O)线接收命令CMD、地址ADDR和数据DATA。存储器装置200可通过电源线接收电力PWR,并且通过控制线接收控制信号CTRL。控制信号CTRL可包括命令锁存启用(C本文档来自技高网
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【技术保护点】
1.一种向集成电路配置新能力的方法,所述方法包括:/n针对集成电路创建固件可编程寄存器的组,所述寄存器的组跨越寄存器编号和功能编号的目标范围以适应新能力;/n由主机向所述集成电路发出配置操作请求,所述配置操作请求包括所述新能力的寄存器编号和功能编号;/n检查所述寄存器编号和所述功能编号是否处于所述目标范围内;/n当所述寄存器编号和所述功能编号处于所述目标范围内时,由所述集成电路向所述主机返回所述组的目标寄存器的值;/n由所述主机更新所述值;并且/n触发固件中断,以将所述新能力添加到现有能力的列表中。/n

【技术特征摘要】
20181113 US 62/760,1071.一种向集成电路配置新能力的方法,所述方法包括:
针对集成电路创建固件可编程寄存器的组,所述寄存器的组跨越寄存器编号和功能编号的目标范围以适应新能力;
由主机向所述集成电路发出配置操作请求,所述配置操作请求包括所述新能力的寄存器编号和功能编号;
检查所述寄存器编号和所述功能编号是否处于所述目标范围内;
当所述寄存器编号和所述功能编号处于所述目标范围内时,由所述集成电路向所述主机返回所述组的目标寄存器的值;
由所述主机更新所述值;并且
触发固件中断,以将所述新能力添加到现有能力的列表中。


2.根据权利要求1所述的方法,其中所述寄存器的组包括多个寄存器类型。


3.根据权利要求2所述的方法,其中所述多个寄存器类型包括读取/写入即RW、只读即RO、读取/写入1以清除即RW1C以及保留即RSVD。


4.根据权利要求1所述的方法,其中所述更新进一步包括为所述目标寄存器设置许可。


5.根据权利要求4所述的方法,其中所述许可包括读取、写入和保留许可。


6.一种为端点内核启用新能力的系统,所述系统包括:
固件能力模块,针对所述新能力定义寄存器空间;
根联合体,配置与所述端点内核的写入和读取事务,包括发出所述新能力的寄存器编号和功能编号;
所述端点内核检查所述寄存器编号和所述功能编号是否处于所述寄存器空间内,并且将所述寄存器空间内的目标寄存器的值返回到所述根联合体;
所述根联合体进一步更新所述值,并且触发固件中断以将所述新能力添加到现有能力的列表中。


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【专利技术属性】
技术研发人员:毛金良
申请(专利权)人:爱思开海力士有限公司
类型:发明
国别省市:韩国;KR

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