用于与非易失性存储器通信的方法和系统技术方案

一种装置，包括存储器接口模块和与存储器接口模块通信的存储器控制器。存储器接口模块配置为与第一和第二存储器条进行通信。响应于从主机系统接收多个存储器命令，存储器控制器生成多个命令序列。多个命令序列的每个对应于多个存储器命令的一个。多个命令序列的一些包括第一部分和第二部分，并且第一部分和第二部分的每个是原子的。多个命令序列的每个与优先级相关联。基于相关联的优先级，多个命令序列的一个被选择。多个命令序列的一个的第一部分被发送到第一存储器条或第二存储器条的任一个。

【技术实现步骤摘要】
【国外来华专利技术】
本申请一般涉及在存储器系统中管理数据。更具体地，本申请涉及存储器系统的操作以改善在与具有多个裸芯或条的可重复编程的非易失性半导体闪速存储器通信中的并行性。
技术介绍
这里提供的
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描述是为了一般呈现本公开的上下文的目的。当前提名的专利技术人的工作，以及其它在提交时可能否则有资格作为现有技术的说明书的方面，在该
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部分中描述的程度上，既没有明示也没有暗示地承认作为针对本公开的现有技术。复杂的操作系统(OS)为通用计算机以及如数码相机、扫描仪等的专用装置提供动力。OS的常常被吹捧的优点之一是其允许用户同时使用多个软件应用。经常地，这些软件应用访问经由硬件接口连接到装置的处理器的硬件组件。取决于系统架构，硬件组件可以共享公共硬件接口。硬件接口可以包含PCI总线、USB总线、ISA总线、ATAPI总线和/或允许经由硬件接口与处理器通信的多个硬件组件的任何专有接口。经由硬件接口访问硬件组件可以取决于访问的类型消耗有限的时间量。为了该讨论的目的，硬件组件包含闪速存储器、紧凑式闪速、打印机、扫描仪、硬盘驱动器、DVD、CD、USB存储棒等。为了访问的持续时间，其它软件应用有时被锁定在访问连接到硬件接口的其它硬件组件之外。如果另一个应用需要访问另一个硬件组件以进行时间严格的操作，这是不期望的。可能期望的是，共享在以有序的并且可配置的方式的若干应用程序之间的公共硬件接口。另外，软件应用程序和硬件组件之间传送的数据的量取决于访问的类型。例如，硬件组件的状态检查可以仅消耗少量的时间。与此相反，传送包括若干兆字节的数据文件可以消耗更大量的时间。时间密集的访问可以通过向访问部署可用的硬件资源而被加快。可能期望的是，基于量化或者限制访问的类型的度量而将硬件资源分配到访问。如果这样的分配(和解除分配)以灵活的、透明的方式进行，一般地，稀少的和有限的硬件资源可以被明智地用于优化系统的操作。
技术实现思路
为了解决在多个条和/或多个裸芯存储器系统中的改善的存储器管理的需要，这里公开了用于实现在与闪速条通信中的并行性的方法和系统。根据一个方面，公开了一种在闪速存储器系统中通信数据的方法。在一个实施例中，闪速存储器包括存储器控制器和闪速装置。闪速存储器系统接收包括用于在存储器控制器和第一闪速装置之间通信数据的第一集合的资源。基于第一模板，闪速存储器系统配置用于在存储器控制器和第一闪速装置之间通信数据的第一集合的资源。根据该方法，闪速存储器系统经由第一集合的资源引起在存储器控制器和第一闪速装置之间通信数据。响应于接收到包括用于在存储器控制器和第一闪速装置通信数据的第二集合的资源的第二模板，基于第二模板，闪速存储器系统配置用于在存储器控制器和第一闪速装置之间通信数据的第二集合的资源。最后，闪速存储器系统经由第二集合的资源引起在存储器控制器和第一闪速装置之间通信数据。根据另一个方面，公开了一种用于与闪速装置通信的系统。该系统包括具有闪速接口模块的存储器控制器。存储器控制器适配为通信地耦接到主机系统。存储器控制器配置为接收模板。模板包括用于基于模板在存储器控制器和的闪速装置之间通信数据的第一集合的资源。存储器控制器适配为配置用于在存储器控制器和第一闪速装置之间通信数据的第一集合的资源。最后，闪速接口模块被可通信地耦接到存储器控制器。闪速接口模块配置为经由第一集合的资源在存储器控制器和第一闪速装置之间通信数据。根据一个方面，公开了一种用于在闪速存储器系统中通信数据的方法。在一个实施例中，闪速存储器系统包括存储器控制器、第一闪速装置和第二闪速装置，第一和第二闪速装置经由公共闪速接口被可通信地耦接到存储器控制器。在接收到用于在存储器控制器和第一闪速装置之间通信数据的第一命令时，基于第一命令，存储器控制器从逻辑数据路径的集合选择逻辑数据路径的第一子集，该逻辑数据路径的第一子集在存储器控制器和第一闪速装置之间。存储器控制器配置逻辑数据路径的第一子集以在存储器控制器和第一闪速装置之间通信数据。最后，存储器控制将第一闪速命令通信到第一闪速装置以经由逻辑数据路径的第一子集启动数据的通信，其中，第一闪速命令对应于接收到的命令。根据另一个方面，公开了一种用于在存储器控制器、第一闪速装置和第二闪速装置之间进行通信数据的系统。该系统包括存储器系统、数据路径管理器(DPM)和存储器控制器。该存储器系统配置为从主机处理器接收闪速命令。此外，响应于接收到闪速命令，存储器系统配置为将闪速命令序列通信到第一闪速装置或第二闪速装置中的一个。另外，数据路径管理器(DPM)配置为从逻辑数据路径的集合选择逻辑数据路径的第一子集，并配置为在存储器控制器和第一闪速装置或第二闪速装置的任一个之间通信数据。根据一个方面，公开了一种用于在闪速存储器系统中管理数据的方法。在一个实施例中，闪速存储器系统包括存储器控制器、第一闪速条和第二闪速条，第一和第二闪速条经由公共闪速接口被可通信地耦接到存储器控制器。存储器控制器从第一闪速命令生成第一命令序列，其中第一命令序列包括第一部分和第二部分，并且从第二闪速命令生成第二命令序列，其中第二命令序列包括至少一个部分。该方法包括，存储器控制器基于第一标准和第二标准选择第一命令序列，其中，第一标准与第一命令序列相关联，并且第二标准与第二命令序列相关联。该方法还包括，经由公共闪速接口将第一命令序列的第一部分通信到第一闪速条;在通信第一部分之后，在通信第一命令序列的第二部分之前，经由公共闪速接口将第二命令序列的至少一部分通信到第二闪速条。最后，在通信第二命令序列的至少一部分之后，经由公共闪速接口，存储器控制器将第一命令序列的第二部分通信到第一闪速条。根据另一个方面，公开了一种在存储器控制器中实现的用于经由公共闪速接口与第一闪速条和第二闪速条通信的方法。响应于接收到第一闪速命令，存储器控制器确定第一存储器命令旨在将被通信到第一闪速条。此外，存储器控制器从第一闪速命令生成命令序列，其中命令序列包括两个部分，并且其中每个部分包括一系列命令，其中命令的系列是原子的，并且其中每个部分包括第一闪速条的标识。存储器控制器将命令序列的第一部分通信到第一闪速条。最后，响应于检测到在第一部分中的命令，生成指示，其中该指示指明命令序列的第一部分已经被通信到第一闪速条。根据又一个方面，公开了一种用于与第一闪速条和第二闪速条通信的存储器控制器。存储器控制器包括闪速接口模块，该闪速接口模块配置为用于与第一和第二闪速条进行通信，以及与闪速接口模块进行通信的处理器。处理器配置为，响应于从主机系统接收多个闪速命令，生成多个命令序列。多个命令序列的每个对应于多个闪速命令的相应的一个。多个命令序列的一些包括第一部分和第二部分。第一部分和第二部分的每个是原子的。此夕卜，多个命令序列的每个与优先级相关联。处理器进一步配置为，经由闪速接口模块，基于与多个命令序列的一个相关联的优先级，选择多个命令序列的一个，并将多个命令序列的一个的第一部分顺序地发送到第一闪速条或第二闪速条的任一个。当回顾下面的附图、详细的描述和权利要求书时，其它特征和优点将变得显而易见。此外，公开了其它实施例，并且每个实施例可以单独使用或组合在一起使用。现在将参照附图描述实施例。【附图说明】图1示出了与具有包含本文档来自技高网...

【技术保护点】
一种用于管理存储器系统中的通信的方法，所述存储器系统包括存储器控制器、第一非易失性存储器(NVM)条和第二非易失性存储器条，所述第一非易失性存储器条和所述第二非易失性存储器条经由公共存储器接口可通信地耦接到所述存储器控制器，所述方法包括所述存储器控制器：从第一存储器命令生成第一命令序列，其中，所述第一命令序列包括第一部分和第二部分，并且从第二存储器命令生成第二命令序列，其中所述第二命令序列包括至少一个部分；基于第一标准和第二标准选择所述第一命令序列，其中，所述第一标准与所述第一命令序列相关联，并且所述第二标准与所述第二命令序列相关联；经由所述公共存储器接口将所述第一命令序列的第一部分通信到所述第一非易失性存储器条；在通信所述第一部分之后，并且在通信所述第一命令序列的所述第二部分之前，经由所述公共存储器接口将所述第二命令序列的所述至少一部分通信到所述第二非易失性存储器条；在通信所述第二命令序列的所述至少一部分之后，经由所述公共存储器接口将所述第一命令序列的所述第二部分通信到所述第一非易失性存储器条。

【技术特征摘要】
【国外来华专利技术】...

【专利技术属性】
技术研发人员：G林，M戴维森，M巴洛卡斯，A格塔，
申请(专利权)人：桑迪士克科技股份有限公司，
类型：发明
国别省市：美国;US