【技术实现步骤摘要】
各个实施例涉及一种具有减小的寄生“侧壁”晶体管区域的晶体管结构。
技术介绍
特定低功率模拟电路利用各种类型的场效应晶体管(例如,互补金属氧化物半导体“CMOS”;金属氧化物半导体场效应晶体管“MOSFET”;金属绝缘体半导体场效应晶体管“MISFET”等)。一些低功率应用使用这种晶体管的匹配的对,然而,这些晶体管的“匹配”性质在较低的操作电流下开始变差。这是因为,在低功率应用中,晶体管在所谓的“弱反型”模式(或者亚阈值区域)下操作,在“弱反”模式下,流动着低的漏极电流(Ids)。进一步地,当在亚阈值区域中操作时,会对晶体管的性能造成不利影响的各种现象可能变得占优势。这些不利现象中的一些不利现象涉及典型场效应晶体管的机械结构。在大多数MOSFET器件中,所谓的“侧壁”晶体管形成在栅极区域的边缘处、并且对这种器件的性能造成不利的影响,特别是当给定的应用要求晶体管的精确匹配的对时。
技术实现思路
在各个实施例中,提供了一种晶体管结构。该晶体管结构可以包括:在衬底中的第一杂质类型的阱区域,在该阱区域中具有至少一个晶体管;第一杂质类型的结构,该第一杂质类型的结构包围阱区域;以及沟槽或场氧化物隔离层,该沟槽或场氧化物隔离层包围该结构。附图说明在附图中,类似的附图标记在不同视图中一般表示本公开的相同部分。附图并不一定按比例绘制,而是一般将重点放在说明本公开的原理上。在以下说明 ...
【技术保护点】
一种晶体管结构,包括:衬底;第一杂质类型的阱区域,所述阱区域在所述衬底中;至少一个晶体管,所述至少一个晶体管至少部分地形成在所述阱区域上,所述阱区域的部分包括晶体管沟道;第一杂质类型的结构,所述结构在所述衬底中,所述结构包围所述阱区域;以及隔离层,所述隔离层在所述衬底的部分上,所述隔离层包围所述结构;其中在包围所述阱区域的所述结构中的所述第一杂质类型的浓度高于在所述阱区域中的所述第一杂质类型的浓度。
【技术特征摘要】
2014.12.30 US 14/585,2111.一种晶体管结构,包括:
衬底;
第一杂质类型的阱区域,所述阱区域在所述衬底中;
至少一个晶体管,所述至少一个晶体管至少部分地形成在所述阱
区域上,所述阱区域的部分包括晶体管沟道;
第一杂质类型的结构,所述结构在所述衬底中,所述结构包围所
述阱区域;以及
隔离层,所述隔离层在所述衬底的部分上,所述隔离层包围所述
结构;
其中在包围所述阱区域的所述结构中的所述第一杂质类型的浓
度高于在所述阱区域中的所述第一杂质类型的浓度。
2.根据权利要求1所述的晶体管结构,
其中所述第一杂质类型包括p型掺杂剂,并且第二杂质类型包括
n型掺杂剂。
3.一种晶体管结构,包括:
衬底;
第一杂质类型的阱区域,所述阱区域在所述衬底中;
至少一个晶体管,所述至少一个晶体管至少部分地形成在所述阱
区域上,所述晶体管具有在所述阱区域中的漏极区域、以及至少部分
地在所述阱区域中的多个源极区域,所述源极区域围绕着所述栅极区
域布置;
所述阱区域包括多个沟道,所述多个沟道将所述漏极区域与所述
多个源极区域分开;
第一杂质类型的结构,所述结构在所述衬底中,所述结构包围所
述阱区域;以及
隔离层,所述隔离层在所述衬底中,所述隔离层包围所述隔离结
构;
其中在包围所述阱区域的所述结构中的所述第一杂质类型的浓
度高于在所述阱区域中的所述第一杂质类型的浓度。
4.根据权利要求3所述的晶体管结构,进一步包括:
氧化物层,所述氧化物层在所述阱区域上方,所述氧化物层包围
所述漏极区域、并且在所述多个沟道中的每个沟道之上延伸;以及
栅极电极,所述栅极电极在所述氧化物层上。
5.根据权利要求4所述的晶体管结构,其中
所述氧化物层的横向延伸由所述第一杂质类型的所述结构定界。
6.根据权利要求3所述的晶体管结构,
其中所述漏极区域包括基本上为正方形的结构;以及
其中所述多个源极区域包括4个源极区域,所述4个源极区域围
绕着所述漏极区域的周界,基本上布置成十字形配置。
7.根据权利要求3所述的晶体管结构,
其中所述漏极区域包括基本上为八边形的结构;以及
其中所述多个源极区域包括8个源极区域,所述8个源极区域围
绕着所述漏极扩散区域的周界,基本上布置成八边形配置。
8.根据权利要求3所述的晶体管结构,
其中所述漏极区域包括基本上为圆形的结构;以及
其中所述多个源极区域包括基本上为环形的结构,所述基本上为
环形的结构与所述漏极区域同心地布置。
9.根据权利要求8所述的晶体管结构,
其中所述栅极电极包括:基本上为环形的结构,所述基本上为环
形的结构与所述漏极区域同心地定位;以及平面部分,所述平面部分
在所述漏极区域和所述多个源极区域之上延伸。...
【专利技术属性】
技术研发人员:H·罗斯雷内尔,
申请(专利权)人:英飞凌科技股份有限公司,
类型:发明
国别省市:德国;DE
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