一种FPGA时钟信号自我检测方法，涉及控制模块技术领域，所解决的是提高FPGA芯片运行的可靠性与安全性的技术问题。该方法为FPGA芯片引入两个时钟信号，其中的一个时钟信号为第一时钟信号，另一个时钟信号为第二时钟信号；利用第一时钟信号控制FPGA芯片内的所有同步逻辑，利用第二时钟信号来检测第一时钟信号是否正确。本发明专利技术提供的方法，特别适用于以FPGA芯片作为主控制器或者重要控制部件的系统。
【技术实现步骤摘要】
本专利技术涉及控制模块技术，特别是涉及一种FPGA时钟信号自我检测方法的技术。
技术介绍
由于FPGA技术具有很高的可靠性，并且便于验证，所以FPGA技术在核电保护系统中具有良好的前景。目前很多公司都在大力开发基于FPGA的核电保护系统。时钟信号是FPGA芯片的重要输入信号，FPGA芯片内部所有同步逻辑的运行都基于该信号，但是目前时钟信号的稳定可靠性都是依赖于信号发生源的，一旦信号发生源出现故障，将导致FPGA芯片的运算错误，从而引发安全事故。
技术实现思路
针对上述现有技术中存在的缺陷，本专利技术所要解决的技术问题是提供一种能避免因时钟信号故障而导致的运算错误，从而能提高FPGA芯片运行的可靠性与安全性的FPGA时钟信号自我检测方法。为了解决上述技术问题，本专利技术所提供的一种FPGA时钟信号自我检测方法，其特征在于，为FPGA芯片引入两个时钟信号，其中的一个时钟信号为第一时钟信号，另一个时钟信号为第二时钟信号； 利用第一时钟信号控制FPGA芯片内的所有同步逻辑，利用第二时钟信号来检测第一时钟信号，具体检测方法为: 第二时钟信号每经过N个周期，就检测一次第一时钟信号，如果第一时钟信号在该段时间内所经过的周期数小于A或大于B，则判定第一时钟信号产生错误； 其中，N为预先设定的周期数阈值，A为预先设定的周期数下限值，B为预先设定的周期数上限值。进一步的，所述第一时钟信号的频率与第二时钟信号的频率相异。进一步的，所述第一时钟信号的频率大于第二时钟信号的频率。进一步的，所述第一时钟信号的频率为50MHZ，第二时钟信号的频率为19.6608MHZ，N=65536，A=166654，B=166680。本专利技术提供的FPGA时钟信号自我检测方法，利用第一时钟信号控制FPGA芯片内的所有同步逻辑，利用第二时钟信号来检测第一时钟信号是否正确，能提高FPGA芯片运行的可靠性与安全性，能避免因时钟信号故障而导致的运算错误。【具体实施方式】以下结合具体实施例对本专利技术的技术方案作进一步详细描述，但本实施例并不用于限制本专利技术，凡是采用本专利技术的相似结构及其相似变化，均应列入本专利技术的保护范围。本专利技术实施例所提供的一种FPGA时钟信号自我检测方法，其特征在于，为FPGA芯片引入两个时钟信号，其中的一个时钟信号为第一时钟信号，另一个时钟信号为第二时钟信号; 利用第一时钟信号控制FPGA芯片内的所有同步逻辑，利用第二时钟信号来检测第一时钟信号，具体检测方法为: 第二时钟信号每经过N个周期，就检测一次第一时钟信号，如果第一时钟信号在该段时间内所经过的周期数小于A或大于B，则判定第一时钟信号产生错误； 其中，N为预先设定的周期数阈值，A为预先设定的周期数下限值，B为预先设定的周期数上限值。本专利技术实施例中，所述第一时钟信号的频率与第二时钟信号的频率相异，其中的第一时钟信号的频率为50MHZ，第二时钟信号的频率为19.6608MHZ，N=65536，A=166654，B=166680o本专利技术实施例特别适用于以FPGA芯片作为主控制器或者重要控制部件的系统。【主权项】1.一种FPGA时钟信号自我检测方法，其特征在于，为FPGA芯片引入两个时钟信号，其中的一个时钟信号为第一时钟信号，另一个时钟信号为第二时钟信号； 利用第一时钟信号控制FPGA芯片内的所有同步逻辑，利用第二时钟信号来检测第一时钟信号，具体检测方法为: 第二时钟信号每经过N个周期，就检测一次第一时钟信号，如果第一时钟信号在该段时间内所经过的周期数小于A或大于B，则判定第一时钟信号产生错误； 其中，N为预先设定的周期数阈值，A为预先设定的周期数下限值，B为预先设定的周期数上限值。2.根据权利要求1所述的FPGA时钟信号自我检测方法，其特征在于:所述第一时钟信号的频率与第二时钟信号的频率相异。3.根据权利要求2所述的FPGA时钟信号自我检测方法，其特征在于:所述第一时钟信号的频率大于第二时钟信号的频率。4.根据权利要求3所述的FPGA时钟信号自我检测方法，其特征在于:所述第一时钟信号的频率为 50MHZ，第二时钟信号的频率为 19.6608MHZ，N=65536，A=166654，B=166680。【专利摘要】一种FPGA时钟信号自我检测方法，涉及控制模块
，所解决的是提高FPGA芯片运行的可靠性与安全性的技术问题。该方法为FPGA芯片引入两个时钟信号，其中的一个时钟信号为第一时钟信号，另一个时钟信号为第二时钟信号；利用第一时钟信号控制FPGA芯片内的所有同步逻辑，利用第二时钟信号来检测第一时钟信号是否正确。本专利技术提供的方法，特别适用于以FPGA芯片作为主控制器或者重要控制部件的系统。【IPC分类】G01R31-00【公开号】CN104777378【申请号】CN201510101454【专利技术人】姜群兴, 王晓凯, 司胜剑, 裴宇森, 朱怀宇, 叶韬, 周兵, 史腾 【申请人】国核自仪系统工程有限公司【公开日】2015年7月15日【申请日】2015年3月9日本文档来自技高网...
【技术保护点】
一种FPGA时钟信号自我检测方法，其特征在于，为FPGA芯片引入两个时钟信号，其中的一个时钟信号为第一时钟信号，另一个时钟信号为第二时钟信号；利用第一时钟信号控制FPGA芯片内的所有同步逻辑，利用第二时钟信号来检测第一时钟信号，具体检测方法为：第二时钟信号每经过N个周期，就检测一次第一时钟信号，如果第一时钟信号在该段时间内所经过的周期数小于A或大于B，则判定第一时钟信号产生错误；其中，N为预先设定的周期数阈值，A为预先设定的周期数下限值，B为预先设定的周期数上限值。
【技术特征摘要】
【专利技术属性】
技术研发人员：姜群兴，王晓凯，司胜剑，裴宇森，朱怀宇，叶韬，周兵，史腾，
申请(专利权)人：国核自仪系统工程有限公司，
类型：发明
国别省市：上海;31
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