一种半导体器件电容结构及其制作方法技术

本发明专利技术公开了一种半导体器件电容结构及其制作方法，是在半导体基底上依次形成下极板和介电质层后，先形成第一金属层，再依次覆盖第一保护层和绝缘层后，依次蚀刻第一金属层顶部的绝缘层和第一保护层形成电容通孔，再形成第二保护层覆盖绝缘层表面及电容通孔内壁，然后制作第二金属层，第二金属层通过电容通孔与第一金属层接触以形成上极板，通过本发明专利技术的设置改善电容中电荷集中区域的结构，避免三种材料交界，减少应力作用，有效隔离制作过程中和使用过程中的水汽等污染，提高可靠度以及器件使用寿命。本发明专利技术的方法工艺步骤少，成本低。

A capacitor structure of semiconductor device and its fabrication method

【技术实现步骤摘要】
一种半导体器件电容结构及其制作方法
本专利技术涉及电容结构，特别是涉及一种高可靠性的半导体器件电容结构及其制作方法。
技术介绍
随着设备技术的发展，化合物半导体的工艺能力越来越高，对于三极管等主动元器件的可靠度的控制能力越来越强。随之而来的被动元器件的短板就显现出来。芯片对于电容的可靠度尤其在高温高湿方面要求也越来越高。现有的半导体器件的电容结构，通常是在已完成器件制程的晶片上依次形成下极板金属层、介质层和上极板金属层，并在其周边涂覆有机物绝缘层以弥补高度差使整个结构平坦，这将会在介质层、金属层和绝缘层之间形成无机化合物、金属和有机物三者的交界区域，由于此处为电容结构的电荷集中区域，因不同材料之间结合的相互作用在此处应力最大，在芯片老化测试过程中容易烧毁而导致器件可靠性失效。此外，由于有机绝缘材料抵挡水汽能力较弱，从而器件阻挡水汽能力减低，容易受到水汽等侵蚀而失效。因此，设计一种高可靠性的电容结构对于器件的性能提升具有重要的意义。
技术实现思路
本专利技术的目的在于克服现有技术之不足，提供一种高可靠性的半导体器件电容结构及其制作方法。本专利技术解决其技术问题所采用的技术方案是：本专利技术提供了一种半导体器件电容结构的制作方法，该方法包括以下步骤：1)于一半导体基底的预设区域上形成下极板金属层；2)沉积电容介电质层；3)于下极板金属层上方形成第一金属层；4)沉积第一保护层；5)涂覆有机物绝缘材料形成绝缘层；6)依次去除所述第一金属层顶部的绝缘层和第一保护层，形成电容通孔；7)沉积第二保护层，去除所述电容通孔底部的第二保护层；8)于所述电容通孔之内形成第二金属层，所述第二金属层与所述第一金属层相接触并构成上极板金属层。可选的，所述第一金属层的材料是Ti/Pt/Au/Ti叠层，通过蒸镀或溅镀形成。可选的，所述第一保护层的材料是与所述电容介电质层或所述介电质层表层相同的绝缘材料。可选的，步骤6)中，所述绝缘层和所述第一保护层在同一道光阻下进行蚀刻形成所述电容通孔。可选的，步骤6)中，通过涂布光阻，进行曝光和显影形成预设蚀刻窗口，首先通过干法蚀刻去除所述预设蚀刻窗口之内的绝缘层，然后通过干法蚀刻去除所述预设蚀刻窗口之内的第一保护层形成第一开口，最后通过干法蚀刻侧向蚀刻所述绝缘层至所述绝缘层的开口大于所述第一开口，从而形成所述电容通孔，然后去除光阻。可选的，所述绝缘层的蚀刻剂是O2，所述第一保护层的蚀刻剂是SF6。可选的，所述第二保护层的材料是氮化硅。可选的，所述第二保护层的厚度是200～500nm。可选的，所述第二金属层通过溅镀与电镀工艺形成，厚度为1000nm-5000nm。本专利技术还提供了上述方法制作的半导体器件电容结构。本专利技术的有益效果是：1.通过第一金属层、第一保护层和第二金属层的设置改善电容中电荷集中区域的结构，通过第一保护层和第二保护层的设置使得整个电容结构中均无三种材料的交界区域，减少应力作用，避免材料间结合不良的问题，进一步提高可靠度以及器件使用寿命；2.在芯片生产流程和后续封装过程中，通过第二保护层可以有效的减少卤族元素和水汽对有机物绝缘材料的侵袭，增强电路和电容对于封装制程的适应性。在实际运用场景中，可以完美的提升电路和电容对于高温高湿的适应性；3.本专利技术的方法中，绝缘层和第一保护层经过一次黄光、一次蚀刻步骤形成电容通孔，通孔结构易于控制，工艺步骤少，生产成本低。附图说明图1为本专利技术实施例的工艺流程图，图中所示依次为各步骤得到的结构示意图；图2为本专利技术实施例的半导体器件的电容结构示意图。具体实施方式以下结合附图及实施例对本专利技术作进一步详细说明。本专利技术的各附图仅为示意以更容易了解本专利技术，其具体比例可依照设计需求进行调整。文中所描述的图形中相对元件的上下关系，在本领域技术人员应能理解是指构件的相对位置而言，因此皆可以翻转而呈现相同的构件，此皆应同属本说明书所揭露的范围。此外，图中所示的元件及结构的个数，均仅为示例，并不以此对数目进行限制，实际可依照设计需求进行调整。实施例，参考图1，一种半导体器件电容结构的制作方法为：1)提供已通过常规手段进行隔离处理的半导体基底1，所述隔离处理是将半导体特性转变成绝缘特性，防止在半导体基底上形成的电容漏电；隔离处理方式例如通过离子注入的方式或在半导体基底上形成绝缘层。半导体基底可以为Si等，也可以为化合物半导体基底，例如SiC、GaAs、InP等；以GaAs基底为例，于基底1上涂布光阻，并进行曝光和显影形成预设图形。用蒸镀或者溅镀的方式沉积金属，用N-甲基吡咯烷酮等化学药液将光阻剥离后留下所需图形形成下极板金属层2。所述下极板金属层2可以是例如Ti/Pt/Au/Ti叠层，总厚度100～1000nm，其中Ti层厚度范围3～50nm，Pt层厚度范围20～50nm。2)用PECVD的方式沉积一层SiN作为电容介电质层3，厚度根据电容值的需求进行设置，例如50～200nm。此外，介电质层也可以是SiN/SiO2/SiN等叠层复合膜。3)涂布光阻，并进行曝光和显影形成预设图形，用蒸镀或者溅镀的方式沉积金属，用N-甲基吡咯烷酮等化学药液将光阻剥离后于下极板金属层2上方留下所需图形形成第一金属层41。第一金属层41优选位于下极板金属层2中间，且宽度小于下极板金属层2。第一金属层41可以是例如Ti/Pt/Au/Ti叠层，总厚度100～1000nm，其中Ti层厚度范围为3～50nm，Pt层厚度范围为20～50nm。4)用PECVD的方式沉积一层氮化硅作为第一保护层5，厚度从100nm到500nm。5)在步骤4)形成的结构表面涂布厚度为1300～2000nm的聚酰亚胺(PI)作为绝缘层6，烘烤后聚酰亚胺硬化。6)用光阻经过涂布、曝光和显影后形成预设蚀刻窗口，预设蚀刻窗口位于第一金属层41顶部；用ICP或者RIE对绝缘层6进行干法刻蚀，蚀刻剂是O2，去除预设蚀刻窗口之内的聚酰亚胺裸露底部的第一保护层5；然后对第一保护层5进行干法蚀刻，蚀刻剂是SF6，去除预设蚀刻窗口之内的第一保护层5形成第一开口51，裸露底部的第一金属层41；最后再采用O2对绝缘层6进行干法蚀刻去除预设蚀刻窗口之内残留的聚酰亚胺材料，并对绝缘层6产生侧向蚀刻，保证绝缘层6的开口61大于第一开口51，两者共同形成电容通孔A；然后用N-甲基吡咯烷酮等化学药液将光阻剥离。7)用PECVD沉积上一层200nm到500nm的氮化硅作为第二保护层7，涂布光阻，进行曝光和显影形成对应电容通孔A的蚀刻窗口，通过干法蚀刻去除所述蚀刻窗口之内的第二保护层7以使电容通孔A底部的第一金属层41裸露；留下的第二保护层7覆盖绝缘层6全部表面，包括了电容通孔A的内壁，从而形成一个封闭的结构，将绝缘层6完全与外界环境隔离开来，在后续生产制程中，避免了卤族元素和水汽对聚酰亚胺侵袭本文档来自技高网...

【技术保护点】
1.一种半导体器件电容结构的制作方法，其特征在于包括以下步骤：/n1)于一半导体基底的预设区域上形成下极板金属层；/n2)沉积电容介电质层；/n3)于下极板金属层上方形成第一金属层；/n4)沉积第一保护层；/n5)涂覆有机物绝缘材料形成绝缘层；/n6)依次去除所述第一金属层顶部的绝缘层和第一保护层，形成电容通孔；/n7)沉积第二保护层，去除所述电容通孔底部的第二保护层；/n8)于所述电容通孔之内形成第二金属层，所述第二金属层与所述第一金属层相接触并构成上极板金属层。/n

【技术特征摘要】
1.一种半导体器件电容结构的制作方法，其特征在于包括以下步骤：
1)于一半导体基底的预设区域上形成下极板金属层；
2)沉积电容介电质层；
3)于下极板金属层上方形成第一金属层；
4)沉积第一保护层；
5)涂覆有机物绝缘材料形成绝缘层；
6)依次去除所述第一金属层顶部的绝缘层和第一保护层，形成电容通孔；
7)沉积第二保护层，去除所述电容通孔底部的第二保护层；
8)于所述电容通孔之内形成第二金属层，所述第二金属层与所述第一金属层相接触并构成上极板金属层。


2.根据权利要求1所述的制作方法，其特征在于：所述第一金属层的材料是Ti/Pt/Au/Ti叠层，通过蒸镀或溅镀形成。


3.根据权利要求1所述的制作方法，其特征在于：所述第一保护层的材料是与所述电容介电质层或所述介电质层表层相同的绝缘材料。


4.根据权利要求1所述的制作方法，其特征在于：步骤6)中，所述绝缘层和所述第一保护层在同一道光阻下进行蚀刻形成所述电容通...

【专利技术属性】
技术研发人员：林鑫，王勇，魏鸿基，
申请(专利权)人：厦门市三安集成电路有限公司，
类型：发明
国别省市：福建;35