【技术实现步骤摘要】
晶圆级封装、半导体器件单元及其制造方法
本公开的实施方式总体上可以涉及封装技术,并且更具体地,涉及晶圆级封装、半导体器件单元及其制造方法。
技术介绍
在半导体封装技术中,随着更小的电子系统或产品的发展,对扇出晶圆级封装(FOWLP)的需求日益增加。根据FOWLP,输入/输出(I/O)端子可以设置在FOWLP中的每一个中包括的芯片的外部区域上。因此,能够减小芯片的尺寸,并且能够在FOWLP中使用标准化的球布局。因此,可以在移动产品中广泛地采用FOWLP。可以在不使用任何印刷电路板(PCB)的情况下在移动产品中采用FOWLP。因此,可以使用FOWLP来实现薄且紧凑的移动产品。然而,为了制造可靠的FOWLP,必须解决翘曲现象和芯片移位现象。
技术实现思路
根据实施方式,可以提供一种晶圆级封装。所述晶圆级封装可以包括并排地设置在互连结构层上的半导体芯片。所述晶圆级封装可以包括附接至所述半导体芯片的加固夹具(reinforcementzig)。所述晶圆级封装可以包括模制层,所述模制层覆盖所述半导体芯片并且嵌入所述加固夹具。根据实施方式,可以提供一种晶圆级封装。所述晶圆级封装可以包括设置在互连结构层上的半导体芯片。所述晶圆级封装可以包括加固夹具,所述加固夹具按照包括至少一个条部的方式附接至所述半导体芯片的表面。所述晶圆级封装可以包括模制层,所述模制层覆盖所述半导体芯片并且嵌入所述加固夹具。根据实施方式,可以提供一种制造晶圆级封装的方法。该方法可以包括将半导体芯片的第一表面附接至载体。该方法可以包括将加固夹具附接至所述半导体芯片的第二表面。该方法可以包括形成覆盖所述半导体芯 ...
【技术保护点】
1.一种晶圆级封装,该晶圆级封装包括:半导体芯片,所述半导体芯片被并排地设置在互连结构层上;加固夹具,该加固夹具附接至所述半导体芯片;以及模制层,该模制层覆盖所述半导体芯片并且嵌入所述加固夹具。
【技术特征摘要】
2017.04.04 KR 10-2017-00435721.一种晶圆级封装,该晶圆级封装包括:半导体芯片,所述半导体芯片被并排地设置在互连结构层上;加固夹具,该加固夹具附接至所述半导体芯片;以及模制层,该模制层覆盖所述半导体芯片并且嵌入所述加固夹具。2.根据权利要求1所述的晶圆级封装,其中,所述加固夹具包括:条部,所述条部附接至所述半导体芯片;以及边缘部,该边缘部与所述条部连接。3.根据权利要求2所述的晶圆级封装,其中,所述条部彼此交叉,以提供具有网格形状的网状部;并且其中,所述半导体芯片被设置在由所述网状部和所述边缘部包围并限定的内部空间中。4.根据权利要求2所述的晶圆级封装,其中,所述加固夹具的所述边缘部按照覆盖所述模制层的侧壁的方式延伸。5.根据权利要求1所述的晶圆级封装,其中,所述加固夹具包含不锈钢材料、合金材料或玻璃材料。6.根据权利要求1所述的晶圆级封装,其中,所述加固夹具的热膨胀系数低于所述模制层的热膨胀系数。7.根据权利要求1所述的晶圆级封装,其中,所述加固夹具包含刚性比所述模制层大的材料。8.根据权利要求1所述的晶圆级封装,该晶圆级封装还包括粘合层,所述粘合层按照将所述半导体芯片永久地接合至所述加固夹具的方式设置在所述半导体芯片中的每一个和所述加固夹具之间。9.根据权利要求8所述的晶圆级封装,其中,所述粘合层被设置在所有所述半导体芯片上。10.根据权利要求1所述的晶圆级封装,其中,所述互连结构层包括用于将所述半导体芯片与外部装置电连接的迹线图案;并且其中,所述迹线图案中的至少一个按照与模制层交叠的方式延伸。11.根据权利要求1所述的晶圆级封装,其中,所述互连结构层包括用于将所述半导体芯片与外部连接端子电连接的迹线图案;并且其中,所述迹线图案中的至少一个按照与模制层交叠的方式延伸。12.一种晶圆级封装,该晶圆级封装包括:半导体芯片,该半导体芯片被设置在互连结构层上;加固夹具,该加固夹具按照包括至少一个条部的方式附接至所述半导体芯片的表面;以及模制层,该模制层覆盖所述半导体芯片并且嵌入所述加固夹具。13.根据权利要求12所述的晶圆级封装,其中,所述至少一个条部包括两个条部;并且其中,所述两个条部彼此交叉,以提供与所述加固夹具对应的网状部。14.根据权利要求12所述的晶圆级封装,其中,所述加固夹具包含不锈钢材料、合金材料或玻璃材料,其中,所述加固夹具的热膨胀系数低于所述模制层的热膨胀系数,并且其中,所述加固夹具包含刚性比所述模制层大的材料。15.一种半导体器件单元,该半导体器件单元包括:半导体芯片,该半导体芯片被设置在互连结构层上;以及保护层,该保护层附接至所述半导体芯片并且包括:模制层,该模制层覆盖所述半导体芯片;以及网状部,该网...
【专利技术属性】
技术研发人员:南宗铉,
申请(专利权)人:爱思开海力士有限公司,
类型:发明
国别省市:韩国,KR
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