【技术实现步骤摘要】
【国外来华专利技术】相关申请的交叉引用本申请要求递交于2014年6月26日、申请号为14/316,615的美国专利申请的权益,并且还根据35U.S.C.§119(e)要求递交于2013年12月2日、申请号为61/910,764的美国临时专利申请的权益,两个申请均通过引用以其整体被并入本文用于所有目的。
本公开大体涉及存储单元,并且更具体地,涉及具有共源极线的存储单元。背景非易失性存储设备当前广泛应用在当电力不可用或被终止时要求信息保存的电子组件中。非易失性存储设备可以包括只读存储器(ROM)、可编程只读存储器(PROM)、可擦除可编程只读存储器(EPROM)和电可擦除可编程只读存储(EEPROM)设备。如今一些存储器阵列利用可以包括存储元件或电荷存储层的晶体管和栅极结构。电荷存储层可以被编程为基于施加于存储器阵列或被存储器阵列接收的电压来储存数据。附图简述图1图示了根据一些实施例实现的存储设备的例子的示意图。图2图示了根据一些实施例实现的存储设备的另一个例子的示意图。图3图示了根据一些实施例实现的存储单元的布局的例子。图4图示了根据一些实施例实现的若干存储单元的布局的例子。图5图示了根据一些实施例实现的存储单元的布局的截面的例子。图6图示了根据一些实施例实现的存储单元的布局的另一个例子。图7图示了根据一些实施例实现的编程方法的例子的流程图。图8图示了根据一些实施例实现的擦除方法的例子的流程图 ...
【技术保护点】
一种方法,包括:在第一晶体管接收第一电压,所述第一晶体管被耦合到第二晶体管,所述第一晶体管和所述第二晶体管被包括在第一存储单元中;在第三晶体管接收第二电压,所述第三晶体管被耦合到第四晶体管,所述第三晶体管和所述第四晶体管被包括在第二存储单元中,所述第一存储单元和所述第二存储单元被耦合到共源极线;在所述第二晶体管的栅极和所述第四晶体管的栅极接收第三电压;以及在所述第一晶体管的栅极接收第四电压,所述第四电压通过Fowler‑Nordheim隧穿引起被包括在所述第一晶体管中的电荷存储层的一个或多个电性质的变化。
【技术特征摘要】
【国外来华专利技术】2013.12.02 US 61/910,764;2014.06.26 US 14/316,6151.一种方法,包括:
在第一晶体管接收第一电压,所述第一晶体管被耦合到第二晶体管,
所述第一晶体管和所述第二晶体管被包括在第一存储单元中;
在第三晶体管接收第二电压,所述第三晶体管被耦合到第四晶体管,
所述第三晶体管和所述第四晶体管被包括在第二存储单元中,所述第一存
储单元和所述第二存储单元被耦合到共源极线;
在所述第二晶体管的栅极和所述第四晶体管的栅极接收第三电压;以
及
在所述第一晶体管的栅极接收第四电压,所述第四电压通过
Fowler-Nordheim隧穿引起被包括在所述第一晶体管中的电荷存储层的一
个或多个电性质的变化。
2.根据权利要求1所述的方法,还包括:
通过所述共源极线在所述第二晶体管的源极和所述第四晶体管的源
极接收第五电压,并且
其中所述第三电压使所述第二晶体管和所述第四晶体管在截止模式
下操作。
3.根据权利要求2所述的方法,其中所述第五电压在大约-0.5V和-5V
之间。
4.根据权利要求1所述的方法,其中所述第一电压在所述第一晶体管
的漏极被接收,并且其中所述第二电压在所述第三晶体管的漏极被接收。
5.根据权利要求4所述的方法,其中所述第一电压在大约-0.5V和-5V
之间,并且其中所述第二电压在大约0.5V和5V之间。
6.根据权利要求4所述的方法,其中所述第一电压和所述第四电压之
间的差值在大约4V和12V之间。
7.根据权利要求1所述的方法,其中所述第三电压在大约-0.5V和-5V
之间。
8.根据权利要求1所述的方法,其中所述第一晶体管是硅-氧化物-氮
化物-氧化物-硅(SONOS)晶体管。
9.根据权利要求8所述的方法,其中所述第四电压通过
Fowler-Nordheim隧穿引起所述SONOS晶体管中的电荷存储层的一个或多
个电性质的变化。
10.根据权利要求8所述的方法,其中所述电荷存储层包括选自以下
项组成的组的至少一种材料:氮氧化硅、氧化铝,氧化铪、氧化铪铝、氧
化锆、硅酸铪、硅酸锆、氮氧化铪、氧化铪锆和氧化镧。
11.一种设备,包括:
第一晶体管,其被配置为通过第一位线接收第一电压;
第二晶体管,其被耦合到所述第一晶体管和共源极线;
第三晶体管,其被配置为通过第二位线接收第二电压;以及
第四晶体管,其被耦合到所述第三晶体管和所述共源极线;
其中所述第一晶体管包括电荷存储层,所述电荷存储层被配置为响应
于接收所述...
【专利技术属性】
技术研发人员:禹小军,范卡特拉曼·普拉哈卡,伊葛·G·葛兹尼索夫,龙·T·辛赫,波·金,
申请(专利权)人:赛普拉斯半导体公司,
类型:发明
国别省市:美国;US
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