【技术实现步骤摘要】
用于刻划密封结构的方法及设备相关申请案交叉参考本申请案依据35U.S.C.§119(a)主张2016年9月7日在印度提出申请的标题为“METHODSANDAPPARATUSFORSCRIBESEALSTRUCTURES”的共同拥有的临时专利申请案(将德州仪器有限公司指定为申请人的第201641030533号印度专利申请案)的优先权权益,所述印度专利申请案据此以其全文引用方式并入本文中。
本专利技术一般来说涉及在半导体装置及集成电路制造中使用刻划密封,且更特定来说涉及用以使用磁及电容耦合增强裸片间RF耦合及裸片间耦合的刻划密封。
技术介绍
集成电路形成为半导体晶片上的多个裸片。对半导体晶片执行各种工艺步骤,所述工艺步骤包含:通过使用杂质掺杂及离子植入在半导体材料内形成有源区域;沉积且图案化绝缘体层;及形成例如金属层的导体层。绝缘体层形成于半导体衬底上方且形成于导体层之间及周围,以提供导体层之间的电绝缘。导体层包含例如经掺杂多晶硅、铝、金及铜导体层的材料。另一绝缘体层形成于整个装置上方且称为“钝化层”或有时称为“保护外涂层”或“PO”层。钝化层提供电绝缘以及保护以免受潮湿及可腐蚀或不利地影响导体及半导体衬底的其它杂质的影响。绝缘体层为有时可能被视为陶瓷材料(例如二氧化硅、氮化硅、氮氧化硅、碳化硅及聚酰亚胺)的薄脆性电介质材料层。通常为铝或另一导体的接合垫层可形成于最上部绝缘体层的顶部处,且由PO层覆盖。接合垫接着由PO层的开口部分暴露。接合线可机械且电耦合到接合垫以在集成电路裸片作为集成电路经完成时形成封装式集成电路的端子。可替代接合线或与接合线一起使用焊料球 ...
【技术保护点】
一种集成电路裸片,其包括:上覆于半导体衬底上的多个下部层级导体层、位于所述多个下部层级导体层之间且环绕所述下部层级导体层的多个下部层级绝缘体层、垂直延伸穿过所述下部层级绝缘体层且电耦合所述下部层级导体中的若干者的多个下部层级导通孔、上覆于所述下部层级导体层上的多个上部层级导体层、位于所述上部层级导体层之间且环绕所述上部层级导体层的多个上部层级绝缘体层、垂直延伸穿过所述上部层级绝缘体层且耦合所述上部层级导体层的多个上部层级导通孔;至少两个刻划密封,其定位于所述集成电路裸片的外围处且彼此间隔开,所述至少两个刻划密封包含所述上部层级导体层、所述上部层级导通孔、所述下部层级导体层及所述下部层级导通孔以形成从所述半导体衬底垂直延伸到在所述集成电路裸片的上表面处的钝化层的垂直阻挡层;及至少一个开口,其垂直延伸穿过所述至少两个刻划密封中的相应一者且延伸穿过:所述上部层级导体层、所述上部层级导通孔层、所述下部层级导体层及所述下部层级导通孔层。
【技术特征摘要】
2016.09.07 IN 201641030533;2016.11.04 US 15/343,551.一种集成电路裸片,其包括:上覆于半导体衬底上的多个下部层级导体层、位于所述多个下部层级导体层之间且环绕所述下部层级导体层的多个下部层级绝缘体层、垂直延伸穿过所述下部层级绝缘体层且电耦合所述下部层级导体中的若干者的多个下部层级导通孔、上覆于所述下部层级导体层上的多个上部层级导体层、位于所述上部层级导体层之间且环绕所述上部层级导体层的多个上部层级绝缘体层、垂直延伸穿过所述上部层级绝缘体层且耦合所述上部层级导体层的多个上部层级导通孔;至少两个刻划密封,其定位于所述集成电路裸片的外围处且彼此间隔开,所述至少两个刻划密封包含所述上部层级导体层、所述上部层级导通孔、所述下部层级导体层及所述下部层级导通孔以形成从所述半导体衬底垂直延伸到在所述集成电路裸片的上表面处的钝化层的垂直阻挡层;及至少一个开口,其垂直延伸穿过所述至少两个刻划密封中的相应一者且延伸穿过:所述上部层级导体层、所述上部层级导通孔层、所述下部层级导体层及所述下部层级导通孔层。2.根据权利要求1所述的集成电路裸片,其中所述至少两个刻划密封进一步包含与所述至少一个开口间隔开的第二开口。3.根据权利要求1所述的集成电路裸片,其中所述至少两个刻划密封的所述至少一个开口在所述集成电路裸片的角落中。4.根据权利要求1所述的集成电路裸片,其中所述至少两个刻划密封具有定位于所述集成电路裸片的一侧的中心部分中的开口,且所述至少两个刻划密封中的第一刻划密封的所述至少一个开口在与所述至少两个刻划密封中的第二刻划密封的所述至少一个开口相对的侧上。5.根据权利要求1所述的集成电路裸片,且其中所述至少两个刻划密封进一步包含:第一经掺杂扩散区,其在所述半导体衬底中、具有第一导电类型的第一浓度;及第二经掺杂扩散区,其在所述半导体衬底中、具有所述第一导电类型的第二浓度且环绕所述第一经掺杂扩散区;其中所述半导体衬底具有不同于所述第一导电类型的第二导电类型。6.根据权利要求1所述的集成电路裸片,其中所述至少两个刻划密封进一步包含具有经耦合以接收偏置电压的条带部分的至少一个下部层级导体。7.一种设备,其包括:多个集成电路裸片,其位于半导体衬底上且彼此间隔开,且具有形成于所述多个集成电路裸片中的相应者的外围处的多个刻划密封,所述多个刻划密封进一步包含:多个下部层级导体层,其上覆于所述半导体衬底上;多个下部层级绝缘体层,其位于所述下部层级导体层之间且环绕所述下部层级导体层;多个下部层级导通孔,其垂直延伸穿过所述下部层级绝缘体层且电耦合所述下部层级导体;多个上部层级导体层,其上覆于所述下部层级导体层上;多个上部层级绝缘体层,其位于所述多个上部层级导体层之间且环绕所述多个上部层级导体层;多个上部层级导通孔,其垂直延伸穿过所述上部层级绝缘体层且耦合所述上部层级导体层;及至少一个开口,其垂直延伸穿过所述刻划密封中的每一者且切穿以下各项中的每一者:所述上部层级导体层、所述上部层级导通孔层、所述下部层级导体层及所述下部层级导通孔层。8.根据权利要求7所述的设备,其中所述多个刻划密封形成围绕所述集成电路裸片的所述外围的垂直...
【专利技术属性】
技术研发人员:S·幕克吉,R·塞尔瓦拉杰,V·戈皮纳坦,
申请(专利权)人:德州仪器公司,
类型:发明
国别省市:美国,US
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