【技术实现步骤摘要】
本专利技术是一种用于数字复接的码速调整技术及其实现电路。输出抖动大小是码速调整数字复接的主要技术指标。在数字复接器中普遍采用了正码速调整技术。国际电联(CCITT)已建议正码速调整的输出抖动在20ui%到35ui%之间。目前已有的正码速调整复接器,如日本、美国、西欧各国的正码速调整复接器商品,1984年西方十国在我国展出的复接器及1984年国外向我国投标的复接器,其输出抖动指标均同CCITT建议。数字通信的许多业务,如图象、载波等对抖动指标的要求是很严格的。CCITT已建议的正码速调整输出指标不能完全满足这种要求。同时,抖动在数字系统中是随码速调整转接次数的增加而线性积累的,CCITTG703建议规定了系统总抖动不能大于150ui%的容限,这种容限限制了已有的正码速调整器在需要频繁转接的数字系统中的应用。因此,需要研究如何减小码速调整输出抖动。国际电联(CCITT)1984年国际会议把如何减小码速调整输出抖动问题列入了1985-1988年研究期的研究课题。本专利技术的目的是要减小正码速调整的输出抖动。正码速调整的输出抖动是脉冲塞入等候抖动。这种等候抖动的大小取决于脉冲塞入比ρ,一般说来,ρ值越大,等候抖动越大。CCITT建议的正码速调整的塞入比为0.4左右,比较大。已有的正码速调整器通常直接在这个塞入比上调整,因而有较大的等候抖动,从而使输出抖动较大。本专利技术基于塞入比越小,等候抖动越小的原理,将塞入比ρ分成ρ1和ρ2两部分,ρ=ρ1+ρ2。其中,ρ1为简单分式 (N)/(M) ,并且ρ1小于且接近于容差范围内ρ的最小值ρmin,同时, (l)/(M) · ...
【技术保护点】
一种正(或负)码速调整技术,其特征是根据塞入比与等候抖动的关系,分离塞入比减小等候抖动。
【技术特征摘要】
1.一种正(或负)码速调整技术,其特征是根据塞入比与等候抖动的关系,分离塞入比减小等候抖动。2.按照权利要求1所说的码速调整减小等候抖动技术,其特征是将总塞入比ρ分离成ρ1和ρ2两部分,且ρ=ρ1+ρ2。3.按照权利要求2所说的码速调整减小等候抖动技术,其特征是塞入比ρ1为固定值,塞入比ρ2为随机值,且ρ1= (N)/(M) ,ρ1小于且接近ρmin, (I)/(M) fsmax>>fL。4.一种按权利要求1所说的码速调整减小等...
【专利技术属性】
技术研发人员:曾烈光,冯重熙,
申请(专利权)人:清华大学,
类型:发明
国别省市:11[中国|北京]
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