【技术实现步骤摘要】
本专利技术总的来说涉及嵌入式控制器系统，更具体地说涉及在嵌入式控制器系统中的串并总线接口。在采用嵌入式微控制器的系统中，对微控制器的可用的I/O引脚和设备上的存储器的限制造成对系统设计的难以接受的制约。可用的I/O引脚的数量限制了能够被微控制器访问的地址空间的大小。还限制了地址空间中的总线设备的大小和数量。这不仅限制了软件和数据可用的存储器的容量，而且限制了微控制器可访问的外部设备。此外，设备上的非易失性存储器容量一般非常有限，这使得外部存储器中对操作软件的存储显得非常重要。微控制器通常是一次性可编程(“OTP”)器件，因此一旦将软件装入芯片上的非易失性存储器后，就不能修改。在不更换微控制器芯片的情况下，不能更新系统软件。因此，需要将系统软件存储在外部存储器空间中的非易失性可编程存储器中。然后，更新系统软件可以通过将新的软件下载到非易失性存储器中。然而，将系统软件存储在外部存储器空间中而不是存储在芯片中也有I/O引脚的数量受到限制的问题。因此，需要有一种将微控制器与包含其操作软件的非易失性存储器接口的方法和电路，于是在不超过微控制器的引脚数目的情况下，通过将...
【技术保护点】
一种微控制器系统包括： 具有至少一条并行输入／输出（“Ｉ／Ｏ”）总线和一个串行数据口的微控制器； 串／并接口逻辑电路，具有一个串行数据口，一条并行地址总线，和一条并行数据总线，所述串行数据口用于与所述微控制器的所述串行数据口联系，其中在所述微控制器的所述串行数据口上传递的第一数据值作为一个并行数据值出现在所述并行数据总线上，所述串／并接口逻辑电路在所述串／并接口逻辑电路的所述并行地址总线上提供一个地址；以及 总线设备，用于接收所述串／并接口逻辑电路的所述并行地址总线上的所述地址，所述总线设备访问所述数据总线，以便传递所述并行数据值。
【技术特征摘要】
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【专利技术属性】
技术研发人员：古义明，TQ纽伊恩，
申请(专利权)人：国际商业机器公司，
类型：发明
国别省市：US[美国]
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