【技术实现步骤摘要】
电容阵列及其制造方法和存储器
本申请涉及半导体器件的制造方法
,特别是涉及一种电容阵列及其制造方法和存储器。
技术介绍
动态随机存储器(DRAM)包括用于存储电荷的电容器以及与电容器相连接的晶体管。DRAM以在电容器上存储电荷的形式存储数据,需要在每几个毫秒的间隔内将电容器作规则性的充电放电。电容器的电容越大,储存在DRAM中的数据也可被维持得越久。传统工艺在制备DRAM中的电容器的过程中,在CAPEH(电容刻蚀)形成电容孔后,电容的上支撑层顶部仍然存在约200nm的多晶硅层,需要通过刻蚀、清洗等步骤除去该多晶硅层,工艺难度高且制得的电容结构存在稳定性差和电容值较小的问题。
技术实现思路
基于此,有必要针对传统工艺难度高、制得的电容结构存在稳定性差和电容值较小的问题,提供一种新的电容阵列及其制造方法。一种电容阵列的制造方法,包括:提供衬底;于所述衬底的上表面形成包括交替层叠的牺牲层及支撑层的叠层结构;于所述叠层结构的上表面形成图形化掩模层;基于所述图形化掩模层刻蚀所述叠层结构,以形成通孔;形成所述通孔后所述叠层结构上表面保留具有预设厚度的图形化掩模层;所述通孔至少沿厚度方向贯穿所述具有预设厚度的图形化掩模层及所述叠层结构;于所述通孔的侧壁及底部形成第一电极;于所述具有预设厚度的图形化掩模层及所述叠层结构内形成开口,所述开口暴露出所述牺牲层,并基于所述开口去除所述牺牲层;于所述第一电极的表面形成电容介质层;于所述电容介质层表面形成第二电极。在其中一个实施例中,形成所述叠 ...
【技术保护点】
1.一种电容阵列的制造方法,其特征在于,包括:/n提供衬底;/n于所述衬底的上表面形成包括交替层叠的牺牲层及支撑层的叠层结构;/n于所述叠层结构的上表面形成图形化掩模层;/n基于所述图形化掩模层刻蚀所述叠层结构,以形成通孔;形成所述通孔后所述叠层结构上表面保留具有预设厚度的图形化掩模层;所述通孔至少沿厚度方向贯穿所述具有预设厚度的图形化掩模层及所述叠层结构;/n于所述通孔的侧壁及底部形成第一电极;/n于所述具有预设厚度的图形化掩模层及所述叠层结构内形成开口,所述开口暴露出所述牺牲层,并基于所述开口去除所述牺牲层;/n于所述第一电极的表面形成电容介质层;/n于所述电容介质层表面形成第二电极。/n
【技术特征摘要】
1.一种电容阵列的制造方法,其特征在于,包括:
提供衬底;
于所述衬底的上表面形成包括交替层叠的牺牲层及支撑层的叠层结构;
于所述叠层结构的上表面形成图形化掩模层;
基于所述图形化掩模层刻蚀所述叠层结构,以形成通孔;形成所述通孔后所述叠层结构上表面保留具有预设厚度的图形化掩模层;所述通孔至少沿厚度方向贯穿所述具有预设厚度的图形化掩模层及所述叠层结构;
于所述通孔的侧壁及底部形成第一电极;
于所述具有预设厚度的图形化掩模层及所述叠层结构内形成开口,所述开口暴露出所述牺牲层,并基于所述开口去除所述牺牲层;
于所述第一电极的表面形成电容介质层;
于所述电容介质层表面形成第二电极。
2.根据权利要求1所述的电容阵列的制备方法,其特征在于,形成所述叠层结构的步骤包括:
于所述衬底上表面形成第一支撑层;
于所述第一支撑层上表面形成第一牺牲层;
于所述第一牺牲层上表面形成第二支撑层;
于所述第二支撑层上表面形成第二牺牲层;
于所述第二牺牲层上表面形成第三支撑层。
3.根据权利要求2所述的电容阵列的制备方法,其特征在于,基于所述图形化掩模层刻蚀所述叠层结构的过程中,刻蚀气体对所述第一支撑层、所述第二支撑层及所述第三支撑层与所述图形化掩模层的刻蚀选择比为3~5,所述刻蚀气体对所述第一牺牲层及所述第二牺牲层与所述图形化掩模层的刻蚀选择比大于10。
4.根据权利要求3所述的电容阵列的制备方法,其特征在于,所述刻蚀气体包括含氟气体与氧气的混合气体或所述含氟气体与氢气的混合气体。
5.根据权利要求2所述的电容阵列的制备方法,其特征在于,所述第三支撑层的厚度大于所述第一支撑层及所述第二支撑层的厚度。
6.根据权利要求1所述的电容阵列的制备方法,其特征在于,所述图形化掩模层的材料为多晶硅。
7.根据权利要求1所述的电容阵列的制备方法,其特征在于,所述预设厚度为150nm-250nm。
8.根据权利要求2所述的电容阵列的制备方法,其特征在于,所述于所述具有预设厚度的图形化掩模层及所述叠层结构内形成开口,所述开口暴露出所述牺牲层,并基于所述开口去除所述牺牲层,包括:
于所述具有预设厚度的图形化掩...
【专利技术属性】
技术研发人员:杨校宇,赵亮,
申请(专利权)人:长鑫存储技术有限公司,
类型:发明
国别省市:安徽;34
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