一种芯片封装方法及芯片技术

本申请公开了提供一种芯片封装方法及芯片，在基板上贴敷粘性带，将待封装芯片以正面朝下倒扣放置在粘性带上；对封装芯片四周进行塑封，将芯片背面磨平，使芯片背面与塑封顶面平齐；去除基板和粘性带，形成芯片正面和背面均裸露、四周设有第一塑封的封装体；通过芯片正背面直接裸露的封装方式，降低了腔体式封装结构的体积，提高信号传输效率和速度，并可集成于传统IC封装、FOWLP、FIWLP、SIP等封装类型之中，芯片上下裸露的方式加大了芯片的散热面积，提高了组件及组件间的散热性能。

A chip packaging method and chip

【技术实现步骤摘要】
一种芯片封装方法及芯片
本申请涉及一种芯片封装方法及芯片。
技术介绍
本部分的陈述仅仅是提供了与本公开相关的
技术介绍
，并不必然构成现有技术。在芯片封装时，对具有特殊封装要求的芯片需要进行定制化设计，特别是传感器类的封装，芯片封装一般都不采用传统IC的封装形式，而采用传感器芯片功能部分或整体芯片裸露的腔体式封装，这种封装的优点在于可以直接将传感器芯片裸露在特殊模具制定的型腔中，将电路连接作用的芯片使用塑封料半包裹或者直接裸露在空气中，能够最佳的发挥传感器芯片的性能。专利技术人发现，上述的腔体式封装体需要以载板为支撑，通过几种不同的材质(芯片贴片胶水、芯片、焊丝)将芯片和线路进行联通，然后使用特殊的模具填充塑封料将芯片部分包裹或者整体裸露在空气中，这些材料的堆叠组装使整个塑封体与芯片的体积比远远大于1:1，不利于器件间信号的高效率传输，而且占用了较大的空间，整体的体积和厚度无法做到最优化，封装体散热能力有较大的局限性，间接的影响了产品的性能和未来封装小、快、灵的大趋势。
技术实现思路
本申请的目的是针对现有技术存在的缺陷，提供一种芯片封装方法及芯片，通过芯片正背面直接裸露的封装方式，降低了腔体式封装结构的体积，提高信号传输效率和速度，并可集成于传统IC封装、FOWLP、FIWLP、SIP等封装类型之中，芯片上下裸露的方式加大了芯片的散热面积，提高了组件及组件间的散热性能。本申请的第一目的是提供一种芯片封装方法，采用以下技术方案：在基板上贴敷粘性带，将待封装芯片以正面朝下倒扣放置在粘性带上；对封装芯片四周进行塑封，将芯片背面磨平，使芯片背面与塑封顶面平齐；去除基板和粘性带，形成芯片正面和背面均裸露、四周设有第一塑封的封装体。进一步地，当封装体应用于IC封装时，在第一塑封的上方、芯片正面一侧进行再布线(RDL，redistributionlayer)，实现新的电路layer，在芯片与layer布线区之间打线，对封装体上方进行二次塑封，形成第二塑封结构。进一步地，所述第二塑封对芯片正面裸露部分进行部分遮挡形成窗口结构，或第二塑封对芯片正面裸露部分无遮挡形成敞开式结构。进一步地，当封装体应用于FOWLP、FIWLP封装之中时，在封装体对应芯片正面一侧依次进行二次塑封和三次塑封，形成第二塑封结构和第三塑封结构，所述第三塑封远离第二塑封的一侧设有载板，所述第二塑封与第三塑封进行RDL布线，芯片正面依次通过金属导体、RDL导线、金属导体后与载板外部的金属球导通。进一步地，在进行二次塑封时，塞入第一金属导体，使其与芯片正面导通；在进行三次塑封前，在第二塑封的顶部进行RDL布线；在进行三次塑封时，塞入第二金属导体，使第二金属导体依次通过RDL导线、第一金属导体后与芯片正面导通。进一步地，当封装体应用于SIP系统级封装时，在SIP系统级封装中与其他元器件通过线路互联。进一步地，所述芯片的正面和背面裸露部分均通过线路与外部其他元器件互联。进一步地，在芯片上方堆叠第二芯片，在第一塑封上方布设载板，在芯片、第二芯片和载板三者之间相互打线，载板远离芯片的一端设有端点，用于引出芯片和第二芯片的信号；在载板、芯片和第二芯片的上方进行二次塑封，形成第二塑封结构。进一步地，所述载板上方部分进行二次塑封，所述端点位于第二塑封外。本申请的第二目的是提供一种芯片，采用以下技术方案：所述芯片利用如上所述的芯片封装方法进行封装。与现有技术相比，本申请具有的优点和积极效果是：将芯片倒装在贴有粘性Tape的载板上，为封装体形成支撑整个架构，使用特殊模具中进行塑封，使芯片体四周被塑封料包裹，去除载板和粘性Tape形成芯片上下裸露的封装体；可根据具体应用需要，采用CMP工艺将背面磨平，使封装体背面光滑且无高度差，方便贴装，使芯片背面直接接触系统板，提高散热性能。附图说明构成本申请的一部分的说明书附图用来提供对本申请的进一步理解，本申请的示意性实施例及其说明用于解释本申请，并不构成对本申请的不当限定。图1为本申请实施例1中封装体的结构示意图；图2为本申请实施例1中封装体的制作过程示意图；图3为本申请实施例1中封装体应用于IC封装的结构示意图；图4为本申请实施例1中封装体应用于FOWLP、FIWLP的结构示意图；图5为本申请实施例1中封装体应用于SIP的结构示意图；图6为本申请实施例1中封装体进行多层芯片堆叠的结构示意图。具体实施方式应该指出，以下详细说明都是例示性的，旨在对本申请提供进一步地说明。除非另有指明，本文使用的所有技术和科学术语具有与本申请所属
的普通技术人员通常理解的相同含义。需要注意的是，这里所使用的术语仅是为了描述具体实施方式，而非意图限制根据本申请的示例性实施方式。如在这里所使用的，除非上下文另外明确指出，否则单数形式也意图包括复数形式，此外，还应当理解的是，当在本说明书中使用术语“包含”和/或“包括”时，其指明存在特征、步骤、操作、器件、组件和/或它们的组合；为了方便叙述，本申请中如果出现“上”、“下”、“左”、“右”字样，仅表示与附图本身的上、下、左、右方向一致，并不对结构起限定作用，仅仅是为了便于描述本专利技术和简化描述，而不是指示或暗示所指的设备或元件必须具有特定的方位，以特定的方位构造和操作，因此不能理解为对本申请的限制。正如
技术介绍
中所介绍的，现有技术中腔体式封装体需要以载板为支撑，通过几种不同的材质将芯片和线路进行联通，然后使用特殊的模具填充塑封料将芯片部分包裹或者整体裸露在空气中，这些材料的堆叠组装使整个塑封体与芯片的体积比远远大于1:1，不利于器件间信号的高效率传输，而且占用了较大的空间，整体的体积和厚度无法做到最优化，封装体散热能力有较大的局限性，间接的影响了产品的性能和未来封装小、快、灵的大趋势，针对上述技术问题，本申请提出了一种芯片封装方法及芯片。实施例1本申请的一种典型的实施方式中，如图1-图6所示，提出了一种芯片封装方法。将芯片嵌入塑封中，芯片上下表面完全裸露，构成封装体结构，如图1所示；所述的芯片可以为IC硅片、Sensor、PV太阳能芯片、Interposer、Metal、PowerIC等。具体的，如图2所示，所述封装体的制作过程如下：在基板上贴敷粘性带Tape，将待封装芯片以正面朝下倒扣放置在粘性带上Tape上；使用模具对封装芯片四周进行塑封，采用CMP工艺将芯片背面磨平，使芯片背面与塑封顶面平齐；去除基板和粘性带Tape，形成芯片正面和背面均裸露、四周设有第一塑封的封装体结构。可以理解的是，将芯片倒装在贴有粘性Tape的载板上，为封装体形成支撑整个架构，使用特殊模具中进行塑封，使芯片体四周被塑封料包裹，去除载板和粘性Tape形成芯片上下裸露的封装体；可根据具体应用需要，采用CMP工艺将背面磨平，使封装体背面本文档来自技高网...

【技术保护点】
1.一种芯片封装方法，其特征在于，包括以下步骤：/n在基板上贴敷粘性带，将待封装芯片以正面朝下倒扣放置在粘性带上；/n对封装芯片四周进行塑封，将芯片背面磨平，使芯片背面与塑封顶面平齐；/n去除基板和粘性带，形成芯片正面和背面均裸露、四周设有第一塑封的封装体。/n

【技术特征摘要】
1.一种芯片封装方法，其特征在于，包括以下步骤：
在基板上贴敷粘性带，将待封装芯片以正面朝下倒扣放置在粘性带上；
对封装芯片四周进行塑封，将芯片背面磨平，使芯片背面与塑封顶面平齐；
去除基板和粘性带，形成芯片正面和背面均裸露、四周设有第一塑封的封装体。


2.如权利要求1所述的芯片封装方法，其特征在于，当封装体应用于IC封装时，在第一塑封的上方、芯片正面一侧进行再布线，实现新的电路layer，在芯片与layer布线区之间打线，对封装体上方进行二次塑封，形成第二塑封结构。


3.如权利要求2所述的芯片封装方法，其特征在于，所述第二塑封对芯片正面裸露部分进行部分遮挡形成窗口结构，或第二塑封对芯片正面裸露部分无遮挡形成敞开式结构。


4.如权利要求1所述的芯片封装方法，其特征在于，当封装体应用于FOWLP、FIWLP封装之中时，在封装体对应芯片正面一侧依次进行二次塑封和三次塑封，形成第二塑封结构和第三塑封结构，所述第三塑封远离第二塑封的一侧设有载板，所述第二塑封与第三塑封进行RDL布线，芯片正面依次通过金属导体、RDL导线、金属导体后与载板外部的金属球导通。

【专利技术属性】
技术研发人员：刘昭麟，邢广军，
申请(专利权)人：山东盛品电子技术有限公司，
类型：发明
国别省市：山东;37