The phase-locked loop is disclosed here. A phase-locked loop device is provided, in which the correction factor is determined based on the relevance of the linear controller.
【技术实现步骤摘要】
锁相环
本申请涉及锁相环以及相关方法。
技术介绍
锁相环(PLL)是使用反馈路径产生输出信号的电子电路,其中相位以及在许多情况下输出信号的频率也被“锁定”到参考信号。特别地,通过在反馈路径中使用分频器,PLL可以用来产生具有参考频率的若干倍的频率的输出信号。这可以例如被用在通信电路或其他电子设备中,以基于像具有相对较低频率的晶体振荡器信号的参考信号来产生具有相对较高频率的时钟信号。各种类型的PLL被使用,例如模拟PLL、具有数字相位检测器的数字PLL或者全数字PLL,其中相位检测器、滤波器和振荡器均是数字组件。这种数字PLL的主要部件之一是数字受控振荡器(DCO),有时也被称为数控振荡器(NCO)。DCO将作为控制信号供应到DCO的数字信号转换为具有由DCO的控制信号和增益因子Kdco确定的频率的输出信号。这种增益因子在许多实现中明显依赖于通常缩写为PVT的处理器、电压和温度变化。高频PLL(例如以在兆赫兹或千兆赫兹的范围内的频率工作)产生电磁场,这可能通过干扰靠近PLL的电子设备或电路而引起问题。这种现象被称为电磁干扰EMI。为了减少或避免这种电磁干扰,PLL的输出信号的峰值输出功率需要低于某一预定限制。为了实现这一点,在一些实现中的PLL的输出频率例如利用随机序列进行调制,从而在降低峰值功率的同时扩大输出频谱。这种方法例如在术语“扩频时钟”(SSC)下是已知的。这种方法减少了电磁干扰,但是同时也增加了由PLL产生的信号的定时误差或抖动。如果抖动变大,例如在通信电路中,这可能导致例如通信错误。因此,抖动需要低于某一限制。如上所述,增益因子Kdco取决于P ...
【技术保护点】
一种设备,包括:锁相环,包括相位检测器、可控振荡器和耦合到所述相位检测器的输出的环路滤波器,所述可控振荡器的控制输入被耦合到所述环路滤波器的输出,随机序列生成电路,被配置为生成随机序列,相关性电路,被配置为形成所述随机序列与所述相位检测器的输出信号之间的相关性,线性控制器电路,被配置为基于所述相关性生成针对所述随机序列的校正因子,其中所述设备被配置为根据基于所述校正因子修改的相关性来修改所述数字受控振荡器的所述控制输入处的信号。
【技术特征摘要】
2016.08.23 DE 102016115657.41.一种设备,包括:锁相环,包括相位检测器、可控振荡器和耦合到所述相位检测器的输出的环路滤波器,所述可控振荡器的控制输入被耦合到所述环路滤波器的输出,随机序列生成电路,被配置为生成随机序列,相关性电路,被配置为形成所述随机序列与所述相位检测器的输出信号之间的相关性,线性控制器电路,被配置为基于所述相关性生成针对所述随机序列的校正因子,其中所述设备被配置为根据基于所述校正因子修改的相关性来修改所述数字受控振荡器的所述控制输入处的信号。2.根据权利要求1所述的设备,还包括倍增器,所述倍增器被配置为将所述随机序列与所述校正因子相乘以生成修改的序列。3.根据权利要求1或2所述的设备,还包括加法器,其中所述加法器的第一输入被耦合到所述环路滤波器的输出,其中所述加法器的第二输出被耦合以接收修改的随机序列,并且其中所述加法器的输出被耦合到所述振荡器的所述控制输入。4.根据权利要求1至3中的任一项所述的设备,其中所述锁相环是数字锁相环,并且其中所述可控振荡器是数字受控振荡器。5.根据权利要求1至4中的任一项所述的设备,其中所述相关性电路是数字电路。6.根据权利要求1至5中的任一项所述的设备,其中所述线性控制器电路包括数字线性控制器。7.根据权利要求1至6中的任一项所述的设备,其中所述相关性电路包括:倍增器,被配置为将所述随机序列与所述相位发生器的输出信号相乘以生成相乘的信号;以及低通滤波器,用以对所述相乘的信号进行滤波以生成所述相关性。8.根据权利要求7所述的设备,其中所述低通滤波器是无限脉冲滤波器。9.根据权利要求1至8中的任一项所述的设备,还包括减法器,所述减法器被耦合以形成所述相关性与相关性目标值之间的差值并且将所述差值提供给所述线性控制器电路。10.根据权利要求1至9中的任一项所述的设备,其中所述校正因子被配置为补偿所述可控振荡器的增益变化。11.根据权利要求1至10中的任一项所述的设备,其中所述数字控制器...
【专利技术属性】
技术研发人员:A·帕克塔雷,
申请(专利权)人:英飞凌科技股份有限公司,
类型:发明
国别省市:德国,DE
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