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在处理器中配置功率管理功能制造技术

技术编号:13539799 阅读:132 留言:0更新日期:2016-08-17 16:38
在一个实施例中,多核处理器包括可以独立地执行指令的核,每一个核都采用独立电压和频率。处理器可以包括具有提供处理器的功率管理特征的可配置性的逻辑的功率控制器。一个这样的特征允许至少一个核基于控制寄存器中存在的单一功率域指示符的状态来在独立性能状态下操作。描述并要求保护其他实施例。

【技术实现步骤摘要】
201610176585

【技术保护点】
一种片上系统(SoC),包括:形成在单个半导体管芯上的多个核,所述多个核中的一个核执行一个或多个线程;所述多个核中的一个核包括用于从指令缓存获取指令的获取单元、用于解码所述指令的解码单元以及用于实施所述指令的无序执行的多个执行单元;一个或多个控制寄存器,用于存储指出所述多个核中的两个或更多个核在独立的性能状态下操作的第一指示;形成在单个半导体管芯上的多个电压调节器,所述多个电压调节器中的一个电压调节器与所述多个核中的一个核相关联;形成在单个半导体管芯上的功率控制器,所述功率控制器控制多个电压调节器以向所述多个核中的第一核提供电压和/或频率,向所述多个核中的第一核提供电压和/或频率独立于向一个或多个其他核提供的电压和/或频率,并且基于第一核的工作负荷、热约束和活动计数判断是否更新所述第一核的所述电压和/或频率;以及形成在所述单个半导体管芯上且与所述多个核外部的处理器电路相关联的至少一个附加电压调节器,所述至少一个附加电压调节器允许核外部的处理器电路在与所述多个核中的一个或多个核不同的电压和/或频率下操作;以及将所述多个核通信耦合到动态随机存取系统存储器的集成存储器控制器。

【技术特征摘要】
2012.08.31 US 13/600,5681.一种片上系统(SoC),包括:形成在单个半导体管芯上的多个核,所述多个核中的一个核执行一个或多个线程;所述多个核中的一个核包括用于从指令缓存获取指令的获取单元、用于解码所述指令的解码单元以及用于实施所述指令的无序执行的多个执行单元;一个或多个控制寄存器,用于存储指出所述多个核中的两个或更多个核在独立的性能状态下操作的第一指示;形成在单个半导体管芯上的多个电压调节器,所述多个电压调节器中的一个电压调节器与所述多个核中的一个核相关联;形成在单个半导体管芯上的功率控制器,所述功率控制器控制多个电压调节器以向所述多个核中的第一核提供电压和/或频率,向所述多个核中的第一核提供电压和/或频率独立于向一个或多个其他核提供的电压和/或频率,并且基于第一核的工作负荷、热约束和活动计数判断是否更新所述第一核的所述电压和/或频率;以及形成在所述单个半导体管芯上且与所述多个核外部的处理器电路相关联的至少一个附加电压调节器,所述至少一个附加电压调节器允许核外部的处理器电路在与所述多个核中的一个或多个核不同的电压和/或频率下操作;以及将所述多个核通信耦合到动态随机存取系统存储器的集成存储器控制器。2.如权利要求1所述的SoC,其特征在于,所述一个或多个控制寄存器存储指出第一组核以共同的性能状态操作的第二指示。3.如权利要求1所述的SoC,还包括由所述多个核中的两个或更多个
\t核访问的缓存。4.如权利要求1所述的SoC,还包括通信耦合到所述多个核中的至少一个的至少一个存储设备。5.如权利要求1所述的SoC,还包括一个或多个外围组件互连快速(PCIe)接口。6.如权利要求1所述的SoC,其特征在于,所述多个处理器中的至少一个包括由所述多个核中的两个或更多个共享的缓存。7.如权利要求1所述的SoC,其特征在于,所述多...

【专利技术属性】
技术研发人员:M·K·布汉达鲁E·J·德哈默S·P·波布霍尔兹R·玛卡拉姆V·加吉
申请(专利权)人:英特尔公司
类型:发明
国别省市:美国;US

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