【技术实现步骤摘要】
【国外来华专利技术】能够生成用于扫描测试的测试模式控制信号的集成电路
本专利技术涉及集成电路的扫描控制。
技术介绍
根据示例方案,所制造的电路被测试,以便验证所制造电路内的逻辑门的输入端或输出端未由于不可预见情况(例如,诸如短路)在操作期间被卡(或保持)在固定值(例如,逻辑0或逻辑1)。为了减轻上述问题,所制造的电路要经受扫描测试。扫描测试在包括组合部件和时序部件的集成电路上执行。时序部件可以包括一个或更多个存储元件(例如,触发器)的序列。在扫描测试期间,构成集成电路的时序部件的存储元件被耦合或连接成扫描链,并且测试矢量通过在集成电路上提供的一个或更多个输入测试引脚传送到扫描链。集成电路被置于评估模式(例如,捕捉阶段),以便一个或更多个存储元件的一个或更多个输入和状态被评估,并且在评估模式中获得的对应响应矢量通过一个或更多个输出测试引脚被移出。响应矢量中的比特值与预期的输出进行比较,以便确定集成电路中的故障状况。
技术实现思路
在此公开能够生成用于通过集成电路中的扫描链进行扫描测试的测试模式控制信号的若干示例方法和集成电路。该集成电路包括测试图案检测块,计数器电路和控制电路。该测试图案检测块经配置以接收检测图案并基于检测图案检测对应于测试图案的移位阶段的第一图案和对应于测试图案的捕捉阶段的第二图案。该测试图案检测块还经配置以基于第一和第二图案中的至少一个图案的检测生成触发信号。计数器电路经配置以基于所检测的图案生成(1)对应于移位阶段和时钟信号的一个或更多个计数状态,和(2)对应于捕捉阶段和时钟信号的一个或更多个计数状态。控制电路与测试图案检测块耦合,并经配置以接收触发信号并基于 ...
【技术保护点】
一种能够生成用于通过集成电路中的扫描链进行扫描测试的测试模式控制信号的集成电路,所述集成电路包括:测试图案检测块,其经配置以:接收检测图案;基于所述检测图案,执行对应于测试图案的移位阶段的第一图案的检测和对应于所述测试图案的捕捉阶段的第二图案的检测;并且基于所述第一和第二图案中的至少一个图案的检测而生成触发信号;控制电路,其耦合到所述测试图案检测块,所述控制电路经配置以接收所述触发信号并基于对应于所述移位阶段的一个或更多个计数状态和对应于所述捕捉阶段的一个或更多个计数状态生成和控制所述测试模式控制信号;以及计数器电路,其耦合到所述控制电路,所述计数器电路经配置以基于所述第一和第二图案中的至少一个图案,生成对应于所述移位阶段和时钟信号的一个或更多个计数状态以及对应于所述捕捉阶段和所述时钟信号的一个或更多个计数状态。
【技术特征摘要】
【国外来华专利技术】2012.05.14 US 13/470,8631.一种经配置以生成用于通过集成电路中的扫描链进行扫描测试的测试模式控制信号的集成电路,所述集成电路包括:测试图案检测块,其经配置以:接收检测图案;基于所述检测图案,执行对应于测试图案的移位阶段的第一图案的检测和对应于所述测试图案的捕捉阶段的第二图案的检测;并且基于检测到所述第一图案和所述第二图案中的至少一个而生成触发信号;控制电路,其耦合到所述测试图案检测块,所述控制电路经配置以接收所述触发信号并基于对应于所述移位阶段的一个或更多个计数状态和对应于所述捕捉阶段的一个或更多个计数状态生成所述测试模式控制信号并控制所述测试模式控制信号;以及计数器电路,其耦合到所述控制电路,所述计数器电路经配置以基于所述第一图案和所述第二图案中的至少一个图案,生成对应于所述移位阶段和时钟信号的一个或更多个计数状态以及对应于所述捕捉阶段和所述时钟信号的一个或更多个计数状态。2.根据权利要求1所述的集成电路,其中所述控制电路经进一步配置以执行下列中的至少一个:在所述计数器电路的计数状态是移位开始计数状态和捕捉结束计数状态中的一种状态时,断言所述测试模式控制信号;以及在所述计数状态是捕捉开始计数状态和移位结束计数状态中的一种状态时,去断言所述测试模式控制信号。3.根据权利要求2所述的集成电路,其中所述计数器电路包括:耦合到所述控制电路的寄存器块,所述寄存器块经配置以存储所述移位开始计数状态、所述移位结束计数状态、所述捕捉开始计数状态以及所述捕捉结束计数状态中的至少一个。4.根据权利要求3所述的集成电路,其中所述计数器电路进一步包括:与所述寄存器块耦合的一个或更多个计数器,其经配置以:生成对应于从所述移位开始计数状态到所述移位结束计数状态的所述移位阶段的所述一个或更多个计数状态;以及生成对应于从所述捕捉开始计数状态到所述捕捉结束计数状态的所述捕捉阶段的所述一个或更多个计数状态。5.根据权利要求3所述的集成电路,其中所述计数器电路进一步包括:第一计数器,其经配置以生成从所述移位开始计数状态到所述移位结束计数状态的一个或更多个计数状态;第二计数器,其经配置以生成从所述捕捉开始计数状态到所述捕捉结束计数状态的所述一个或更多个计数状态;以及一个或更多个计数器,其经配置以生成对应于在所述移位阶段的开始前的一个或更多个等待周期的一个或更多个计数状态,以及生成对应于在所述捕捉阶段的开始前的一个或更多个等待周期的一个或更多个计数状态。6.根据权利要求5所述的集成电路,其中所述计数器电路进一步包括图案计数器,其经配置以生成一个或更多个计数状态,所述一个或更多个计数状态对应于从对应于所述测试图案的所述移位阶段的所述移位开始计数状态到对应于所述测试图案的所述捕捉阶段的所述捕捉结束计数状态的预定数量的转换。7.根据权利要求1所述的集成电路,其进一步包括:第一组触发器,其与所述测试图案检测块耦合,所述第一组触发器经配置以在检测到对应于所述移位阶段的所述第一图案时生成第一预定延迟;以及第二组触发器,其与所述扫描链耦合,所述第二组触发器用于将对应于先前移位阶段的测试图案存储第二预定延迟时间,并使得在完成所述第二预定延迟时使能所述移位阶段的初始化。8.根据权利要求3所述的集成电路,其进一步包括与所述寄存器块通信关联或耦合的测试接口,所述测试接口控制所述寄存器块,并基于所述测试图案改变所述移位开始计数状态、所述捕捉开始计数状态、所述移位结束计数状态和所述捕捉结束计数中的至少一个。9.根据权利要求1所述的集成电路,其中所述测试模式控制信号包括用于控制所述测试图案的所述移位阶段和所述捕捉阶段的扫描使能信号和用于控制所述扫描链的操作的加载使能信号中的一个。10.一种经配置以生成用于通过集成电路中的扫描链进行扫描测试的测试模式控制信号的集成电路,所述集成电路包括:测试图案检测块,其经配置以:接收检测图案;基于所述检测图案,执行对应于测试图案的第一移位阶段的图案的检测;并且基于检测到所述图案,生成触发信号;控制电路,其耦合到所述测试图案检测块,所述控制电路经配置以接收所述触发信号并基于对应于所述第一移位阶段的一个或更多个计数状态和对应于后续移位阶段和捕捉阶段的一个或更多个计数状态而生成所述测试模式控制信号并控制所述测试模式控制信号;以及计数器电路,其耦合到所述控制电路,所述计数器电路包括:图案计数器,其经配置以在检测到所述第一移位阶段时被触发,所述图案计数器经配置以生成一个或更多个计数状态,所述一个或更多个计数状态对应于从对应于所述测试图案的所述第一移位阶段和后续移位阶段中的一个移位阶段的移位开始计数状态到对应于所述测试图案的捕捉阶段的捕捉结束计数状态的预定数量的转换,以及一个或更多个计数器,其与所述图案计数器耦合,所述一个或更多个计数器经配置以生成对应于所述第一移位阶段、所述后续移位阶段和所述捕捉阶段的一个或更多个计数状态。11.根据权利要求10所述的集成电路,其中所述控制电路经进一步配置以执行下列中的至少一个:在所述计数器电路的计数状态是所述移位开始计数状态和所述捕捉结束计数状态中的一种状态时,断言所述测试模式控制信号;以及在所述计数状态是捕捉开始计数状态和移位结束计数状态中的一种状态时,去断言所述测试模式控制信号。12.根据权利要求10所述的集成电路,其中所述计数器电路包括:寄存器块,其经配置以存储所述移位开始计数状态、所述捕捉开始计数状态、所述移位结束计数状态和所述捕捉结束计数状态中的至少一个。13.根据权利要求12所述的集成电路,其中所述计数器电路进一步包括:一个或更多个计数器,其经配置以生成一个或更多个计数状态,所述一个或更多个计数状态对应于在所述第一移位阶段和...
【专利技术属性】
技术研发人员:R·米塔尔,P·萨巴瑞瓦,P·纳拉亚南,R·A·帕瑞克基,
申请(专利权)人:德克萨斯仪器股份有限公司,德克萨斯仪器日本有限公司,
类型:发明
国别省市:美国;US
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