The invention provides a memory system and an operation method thereof. The memory system includes: a controller buffer memory; a host interface configured to receive and write data from a host computer from a non-linear host computer; a host address conversion unit configured to map a non-linear host physical address to a linear virtual address; and a host control unit configured to write data buffers to the controller buffer storage according to a linear virtual address. Device.
【技术实现步骤摘要】
存储器系统及其操作方法相关申请的交叉引用本申请要求于2017年11月13日提交的申请号为10-2017-0150660的韩国专利申请的优先权,其全部公开通过引用并入本文。
本专利技术的各个实施例涉及一种存储器系统及其操作方法。特别地,实施例涉及一种能够将非线性主机物理地址转换为线性虚拟地址并且将存储在主机缓冲存储器中的数据缓冲到控制器缓冲存储器中的存储器系统及其操作方法。
技术介绍
非易失性存储器装置可以包括多个存储块。另外,存储块中的每一个可以包括多个存储器单元,并且可以对一个存储块中的存储器单元同时执行擦除操作。当存储器系统从主机接收写入命令和逻辑地址时,存储器系统可以分配对应于逻辑地址的物理地址,并且将数据写入对应于物理地址的存储器区域中。存储器系统可以将地址映射信息临时存储在缓冲存储器中,并且将存储在缓冲存储器中的地址映射信息清除(flush)到非易失性存储器装置。另外,当电源接通时,存储器系统可以将存储在非易失性存储器装置中的地址映射信息加载到缓冲存储器。
技术实现思路
各个实施例涉及一种通过将非线性主机物理地址转换为线性虚拟地址来高效地执行写入操作和读取操作的存储器系统及其操作方法。根据实施例,一种存储器系统,其可以包括:控制器缓冲存储器;主机接口,其被配置为从主机接收非线性主机物理地址和写入数据;主机地址转换部,其被配置为将非线性主机物理地址映射到线性虚拟地址;以及主机控制部,其被配置为根据线性虚拟地址将写入数据缓冲在控制器缓冲存储器中。根据另一实施例,一种存储器系统,其可以包括:控制器缓冲存储器,其包括被配置为缓冲数据的多个控制器缓冲器单元;主 ...
【技术保护点】
1.一种存储器系统,其包括:控制器缓冲存储器;主机接口,从主机接收非线性主机物理地址和写入数据;主机地址转换部,将所述非线性主机物理地址映射到线性虚拟地址;以及主机控制部,根据所述线性虚拟地址将所述写入数据缓冲在所述控制器缓冲存储器中。
【技术特征摘要】
2017.11.13 KR 10-2017-01506601.一种存储器系统,其包括:控制器缓冲存储器;主机接口,从主机接收非线性主机物理地址和写入数据;主机地址转换部,将所述非线性主机物理地址映射到线性虚拟地址;以及主机控制部,根据所述线性虚拟地址将所述写入数据缓冲在所述控制器缓冲存储器中。2.根据权利要求1所述的存储器系统,其中所述主机包括主机缓冲存储器,所述主机缓冲存储器包括存储所述写入数据的多个主机缓冲器单元,以及所述非线性主机物理地址中的每一个对应于所述多个主机缓冲器单元中的一个。3.根据权利要求2所述的存储器系统,进一步包括:非易失性存储器装置;闪存转换部,将从所述主机接收的逻辑地址转换为闪存物理地址;以及闪存控制部,根据所述闪存物理地址,控制将缓冲在所述控制器缓冲存储器中的写入数据写入到所述非易失性存储器装置。4.根据权利要求3所述的存储器系统,其中所述闪存控制部根据顺序编程算法,将缓冲在所述控制器缓冲存储器中的写入数据写入到所述非易失性存储器装置。5.根据权利要求2所述的存储器系统,其中当最后的线性虚拟地址被映射后,所述主机地址转换部返回到第一线性虚拟地址。6.根据权利要求2所述的存储器系统,其中所述多个主机缓冲器单元中的每一个对应于单个输入/输出进程。7.根据权利要求6所述的存储器系统,其中所述主机地址转换部在所述线性虚拟地址中生成与多个输入/输出进程相对应的起始线性虚拟地址和一个或多个线性虚拟地址,以及所述主机控制部根据所述起始线性虚拟地址和所述一个或多个线性虚拟地址,将所述写入数据缓冲在所述控制器缓冲存储器中。8.根据权利要求3所述的存储器系统,其中所述主机接口从所述主机接收写入命令,以及所述写入命令包括所述非线性主机物理地址、所述逻辑地址和所述写入数据的大小信息。9.根据权利要求2所述的存储器系统,其中所述多个主机缓冲器单元中的每一个具有与所述控制器缓冲存储器中的控制器缓冲器单元相同的大小。10.一种存储器系统,其包括:控制器缓冲存储器,其包括缓冲数据的多个控制器缓冲器单元;主机地址转换部,其生成物理-虚拟地址映射表;以及主机控制部,其根据所述物理-虚拟地址映射表,将缓冲在所述控制器缓冲存储器中的数据输出到主机的主机缓冲存储器,其中所述物理-虚拟地址映射表包括与...
【专利技术属性】
技术研发人员:李东燮,
申请(专利权)人:爱思开海力士有限公司,
类型:发明
国别省市:韩国,KR
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