【技术实现步骤摘要】
一种半导体元件及其制备方法
[0001]本专利技术实施例涉及半导体
,尤其涉及一种半导体元件及其制备方法。
技术介绍
[0002]和传统金属
‑
氧化层半导体场效晶体管(Metal
‑
Oxide
‑
Semiconductor Field
‑
Effect Transistor,MOSFET)相比,深沟道MOSFET有更好的品质因数(figure of merit,FOM)。由于采用电藕平衡设计,分裂栅型功率MOSFET能够同时实现低导通电阻和低反向传输电容,从而降低系统的导通损耗和开关损耗,提高电子产品的使用效率。
[0003]然而实际应用中,比如谐振拓扑的电源或者无刷电机应用,在每一次开关过程中都会经历MOSFET体二极管的反向恢复,在体二极管反向恢复的时候,漏源电压VDS容易尖峰过大从而直接导致MOSFET过压失效。因此如何减小漏源电压VDS尖峰,成为亟待解决的技术问题。
技术实现思路
[0004]本专利技术实施例提供一种半导体元件及其制备方法,以减小MOSFET在体二极管反向恢复时所需要的电荷总量,从而减小漏源电压VDS尖峰,保证MOSFET的良好性能。
[0005]第一方面,本专利技术实施例提供了一种半导体元件,包括:
[0006]衬底;
[0007]外延层,位于所述衬底的一侧,所述外延层远离所述衬底的一侧包括沟槽;
[0008]氧化层,位于所述沟槽内;
[0009]栅极多 ...
【技术保护点】
【技术特征摘要】
1.一种半导体元件,其特征在于,包括:衬底;外延层,位于所述衬底的一侧,所述外延层远离所述衬底的一侧包括沟槽;氧化层,位于所述沟槽内;栅极多晶硅层和源极多晶硅层,均内嵌于所述氧化层中;所述栅极多晶硅层和所述源极多晶硅层之间以所述氧化层隔开,所述氧化层至少暴露所述栅极多晶硅层的远离所述衬底的表面;体区和源区,均形成于所述外延层的远离所述衬底的一端中;所述体区和所述源区均位于所述栅极多晶硅层的左右两侧;相对于所述源区,所述体区位于所述源区靠近所述衬底的一侧;源极电极,位于所述体区远离所述衬底的一侧,并与所述源区电连接;其中,所述源极多晶硅层与所述源极电极电连接,所述源极多晶硅层的掺杂离子的类型与所述栅极多晶硅层的掺杂离子的类型相反。2.根据权利要求1所述的半导体元件,其特征在于,所述衬底、所述外延层、所述源区和所述栅极多晶硅层的掺杂离子的类型均为P型;所述体区和所述源极多晶硅层的掺杂离子的类型均为N型。3.根据权利要求1所述的半导体元件,其特征在于,所述衬底、所述外延层、所述源区和所述栅极多晶硅层的掺杂离子的类型均为N型;所述体区和所述源极多晶硅层的掺杂离子的类型为P型。4.根据权利要求1所述的半导体元件,其特征在于,所述栅极多晶硅层位于所述源极多晶硅层远离所述衬底的一侧;所述栅极多晶硅层与所述沟槽之间的所述氧化层为第一氧化层;所述栅极多晶硅层与所述源极多晶硅层之间的所述氧化层为中间氧化层;所述源极多晶硅层与所述沟槽之间的所述氧化层为第二氧化层;其中,所述中间氧化层和所述第一氧化层一体成型。5.根据权利要求1所述的半导体元件,其特征在于,所述栅极多晶硅层环绕所述源极多晶硅层;所述氧化层暴露所述栅极多晶硅层的远离所述衬底的表面和所述源极多晶硅层的远离所述衬底的表面;所述栅极多晶硅层的远离所述衬底的表面与所述源极多晶硅层的远离所述衬底的表面齐平;所述栅极多晶硅层靠近所述衬底的表面与所述沟槽的底部之间的距离,小于所述源极多晶硅层靠近所述衬底的表面与所述沟槽的底部之间的距离;所述栅极多晶硅层与所述沟槽之间的所述氧化层为第一氧化层;所述栅极多晶硅层与所述源极多晶硅层之间的所述氧化层为中间氧化层;所述源极多晶硅层与所述沟槽之间的所述氧化层为第二氧化层;其中,所述第一氧化层、所述中间氧化层和所述第二氧化层一体成型。6.根据权利要求1所述的半导体元件,其特征在于,还包括:漏极电极,所述漏极电极位于所述衬底远离所述外延层的一侧并与所述衬底电连接。7.根据权利要求4或5任一项所述的半导体元件,其特征在于,所述第一氧化层、所述中间氧化层和所述第二氧化层的材质均包括氧化硅。
8.一种半导体元件的制备方法,其特征在于,提供衬底;在所述衬底的一侧形成外延层,所述外延层远离所述衬底的一侧包括沟槽;在所述沟槽内形成氧化层、栅极多晶硅层和源极多晶硅层,所述栅极多晶硅层和所述源极多晶硅层均内嵌于所述氧化...
【专利技术属性】
技术研发人员:罗志云,王飞,潘梦瑜,
申请(专利权)人:恒泰柯半导体上海有限公司,
类型:发明
国别省市:
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