【技术实现步骤摘要】
【国外来华专利技术】具有可缩放双端子纳米管开关的非易失性阻性存储器、 闩锁电路和工作电路相关申请参考本申请要求保护下列申请的美国专利法§119 (e)下的利益,其全部内容通过引用结合于此2006年8月8日提交的美国临时专利申请No. 60/836,343,题为作为 电子烙丝替换元件的可縮放非易失性纳米管开关(Scalable Nonvolatile Nanotube Switches as Electronic Fuse Replacement Elements);2006年8月8日提交的美国临时专利申请No. 60/836,437,题为非易 失性纳米管二极管(Nonvolatile Nanotube Diode);2006年8月28日提交的美国临时专利申请No. 60/840,586,题为非易 失性纳米管二极管(Nonvolatile Nanotube Diode);2006年10月27日提交的美国临时专利申请No. 60/855,109,题为非 易失性纳米管区块(Nonvolatile Nanotube Blocks);2007年3月16日提交的美国临时专利申请No.60/918,388,题为使用 非易失性纳米管区块的存储器存储元件与交叉点开关及其阵列(Memory Elements and Cross Point Switches and Arrays of Same Using Nonvolatile Nanotube Blocks)。本申请为下列申请的继续申请,并要求美国专利法§ 120下的优先权,其全部内容通过引用结合于此2005年11月15日提交的美国专利申请No ...
【技术保护点】
一种非易失性闩锁电路,包括: 至少一个输入端,能够输入逻辑状态; 输出端,能够输出逻辑状态; 纳米管开关元件,包括设置于两个导电触点之间的纳米管结构制品,所述纳米管结构制品电连接所述两个导电触点,其中所述纳米管开关元件能够 在相对较低电阻状态与相对较高电阻状态之间切换,其中所述纳米管开关元件能够非易失性地保持在所述相对较低或所述相对较高电阻状态; 易失性闩锁电路,包括电气地设置于所述输入端与所述纳米管开关元件之间的至少一个半导体元件,所述半导体元件能够接 收及易失性地储存逻辑状态,所述逻辑状态输入至所述输入端; 其中当所述纳米管开关元件处于所述相对较低电阻状态时,所述易失性闩锁电路保持第一逻辑状态并在所述输出端输出所述第一逻辑状态,且其中当所述纳米管开关元件处于所述相对较高电阻状态时, 所述易失性闩锁电路保持第二逻辑状态,所述第二逻辑状态在所述输出端输出。
【技术特征摘要】
【国外来华专利技术】US 2006-8-8 60/836,343;US 2006-8-8 60/836,437;US 21.一种非易失性闩锁电路,包括至少一个输入端,能够输入逻辑状态;输出端,能够输出逻辑状态;纳米管开关元件,包括设置于两个导电触点之间的纳米管结构制品,所述纳米管结构制品电连接所述两个导电触点,其中所述纳米管开关元件能够在相对较低电阻状态与相对较高电阻状态之间切换,其中所述纳米管开关元件能够非易失性地保持在所述相对较低或所述相对较高电阻状态;易失性闩锁电路,包括电气地设置于所述输入端与所述纳米管开关元件之间的至少一个半导体元件,所述半导体元件能够接收及易失性地储存逻辑状态,所述逻辑状态输入至所述输入端;其中当所述纳米管开关元件处于所述相对较低电阻状态时,所述易失性闩锁电路保持第一逻辑状态并在所述输出端输出所述第一逻辑状态,且其中当所述纳米管开关元件处于所述相对较高电阻状态时,所述易失性闩锁电路保持第二逻辑状态,所述第二逻辑状态在所述输出端输出。2. 如权利要求1所述的非易失性闩锁电路,其特征在于,所述电子闩锁电 路包括反相器电路,所述反相器电路包括多个场效应晶体管。3. 如权利要求1所述的非易失性闩锁电路,其特征在于,所述纳米管开关 元件能够在所述相对较低电阻状态与所述相对较高电阻状态之间切换数次。4. 如权利要求1所述的非易失性闩锁电路,其特征在于,所述电子闩锁电 路将所述纳米管开关元件的所述相对较低电阻状态转换至相对较高的电压电 平,其对应于在所述输出端输出的所述第一逻辑状态,且其中所述电子闩锁电 路将所述纳米管开关元件的所述相对较高电阻状态转换至相对较低的电压电 平,其对应于在所述输出端输出的所述第二逻辑状态。5. 如权利要求1所述的非易失性闩锁电路,进一步电连接存储单元,其中当所述非易失性闩锁电路输出所述第一逻辑状态时,所述存储单元是有效的, 且其中当所述非易失性闩锁电路输出所述第二逻辑状态时,所述存储单元是无效的。6. 如权利要求5所述的非易失性闩锁电路,其特征在于,所述非易失性闩 锁电路包括用于所述存储单元的冗余电路,且能够在所述存储单元为不可用时 旁路所述存储单元。7. 如权利要求5所述的非易失性闩锁电路,其特征在于,旁路所述存储单元包括校正差错。8. 如权利要求1所述的非易失性闩锁电路,进一步电连接存储单元,所述 存储单元能够储存第一与第二存储器状态,其中所述第一存储器状态被输入至所述输入端作为第一逻辑状态,且通过所述非易失性闩锁电路而被非易失性地 保持及输出为所述第一逻辑状态,且其中所述第二存储器状态被输入至所述输 入端作为第二逻辑状态,且通过所述非易失性闩锁电路而被非易失性地保持及 输出为所述第二逻辑状态。9. 如权利要求8所述的非易失性闩锁电路,其特征在于,所述非易失性闩 锁电路包括用于所述存储单元的冗余电路,且能够非易失性地保持分别对应于 所述第一及所述第二存储器状态的所述第一及第二逻辑状态。10. 如权利要求8所述的非易失性闩锁电路,其特征在于,所述存储单 元包括NRAM阵列中的一单元。11. 如权利要求9所述的非易失性闩锁电路,其特征在于,非易失性地 保持所述第一及第二逻辑状态之一包括校正所述存储单元中的差错。12. 如权利要求1所述的非易失性闩锁电路,进一步电连接存储器电路, 其中在所述输入端输入的电刺激包括随时间变化的电剌激,其中在所述输出端 输出的电刺激包括随时间变化的电刺激,且其中通过在所述输入端及所述输出 端的所述随时间变化的电刺激之间产生可控制的延迟,所述非易失性闩锁电路 控制所述存储器电路的操作。13. 如权利要求12所述的非易失性闩锁电路,其特征在于,产生可控 制的延迟包括提供具有实质选定的上升时间及实质选定的下降时间的实质双 模信号。14. 如权利要求l所述的非易失性闩锁电路,其特征在于,所述纳米管 开关元件包括可编程一次的熔丝,所述可编程一次的熔丝能够仅从所述相对较 低电阻状态切换至所述相对较高电阻状态。15. 如权利要求14所述的非易失性闩锁电路,其特征在于,所述可编 程一次的熔丝更包括设置于所述纳米管结构制品之上的绝缘体材料。16. 如权利要求15所述的非易失性闩锁电路,其特征在于,所述纳米 管结构制品被暴露于由所述绝缘体材料中的开口所限定的一部分中,且其中所 述可编程一次的熔丝能够通过激光烧蚀从所述相对较低电阻状态切换至所述 相对较高电阻状态。17. 如权利要求l所述的非易失性闩锁电路,其特征在于,所述纳米管开关元件包括可编程一次的熔丝,所述可编程一次的熔丝能够从截止状态切换 至导通状态。18. —种用于与多个非易失性寄存器堆一起使用的非易失性寄存器堆配置电路,包括 输入电压端; 选择电路;多个纳米管熔丝元件,与所述输入电压端电连接,每一纳米管熔丝元件与 所述多个非易失性寄存器堆之一电连接,每一纳米管熔丝元件与所述选择电路电连接;其中每一纳米管熔丝元件包括纳米管结构制品及两个导电触点,所述纳米管结构制品被设置于所述两个 导电触点之间,所述纳米管结构制品电连接所述两个导电触点;其中,响应于电刺激,所述纳米管熔丝元件能够从导通状态切换至截止状 态,所述导通状态对应于所述第一及第二端的相对较低电阻,而所述截止状态对应于所述两个导电触点之间的相对较低电阻;其中,当所述纳米管熔丝元件处于所述导通状态时,对应的非易失性寄存 器堆是有效的且在所述输入电压端对电刺激作出反应,且其中,当所述纳米管 熔丝元件处于所述截止状态时,对应的非易失性寄存器堆是无效的且在所述输 入电压端对电刺激不作出反应;其中,所述选择电路能够将电刺激施加至选定的纳米管熔丝元件的每一 个,以选择性地旁路所述对应的寄存器堆。19. 如权利要求18所述的非易失性寄存器堆配置电路,其特征在于,响应于寄存器堆有缺陷,所述选择电路选择性地旁路所述寄存器堆。20. 如权利要求18所述的非易失性寄存器堆配置电路,其特征在于, 当所述多个纳米管熔丝元件之一处于所述导通状态时,所述对应的非易失性寄 存器堆能够响应于所述输入电压端的电刺激,以多个信息状态操作。21. 如权利要求18所述的非易失性寄存器堆配置电路,其特征在于,所述纳米管熔丝元件是可编程一次的纳米管熔丝元件。22. 如权利要求18所述的非易失性寄存器堆配置电路,其特征在于, 所述纳米管熔丝元件能够从所述截止状态切换至所述导通状态。23. —种非易失性存储器,包括 位线;字线;至少一个非易失性存储单元,每一非易失性存储单元具有双端子纳米管开关器件,包括第一及第二导电端以及设置于所述第一及第二导电端之间的纳米管结构制品,所述纳米管结构制品电连接所述第一及第二导电端;存储单元选择电路,与所述位线及所述字线电连接,以响应于所述位线及所述字线的其中之一的激活,而选择所述双端子纳米管开关器件进行读取及写入操作;写入控制电路,对控制信号作出反应,用以将写入信号供应给选定的存储 单元,以在所述纳米管结构制...
【专利技术属性】
技术研发人员:CL伯廷,T鲁克斯,JW沃德,F郭,SL孔瑟科,M梅恩霍德,
申请(专利权)人:南泰若股份有限公司,
类型:发明
国别省市:US[美国]
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