一种时钟芯片的数模混合验证方法技术

技术编号:43885234 阅读:50 留言:0更新日期:2024-12-31 19:10
本发明专利技术提供了一种时钟芯片的数模混合验证方法,包括:基于时钟芯片的模拟电路顶层搭建测试顶层,并提取模拟verilog电路模型;利用模拟电路完成模块级仿真,得到非线性参数和抖动时钟参数;将非线性参数和抖动时钟参数插入verilog电路模型完成非线性建模,并与数字RTL/数字网表配合搭建数模混合仿真环境;在数模混合仿真环境中施加测试激励使得锁相环锁定,并周期采集数据计算抖动指标,完成时钟芯片的数模混合仿真验证。本发明专利技术通过在对时钟芯片数模混合验证中引入非线性TDC、DTC、DCO模型和抖动时钟模型,可以让仿真更加接近真实场景,仿真结果更加可靠,并且仿真速度更快。

【技术实现步骤摘要】

本专利技术涉及芯片验证领域,特别涉及一种时钟芯片的数模混合验证方法


技术介绍

1、基于数字锁相环的时钟芯片,时-数转换器tdc(time-to-digital converter)和数-时转换器dtc(digital-to-time converter)通常用于数字锁相环dpll(digitalphase-locked loop)频率合成器中,作为相位检测器使用,采用tdc、dtc进行严格的时间测量或相移,但是tdc和dtc实现会有一定的非线性,基于延迟架构的tdc每一级延迟会不一样,从而影响tdc的非线性。目前基于数字锁相环的时钟芯片仿真是基于线性tdc、dtc模型进行数模混合仿真,如图1所示的非线性曲线和线性曲线,不能真正体现模拟tdc、dtc非线性特性,仿真性能和实际有一定偏差。

2、在数字锁相环的时钟芯片中,数字信号控制的振荡器dco(digitally controlledoscillator)以输入的数字码作为控制,调节其输出信号的频率与相位,目前dco典型的架构是基于电容电感(lc)谐振网络,其中l和c分别为谐振回路中的总电感和本文档来自技高网...

【技术保护点】

1.一种时钟芯片的数模混合验证方法,其特征在于,应用于前仿真中,包括:

2.根据权利要求1所述的时钟芯片的数模混合验证方法,其特征在于,所述非线性参数获取过程包括:

3.根据权利要求1或2所述的时钟芯片的数模混合验证方法,其特征在于,所述抖动时钟参数获取过程包括:

4.根据权利要求1所述的时钟芯片的数模混合验证方法,其特征在于,在施加测试激励使得锁相环锁定时,根据芯片规格配置生成时钟工作的典型频点频率、上下边界工作频率、工作范围内随机频点用例,分别配置生成的用例使锁相环锁定进行验证。

5.根据权利要求1所述的时钟芯片的数模混合验证方法,其特...

【技术特征摘要】

1.一种时钟芯片的数模混合验证方法,其特征在于,应用于前仿真中,包括:

2.根据权利要求1所述的时钟芯片的数模混合验证方法,其特征在于,所述非线性参数获取过程包括:

3.根据权利要求1或2所述的时钟芯片的数模混合验证方法,其特征在于,所述抖动时钟参数获取过程包括:

4.根据权利要求1所述的时钟芯片的数模混合验证方法,其特征在于,在施加测试激励使得锁相环锁定时,根据芯片规格配置生成时钟工作的典型频点频率、上下边界工作频率、工作范围内随机频点用例,分别配置生成的用例使锁相环锁定进行验证。

5.根据权利要求1所述的时钟芯片的数模混合验证方法,其特征在于,所述周期采集数据计算抖动指标,完成时钟芯片的数模混合前仿真验证,具体包括:

...

【专利技术属性】
技术研发人员:请求不公布姓名请求不公布姓名请求不公布姓名请求不公布姓名请求不公布姓名
申请(专利权)人:成都电科星拓科技有限公司
类型:发明
国别省市:

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