【技术实现步骤摘要】
本专利技术涉及一种设备和方法，用于通过在周边提供具有多个以第一顺序物理排列的第一I/O端口的第一集成电路和在该周边提供具有多个以第二顺序物理排列的第二端口的第二集成电路来连接第一和第二集成电路，其中每个第一I/O端口将被连接到第二I/O端口中的一个。特别是，本专利技术涉及一种互连同步动态随机存取存储器(SDRAM)和数字信号处理器(DSP)的方法。
技术介绍
在很多DSP方案中，需要一个标准的SDRAM来存储由DSP生成的数据。在需要时，这个数据、即一个场将由该DSP读出。但是，标准的SDRAM被设计成用于工业。由此，例如微软的MT48LC2M32B2的SDRAM的I/O端口的引脚具有如下顺序DATA0-DATA7、DATA16-DATA23、DATA24-DATA31和DATA8-DATA15。通常，用于控制DVD+RW的控制器包括这种标准的SDRAM和DSP。该DSP通常被设计成与来自Faroudja的FL12200的情况类似的DATA0到DATA31的简单序列。为了在这种DSP和SDRAM之间建立数据总线，必须提供彼此交叉的数据线。为此，使用在这种情况下...
【技术保护点】
一种通过提供具有多个第一逻辑Ｉ／Ｏ端口的第一集成电路和提供具有多个第二逻辑Ｉ／Ｏ端口的第二集成电路来连接至少所述第一和第二集成电路的方法，其特征在于：将所述第一逻辑Ｉ／Ｏ端口以其中连线彼此互不相交的独立于所述第一和第二逻辑Ｉ／Ｏ端口 任一对应关系的方式与所述第二逻辑Ｉ／Ｏ端口连接。
【技术特征摘要】
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