【技术实现步骤摘要】
半导体存储器装置及其操作方法
[0001]各种实施方式总体上涉及半导体存储器装置及其操作方法,并且更具体地,涉及能够通过向多条字线施加验证通过电压来执行验证操作的半导体存储器装置及其操作方法。
技术介绍
[0002]一般而言,半导体存储器装置分为易失性存储器装置和非易失性存储器装置。易失性存储器装置和非易失性存储器装置能够使用施加到其的电力来执行存储数据或输出所存储的数据的数据处理操作。易失性存储器装置的优点在于数据处理速度快,但缺点在于需要为了保持所存储的数据而持续地供电。非易失性存储器装置的优点在于不需要为了保持所存储的数据而持续地供电,但缺点在于数据处理速度慢。
[0003]近期,随着半导体存储器装置的工艺和设计技术的显著发展,易失性存储器装置的数据处理速度与非易失性存储器装置的数据处理速度之间的差异已经显著减小。因此,近来,非易失性存储器装置备受关注。
[0004]非易失性存储器装置的代表性示例是具有串结构的NAND型闪存装置,在该串结构中多个存储器单元串联联接。NAND型闪存装置的每个存储器单元包括浮栅。因此,存储器单元可以通过经由福勒
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诺德海姆(Fowler
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Nordheim)隧穿方法将电子引入到浮栅中或从浮栅中释放电子来存储逻辑“高”数据或逻辑“低”数据。
[0005]包括NAND型闪存装置的非易失性存储器装置执行编程操作以便将数据存储在存储器单元中,并且执行读取操作以便输出存储器单元中所存储的数据。此外,非易失性存储器装置在编程操作之前执 ...
【技术保护点】
【技术特征摘要】
1.一种半导体存储器装置,该半导体存储器装置包括:存储器单元阵列电路,所述存储器单元阵列电路包括联接至多条字线的多个存储器单元;以及驱动力调整电路,所述驱动力调整电路基于所述多个存储器单元当中的至少一个存储器单元是否被编程来调整向所述多条字线施加的相应的多个验证通过电压的驱动力。2.根据权利要求1所述的半导体存储器装置,其中,所述多个验证通过电压包括驱动力不同的第一验证通过电压和第二验证通过电压,并且其中,所述驱动力调整电路向所述多条字线当中的未选字线施加所述第一验证通过电压和所述第二验证通过电压。3.根据权利要求2所述的半导体存储器装置,其中,所述驱动力调整电路向与所述多个存储器单元当中处于已编程状态的存储器单元相对应的未选字线施加所述第一验证通过电压,并且向与所述多个存储器单元当中处于擦除状态的存储器单元相对应的未选字线施加所述第二验证通过电压。4.根据权利要求2所述的半导体存储器装置,其中,在验证操作中,所述第一验证通过电压的目标电平不同于所述第二验证通过电压的目标电平。5.根据权利要求4所述的半导体存储器装置,其中,所述第一验证通过电压的目标电压电平高于所述第二验证通过电压的目标电压电平。6.根据权利要求2所述的半导体存储器装置,其中,所述第一验证通过电压和所述第二验证通过电压各自具有与所述多个存储器单元当中处于已编程状态的存储器单元的数量相对应的驱动力和所述多个存储器单元当中处于擦除状态的存储器单元的数量相对应的驱动力。7.根据权利要求1所述的半导体存储器装置,该半导体存储器装置还包括:多个页缓冲器电路,所述多个页缓冲器电路通过接收从所述存储器单元阵列电路传送的数据来执行验证操作,其中,基于所述多个存储器单元当中处于已编程状态的存储器单元的数量和处于擦除状态的存储器单元的数量来调整所述多个页缓冲器电路的验证操作时间点。8.根据权利要求2所述的半导体存储器装置,其中,所述驱动力调整电路基于验证目标存储器单元的位置和编程方向来向所述未选字线施加所述第一验证通过电压和所述第二验证通过电压。9.根据权利要求2所述的半导体存储器装置,其中,所述第一验证通过电压和所述第二验证通过电压中的每一个具有与验证目标存储器单元的位置和编程方向相对应的驱动力。10.根据权利要求1所述的半导体存储器装置,该半导体存储器装置还包括:多个页缓冲器电路,所述多个页缓冲器电路通过接收从所述存储器单元阵列电路传送的数据来执行验证操作,其中,基于验证目标存储器单元的位置和编程方向来调整所述多个页缓冲器电路的验证操作时间点。11.根据权利要求1所述的半导体存储器装置,其中,所述驱动力调整电路包括:验证控制电路,所述验证控制电路基于与所述多个存储器单元当中的至少一个存储器单元是否被编程相对应的验证操作信息来生成选择电压信息和选择字线信息;
电压生成电路,所述电压生成电路基于所述选择电压信息设置所述多个验证通过电压中的每一个的驱动力;以及字线驱动电路,所述字线驱动电路基于所述选择字线信息通过所述多个验证通过电压来驱动所述多条字线。12.根...
【专利技术属性】
技术研发人员:崔亨进,
申请(专利权)人:爱思开海力士有限公司,
类型:发明
国别省市:
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