本发明专利技术涉及一种地址访问方法、装置及系统，该方法包括读操作和写操作，读操作包括将设备端内部所有模块的同类寄存器映射到同一地址段上；在接收到针对该地址进行访问的实读指令后，通过block read访问整段地址空间，获取所有模块的同类寄存器的数据；将数据发送至主机端；写操作包括将所有写操作编码为指令+操作数的数据格式；主机端将多条写操作数据存储为数据块并一次性写入设备端；设备端仅对数据进行逐条解码，按照指令将写操作分发给不同模块进行并行寻址寄存器，将对应的操作数同步写入相应的寄存器中。本发明专利技术对寄存器采取块读取、并行写入的方法，在尽可能高效利用总线带宽的基础上显著提高总线访问寄存器的执行效率。率。率。
【技术实现步骤摘要】
地址访问方法、装置及系统
[0001]本专利技术涉及缓存管理
，尤其是指一种地址访问方法、装置及系统。
技术介绍
[0002]在计算机控制电子设备的应用中，随着计算机和电子设备的性能不断增强，需要处理的信息量越来越多，因此对计算机和设备互连的总线的性能要求也越来越高。电子智能设备往往是把内部各项功能的控制接口封装为寄存器，并把所有寄存器按照数据
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地址编码规则映射到地址空间，计算机通过总线来寻址访问寄存器，因此如何充分利用总线带宽提高寄存器访问效率是数据传输中很重要的一环。
[0003]总线是主机和设备之间实现信息传输、数据交换的公共数据通道。在进行数据传输时，总线的带宽直接影响着数据通信的传输效率。因此市场上不断出现带宽越来越高的总线技术，高带宽总线的优势有利于U盘、硬盘等存储设备和流媒体设备，其设备端的数据是连续存放的整块数据，总线访问数据时，只需要指定一次数据块的首地址，就可以连续访问大量数据，可以充分利用带宽。带宽的增加虽然显著提升了大块数据的传输效率，但是并没有显著提升单笔数据单次传输的速度，即单笔小数据量的访问不能充分利用总线带宽的优势。其中有类电子设备的数据是由大量相同或相似的模块组成，模块内部设置有相同的寄存器结构，计算机需要同步控制多模块并行工作，故需要通过总线访问所有模块的所有寄存器。这类设备不同于存储设备，其寄存器功能都是相对独立的，工作时经常需要访问某些指定的寄存器。目前将所有寄存器映射到地址空间的传统方法如图1所示，将寄存器映射到地址空间，把每个模块内部的所有寄存器分配在相邻地址，相邻地址的寄存器对应不同功能，在上一级地址按照多模块展开。例如一个device内部含M个相同的模块，各个模块里包含的寄存器种类相同，需要访问多个模块中同一类寄存器。使用传统方法访问这种环境下的device时，执行读操作需要跳跃地址的读操作，执行写操作时也需要跳跃地址的写操作；因此这种device需要多模块的并发操作时，只能小块碎片化的进行数据处理，虽然传输总线的带宽很大，但是对于跳跃地址的寄存器访问，需要访问多次，每次只能访问一个地址，这种方法明显存在既低效、又无法体现高带宽优势的缺陷。
[0004]因此提供一种能够提高总线地址空间访问效率的技术很有必要。
技术实现思路
[0005]为此，本专利技术所要解决的技术问题在于克服现有技术中存在的地址访问既低效又无法体现高带宽优势的技术缺陷。
[0006]为解决上述技术问题，本专利技术提供了一种地址访问方法，该方法包括读操作，所述读操作按照寄存器地址访问，所述读操作包括：
[0007]将设备端内部所有模块的同类寄存器映射到地址连续的同一地址段上；
[0008]在接收到主机端针对该地址进行访问的实读指令后，设备端通过block read访问整段地址空间，获取所有模块的同类寄存器的数据；
[0009]以及将所述数据发送至主机端。
[0010]在本专利技术的一个实施例中，在所述主机端发起针对所述地址进行访问的实读指令前，由所述主机端发起针对所述地址进行访问的预读指令，在接收到预读指令后，设备端将该地址的数据预先缓存在寄存器接口。
[0011]在本专利技术的一个实施例中，对多个模块同类寄存器执行读操作时，由主机端将所述预读指令同时并发给多个模块。
[0012]本专利技术还提供一种地址访问方法，该方法包括写操作，所述写操作包括：
[0013]将所有写操作编码为指令+操作数的数据格式，不携带地址信息；
[0014]主机端将连续执行的多条写操作数据存储为数据块并一次性写入设备端；
[0015]设备端在接收到主机端的写数据块后忽略写操作的地址信息，仅对数据进行逐条解码，按照数据中的指令将写操作分发给不同模块进行并行寻址寄存器，并且将对应的操作数同步写入相应的寄存器中。
[0016]在本专利技术的一个实施例中，对多个同类寄存器执行写操作时，由主机端发起列举指令，设备端在接收到列举指令后，选中需要执行寄存器写操作的模块，其他模块进入未选中模式，并将写操作作用于所有处于选中模式的模块。
[0017]在本专利技术的一个实施例中，处于选中模式的所有模块同步执行写操作。
[0018]本专利技术还提供一种地址访问方法，该方法包括读操作和写操作，
[0019]所述读操作包括：
[0020]将设备端内部所有模块的同类寄存器映射到地址连续的同一地址段上；
[0021]在接收到主机端针对该地址进行访问的实读指令后，设备端通过block read访问整段地址空间，获取所有模块的同类寄存器的数据；以及将所述数据发送至主机端；
[0022]所述写操作包括：
[0023]将所有写操作编码为指令+操作数的数据格式，不携带地址信息；
[0024]主机端将连续执行的多条写操作数据存储为数据块并一次性写入设备端；
[0025]设备端在接收到主机端的写数据块后忽略写操作的地址信息，仅对数据进行逐条解码，按照数据中的指令将写操作分发给不同模块进行并行寻址寄存器，并且将对应的操作数同步写入相应的寄存器中。
[0026]本专利技术还提供一种读操作装置，包括：
[0027]地址映射模块，其用于将设备端内部所有模块的同类寄存器映射到地址连续的同一地址段上；
[0028]读操作模块，其用于在接收到主机端针对该地址进行访问的实读指令后，设备端通过block read访问整段地址空间，获取所有模块的同类寄存器的数据；
[0029]数据发送模块，其用于将所述数据发送至主机端。
[0030]本专利技术还提供一种写操作装置，包括：
[0031]编码模块，其用于将所有写操作编码为指令+操作数的数据格式，不携带地址信息；
[0032]写操作模块，其用于由主机端将连续执行的多条写操作数据存储为数据块并一次性写入设备端；
[0033]解码模块，其用于由设备端在接收到主机端的写数据块后忽略写操作的地址信
息，仅对数据进行逐条解码，按照数据中的指令将写操作分发给不同模块进行并行寻址寄存器，并且将对应的操作数同步写入相应的寄存器中。
[0034]本专利技术还提供一种地址访问系统，包括：
[0035]读操作装置，其用于将设备端内部所有模块的同类寄存器映射到地址连续的同一地址段上；在接收到主机端针对该地址进行访问的实读指令后，设备端通过block read访问整段地址空间，获取所有模块的同类寄存器的数据；将所述数据发送至主机端；
[0036]写操作装置，其用于将所有写操作编码为指令+操作数的数据格式，不携带地址信息；主机端将连续执行的多条写操作数据存储为数据块并一次性写入设备端；设备端在接收到主机端的写数据块后忽略写操作的地址信息，仅对数据进行逐条解码，按照数据中的指令将写操作分发给不同模块进行并行寻址寄存器，并且将对应的操作数同步写入相应的寄存器中。
[0037]本专利技术的上述技术方案相比现有技术具有以下优点：
[0038本文档来自技高网...
【技术保护点】
【技术特征摘要】
1.一种地址访问方法，该方法包括读操作，所述读操作按照寄存器地址访问，其特征在于：所述读操作包括：将设备端内部所有模块的同类寄存器映射到地址连续的同一地址段上；在接收到主机端针对该地址进行访问的实读指令后，设备端通过block read访问整段地址空间，获取所有模块的同类寄存器的数据；以及将所述数据发送至主机端。2.根据权利要求1所述的一种地址访问方法，其特征在于：在所述主机端发起针对所述地址进行访问的实读指令前，由所述主机端发起针对所述地址进行访问的预读指令，在接收到预读指令后，设备端将该地址的数据预先缓存在寄存器接口。3.根据权利要求2所述的一种地址访问方法，其特征在于：对多个模块同类寄存器执行读操作时，由主机端将所述预读指令同时并发给多个模块。4.一种地址访问方法，该方法包括写操作，其特征在于：所述写操作包括：将所有写操作编码为指令+操作数的数据格式，不携带地址信息；主机端将连续执行的多条写操作数据存储为数据块并一次性写入设备端；设备端在接收到主机端的写数据块后忽略写操作的地址信息，仅对数据进行逐条解码，按照数据中的指令将写操作分发给不同模块进行并行寻址寄存器，并且将对应的操作数同步写入相应的寄存器中。5.根据权利要求4所述的一种地址访问方法，其特征在于：对多个同类寄存器执行写操作时，由主机端发起列举指令，设备端在接收到列举指令后，选中需要执行寄存器写操作的模块，其他模块进入未选中模式，并将后续写操作作用于所有处于选中模式的模块。6.根据权利要求5所述的一种地址访问方法，其特征在于：处于选中模式的所有模块同步执行写操作。7.一种地址访问方法，该方法包括读操作和写操作，其特征在于：所述读操作包括：将设备端内部所有模块的同类寄存器映射到地址连续的同一地址段上；在接收到主机端针对该地址进行访问的实读指令后，设备端通过block read访问整段地址空间，获取所有模块的同类寄存器的数据；以及将所述数据发送至主...
【专利技术属性】
技术研发人员：徐润生，朱艳青，
申请(专利权)人：胜达克半导体科技上海股份有限公司，
类型：发明
国别省市：
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