本发明专利技术公开了一种基于CPCI总线的多类型信息处理装置，它包括数据处理和交互模块、第一数字信号处理器、第二数字信号处理器、CAN总线IP数据接收发送模块、1553B总线IP数据接收发送模块、UART数据接收发送模块、CPCI总线控制模块、第一FLASH数据读写模块、第二FLASH数据读写模块和SRAM数据读写模块；本发明专利技术以高性能国产微处理器DSP和可编程逻辑器FPGA为核心，结合大容量存储芯片和智能专家系统，实现智能化、自主化的信息交互和处理，同时实现了类似文件系统的功能，便于信息的更新、查阅和迁移。
Multi-type Information Processing Device and Method Based on CPCI Bus
【技术实现步骤摘要】
基于CPCI总线的多类型信息处理装置及方法
本专利技术涉及信息处理
，具体地指一种基于CPCI(CompactPeripheralComponentInterconnect)总线的多类型信息处理装置及方法。
技术介绍
传统的基于CPCI总线的信息处理装置，一般采用多块基于X86架构的CPCI总线板卡组合实现，这种结构虽然也具有信息的处理功能，但功能单一，集成化、智能化、自主化和国产化水平低，实时性不高、系统体积和功耗较大，不具备多类型信息处理能力，系统性能严重依耐计算机主板和上位机软件。因此迫切需要一种能实现智能化、集成化、自主化的多类型信息处理装置。
技术实现思路
本专利技术提供一种基于CPCI总线的多类型信息处理装置及方法，本专利技术以高性能国产微处理器DSP(DigitalSignalProcessing，数字信号处理)和可编程逻辑器FPGA(Field－ProgrammableGateArray，现场可编程门阵列)为核心，结合大容量存储芯片和智能专家系统(即预设的数据传输故障判断方式和数据传输故障处理机制)，实现智能化、自主化的信息交互和处理，同时实现了类似文件系统的功能，便于信息的更新、查阅和迁移。为实现此目的，本专利技术所设计的基于CPCI总线的多类型信息处理装置，它包括数据处理和交互模块、第一数字信号处理器、第二数字信号处理器、CAN(ControllerAreaNetwork，控制器局域网络)总线IP(IntelligentProperty核是具有知识产权核的集成电路芯核总称)数据接收发送模块、1553B总线IP数据接收发送模块、UART(UniversalAsynchronousReceiver/Transmitter，通用异步收发传输器)数据接收发送模块、CPCI总线控制模块、第一FLASH(闪存)数据读写模块、第二FLASH数据读写模块、SRAM(StaticRandom-AccessMemory，静态随机存取存储器)数据读写模块，其中，所述第一数字信号处理器和第二数字信号处理器的FPGA数据通信端分别连接数据处理和交互模块的对应控制信号接口，所述CAN总线IP数据接收发送模块的FPGA数据通信端连接数据处理和交互模块的CAN总线IP数据通信接口，1553B总线IP数据接收发送模块的FPGA数据通信端连接数据处理和交互模块的1553B总线IP数据通信接口，UART数据接收发送模块的FPGA数据通信端连接数据处理和交互模块的UART数据通信接口，CPCI总线控制模块的FPGA数据通信端连接数据处理和交互模块的CPCI总线数据通信接口，第一FLASH数据读写模块和第二FLASH数据读写模块的FPGA数据通信端分别连接数据处理和交互模块对应的FLASH数据通信接口，SRAM数据读写模块的FPGA数据通信端连接数据处理和交互模块的SRAM数据通信接口；所述第一数字信号处理器用于对数据处理和交互模块进行控制，实现第一FLASH数据读写模块和第二FLASH数据读写模块的FLASH数据读写控制；所述第一数字信号处理器用于对数据处理和交互模块进行控制实现CAN总线IP数据接收发送模块、1553B总线IP数据接收发送模块、UART数据接收发送模块、CPCI总线控制模块和SRAM数据读写模块的数据传输故障判断，并根据预设的数据传输故障处理机制进行对应的数据传输故障处理，预设的数据传输故障判断方式和数据传输故障处理机制预存在第一FLASH芯片中，数据处理和交互模块需要时通过第一FLASH数据读写模块在第一FLASH芯片中调用；所述第一数字信号处理器还用于，对与数据处理和交互模块进行交互的所有CAN总线IP数据、1553B总线IP数据、UART数据、CPCI总线数据、SRAM数据通过第二FLASH数据读写模块存储至第二FLASH芯片中；所述第二数字信号处理器用于控制数据处理和交互模块对CAN总线IP数据、1553B总线IP数据、UART数据、CPCI总线数据、SRAM数据分别按照预置的对应数据处理机制进行相应的数据处理，并将选定的数据处理结果通过CPCI总线控制模块上传至上位机。一种利用上述装置的多类型信息处理方法，它包括如下步骤：步骤1：将预设的数据传输故障判断方式和数据传输故障处理机制预存在第一FLASH芯片中，将预设的CAN总线IP数据、1553B总线IP数据、UART数据、CPCI总线数据和SRAM数据的数据处理机制存储在数据处理和交互模块；步骤2：第一数字信号处理器对数据处理和交互模块进行控制，实现第一FLASH数据读写模块和第二FLASH数据读写模块的FLASH数据读写控制；步骤3：第一数字信号处理器对数据处理和交互模块进行控制实现CAN总线IP数据接收发送模块、1553B总线IP数据接收发送模块、UART数据接收发送模块、CPCI总线控制模块和SRAM数据读写模块的数据传输故障判断，并根据预设的数据传输故障处理机制进行对应的数据传输故障处理；第一数字信号处理器对与数据处理和交互模块进行交互的所有CAN总线IP数据、1553B总线IP数据、UART数据、CPCI总线数据、SRAM数据通过第二FLASH数据读写模块存储至第二FLASH芯片中；步骤4：所述第二数字信号处理器控制数据处理和交互模块对CAN总线IP数据、1553B总线IP数据、UART数据、CPCI总线数据、SRAM数据分别按照预置的对应数据处理机制进行相应的数据处理，并将选定的数据处理结果通过CPCI总线控制模块上传至上位机。本专利技术的技术效果体现在：本专利技术的信息处理装置采用全国产化软硬件，模块化IP核设计，集成了多种总线接口，实现了智能化、集成化、自主化和全国产化，实时性高。本专利技术可解决现有此类设备功能单一，集成化、智能化、自主化和国产化水平低、实时性差，不具备多类型信息自主处理的问题，相对现有此类设备，完全实现了自主可控和智能化。本专利技术适用于车载、舰载、机载等多类型数据处理和对实时性要求较高的场景，具有较好的应用价值和推广前景。附图说明图1为本专利技术的结构框图；其中，1—数据处理和交互模块、2—第一数字信号处理器、3—CAN总线IP数据接收发送模块、3.1—CAN总线接口、4—1553B总线IP数据接收发送模块、4.1—1M1553B总线接口、5—UART数据接收发送模块、5.1—UART串行接口、6—CPCI总线控制模块、6.1—CPCI总线协议芯片、7—第一FLASH数据读写模块、7.1—第一FLASH芯片、8—SRAM数据读写模块、8.1—SRAM芯片、9—第二数字信号处理器、10—第二FLASH数据读写模块、10.1—第二FLASH芯片。具体实施方式以下结合附图和具体实施例对本专利技术作进一步的详细说明：本专利技术所设计的基于CPCI总线的多类型信息处理装置，如图1所示，它包括数据处理和交互模块1、第一数字信号处理器2、第二数字信号处理器9、CAN总线IP数据接收发送模块3、1553B总线IP数据接收发送模块4、UART数据接收发送模块5、CPCI总线控制模块6、第一FLASH数据读写模块7、第二FLASH数据读写模块10、SRAM数据读写模块8，其中，所述第一数字信号处理器2和第二数字信号处理器9的FPGA数据通信端分别连接数据本文档来自技高网...
【技术保护点】
1.一种基于CPCI总线的多类型信息处理装置，其特征在于：它包括数据处理和交互模块(1)、第一数字信号处理器(2)、第二数字信号处理器(9)、CAN总线IP数据接收发送模块(3)、1553B总线IP数据接收发送模块(4)、UART数据接收发送模块(5)、CPCI总线控制模块(6)、第一FLASH数据读写模块(7)、第二FLASH数据读写模块(10)、SRAM数据读写模块(8)，其中，所述第一数字信号处理器(2)和第二数字信号处理器(9)的FPGA数据通信端分别连接数据处理和交互模块(1)的对应控制信号接口，所述CAN总线IP数据接收发送模块(3)的FPGA数据通信端连接数据处理和交互模块(1)的CAN总线IP数据通信接口，1553B总线IP数据接收发送模块(4)的FPGA数据通信端连接数据处理和交互模块(1)的1553B总线IP数据通信接口，UART数据接收发送模块(5)的FPGA数据通信端连接数据处理和交互模块(1)的UART数据通信接口，CPCI总线控制模块(6)的FPGA数据通信端连接数据处理和交互模块(1)的CPCI总线数据通信接口，第一FLASH数据读写模块(7)和第二FLASH数据读写模块(10)的FPGA数据通信端分别连接数据处理和交互模块(1)对应的FLASH数据通信接口，SRAM数据读写模块(8)的FPGA数据通信端连接数据处理和交互模块(1)的SRAM数据通信接口；所述第一数字信号处理器(2)用于对数据处理和交互模块(1)进行控制，实现第一FLASH数据读写模块(7)和第二FLASH数据读写模块(10)的FLASH数据读写控制；所述第一数字信号处理器(2)用于对数据处理和交互模块(1)进行控制实现CAN总线IP数据接收发送模块(3)、1553B总线IP数据接收发送模块(4)、UART数据接收发送模块(5)、CPCI总线控制模块(6)和SRAM数据读写模块(8)的数据传输故障判断，并根据预设的数据传输故障处理机制进行对应的数据传输故障处理，预设的数据传输故障判断方式和数据传输故障处理机制预存在第一FLASH芯片(7.1)中，数据处理和交互模块(1)需要时通过第一FLASH数据读写模块(7)在第一FLASH芯片(7.1)中调用；所述第一数字信号处理器(2)还用于，对与数据处理和交互模块(1)进行交互的所有CAN总线IP数据、1553B总线IP数据、UART数据、CPCI总线数据、SRAM数据通过第二FLASH数据读写模块(10)存储至第二FLASH芯片(10.1)中；所述第二数字信号处理器(9)用于控制数据处理和交互模块(1)对CAN总线IP数据、1553B总线IP数据、UART数据、CPCI总线数据、SRAM数据分别按照预置的对应数据处理机制进行相应的数据处理，并将选定的数据处理结果通过CPCI总线控制模块(6)上传至上位机。...
【技术特征摘要】
1.一种基于CPCI总线的多类型信息处理装置，其特征在于：它包括数据处理和交互模块(1)、第一数字信号处理器(2)、第二数字信号处理器(9)、CAN总线IP数据接收发送模块(3)、1553B总线IP数据接收发送模块(4)、UART数据接收发送模块(5)、CPCI总线控制模块(6)、第一FLASH数据读写模块(7)、第二FLASH数据读写模块(10)、SRAM数据读写模块(8)，其中，所述第一数字信号处理器(2)和第二数字信号处理器(9)的FPGA数据通信端分别连接数据处理和交互模块(1)的对应控制信号接口，所述CAN总线IP数据接收发送模块(3)的FPGA数据通信端连接数据处理和交互模块(1)的CAN总线IP数据通信接口，1553B总线IP数据接收发送模块(4)的FPGA数据通信端连接数据处理和交互模块(1)的1553B总线IP数据通信接口，UART数据接收发送模块(5)的FPGA数据通信端连接数据处理和交互模块(1)的UART数据通信接口，CPCI总线控制模块(6)的FPGA数据通信端连接数据处理和交互模块(1)的CPCI总线数据通信接口，第一FLASH数据读写模块(7)和第二FLASH数据读写模块(10)的FPGA数据通信端分别连接数据处理和交互模块(1)对应的FLASH数据通信接口，SRAM数据读写模块(8)的FPGA数据通信端连接数据处理和交互模块(1)的SRAM数据通信接口；所述第一数字信号处理器(2)用于对数据处理和交互模块(1)进行控制，实现第一FLASH数据读写模块(7)和第二FLASH数据读写模块(10)的FLASH数据读写控制；所述第一数字信号处理器(2)用于对数据处理和交互模块(1)进行控制实现CAN总线IP数据接收发送模块(3)、1553B总线IP数据接收发送模块(4)、UART数据接收发送模块(5)、CPCI总线控制模块(6)和SRAM数据读写模块(8)的数据传输故障判断，并根据预设的数据传输故障处理机制进行对应的数据传输故障处理，预设的数据传输故障判断方式和数据传输故障处理机制预存在第一FLASH芯片(7.1)中，数据处理和交互模块(1)需要时通过第一FLASH数据读写模块(7)在第一FLASH芯片(7.1)中调用；所述第一数字信号处理器(2)还用于，对与数据处理和交互模块(1)进行交互的所有CAN总线IP数据、1553B总线IP数据、UART数据、CPCI总线数据、SRAM数据通过第二FLASH数据读写模块(10)存储至第二FLASH芯片(10.1)中；所述第二数字信号处理器(9)用于控制数据处理和交互模块(1)对CAN总线IP数据、1553B总线IP数据、UART数据、CPCI总线数据、SRAM数据分别按照预置的对应数据处理机制进行相应的数据处理，并将选定的数据处理结果通过CPCI总线控制模块(6)上传至上位机。2.根据权利要求1所述的基于CPCI总线的多类型信息处理装置，其特征在于：所述CAN总线IP数据接收发送模块(3)有四个，四个CAN总线IP数据接收发送模块(3)的FPGA数据通信端分别连接数据处理和交互模块(1)的四个对应的CAN总线IP数据通信接口；所述UART数据接收发送模块(5)有四个，四个UART数据接收发送模块(5)的FPGA数据通信端分别连接数据处理和交互模块(1)的四个对应的UART数据通信接口。3.根据权利要求1所述的基于CPCI总线的多类型信息处理装置，其特征在于：所述SRAM数据读写模块(8)有两个，两个S...
【专利技术属性】
技术研发人员：王明博，粱美红，查坤，仁钦，冯小利，鲜于琳，张锐，
申请(专利权)人：湖北三江航天万峰科技发展有限公司，
类型：发明
国别省市：湖北,42
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