The anti-delamination grinding method applied to a low dielectric material chip includes the following steps: providing a chip, a chip including a chip, a substrate and a bump, a substrate including a multi-layer sub-board, a chip connected to a sub-board of the top layer of the substrate through a bump, and a gap between the chip and the substrate filled with a filling substrate; Grinding the side of the chip, the side of the thinned substrate, and filling the underglue until the convex block in the first outer ring is exposed; polishing the side of the chip. The invention applies to the anti-delamination grinding method of the low dielectric material chips, and provides a new method for preventing delamination or bursting. By thinning the substrate, and then grinding the substrate and chips, the delamination or bursting of the chips due to grinding can be prevented, and the judgment of the experimental results can be avoided by the operator when observing the cross section. It is helpful to improve the accuracy of the experimental results, and can correctly judge whether the structure is damaged by reliability test and product deformation.
【技术实现步骤摘要】
应用于低介电材质覆晶芯片的防脱层研磨方法
本专利技术涉及半导体
,尤其是指一种应用于低介电材质覆晶芯片的防脱层研磨方法。
技术介绍
覆晶技术搭配排列方正的球栅数组(Ballgraidarry,BGA)封装制程,可以提供较好的电气特性,并且大幅地提高接脚密度,降低噪声的干扰,散热性也较佳,还可以缩小封装尺寸,以此符合高阶产品和高性能的需求,所以成为主流的封装型态。近年来,这种覆晶截构封装技术在计算机科技和3C产品上运用得非常多,例如:CPU封装ATI会图芯片等等,还有一些高阶ASIC组件产品,皆可大量的看到。如图1和图2所示,覆晶芯片主要包括芯片10、基板20、凸块11。其中,基板20用来支撑上方的芯片10或印刷电路板,基板20由多层子板结合而成,与芯片10最近的一层为铜板21,即基板20的顶层子板为铜板21;凸块11主要是连接芯片10的正面与基板20的通讯桥梁;芯片10与基板20之间的缝隙中填充有填充底胶30。覆晶芯片经过可靠性老化实验后,需经过DPA(物性失效分析)实验,确认其封装体结构是否因热应力导致产品器件遭到破坏失效,实验中需确认本身封装体截面构造是否失效。而低介电材质覆晶芯片,如LOWK芯片,芯片的正面为LOWK布线区,主要是集成电路布线区,使用一般研磨方式会导致芯片结构因人为应力导致脱层或爆裂,无法分析验证该器件是否符合老化寿命使用年限。故有必要提供一种研磨方法,使低介电材质覆晶芯片,如LOWK芯片在研磨时,不会因人为应力导致脱层或爆裂。
技术实现思路
为了解决现有技术中研磨芯片时会因人为应力导致脱层或爆裂的技术问题,本专利技术提供了一种应用 ...
【技术保护点】
1.一种应用于低介电材质覆晶芯片的防脱层研磨方法,其特征在于,包括步骤:提供覆晶芯片,所述覆晶芯片包括芯片、基板和凸块,所述基板包括多层子板,所述芯片通过所述凸块连接于所述基板的顶层的所述子板,所述芯片和所述基板之间的缝隙填充有填充底胶;减薄所述基板;研磨所述芯片的侧面、经减薄的所述基板的侧面和所述填充底胶,直至裸露出位于外围第一圈的所述凸块;抛光所述芯片的侧面。
【技术特征摘要】
1.一种应用于低介电材质覆晶芯片的防脱层研磨方法,其特征在于,包括步骤:提供覆晶芯片,所述覆晶芯片包括芯片、基板和凸块,所述基板包括多层子板,所述芯片通过所述凸块连接于所述基板的顶层的所述子板,所述芯片和所述基板之间的缝隙填充有填充底胶;减薄所述基板;研磨所述芯片的侧面、经减薄的所述基板的侧面和所述填充底胶,直至裸露出位于外围第一圈的所述凸块;抛光所述芯片的侧面。2.如权利要求1所述的应用于低介电材质覆晶芯片的防脱层研磨方法,其特征在于,所述减薄所述基板为:自所述基板的底层至顶层将所述基板减薄至所述基板的顶层的所述子板的底面。3.如权利要求1所述的应用于低介电材质覆晶芯片的防脱层研磨方法,其特征在于:使用P800砂纸进行所述减薄。4.如权利要求1至3中任一项所述的应用于低介电材质覆晶芯片的防脱层研磨方法,其特征在于,研磨所述芯片的侧面、经减薄的所述基板的侧面和所述填充底胶,直至裸露出位于外围第一圈的所述凸块的步骤包括:粗磨经减薄的所述基板的侧面和所述填充底胶,直至所述基板的四周与所述芯片的四周相平齐;细磨所述芯片的侧面、经粗磨的所述基板的侧面和所述填充底胶,直至裸露出位于外围第一圈的所述凸块。5.如权利要...
【专利技术属性】
技术研发人员:潘健成,陈清陇,
申请(专利权)人:宜特上海检测技术有限公司,
类型:发明
国别省市:上海,31
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