基于FPGA的图形化组态方法和装置制造方法及图纸

技术编号:14888009 阅读:211 留言:0更新日期:2017-03-28 18:15
本发明专利技术属于一种核电站中控制站设备算法组态的技术领域,提供了一种基于FPGA的图形化组态方法和装置,所述方法包括:有选择性地配置数据输入接口和/或数据输出接口,使得只有已经被选择的数据输入接口和/或数据输出接口对应的图形化接口图被显示;通过被显示出来的图形化接口,进行组态算法的绘制,使得所述FPGA能够按照所述绘制后的组态算法进行逻辑运算。因此,能够将外部变量接口变成参数可配,通过配置文件的设置,选择打开哪些接口或关闭哪些接口,让图形化接口图只显示打开的接口,便于使用。

【技术实现步骤摘要】

本专利技术涉及一种核电站中控制站设备算法组态的
,尤其涉及一种基于FPGA的图形化组态方法和装置
技术介绍
随着可编程逻辑器件的迅猛发展,现场可编程门阵列(FieldProgrammableGateArray,简称FPGA)已经广泛应用于工业、军工、核电和航天等领域。并且对于只在FPGA上进行算法组态的非FPGA开发人员,可以通过图形化输入的方式完成预定的逻辑运算功能,由于采用这种图形化组态的输入方法,算法组态人员不需要了解HDL(硬件描述语言,英文全称HardwareDescriptionLanguage)语言的相关知识,也能够通过图形化组态的输入方法快速地进行工程开发工作;所以图形化组态的输入方法在非FPGA开发人员应用FPGA进行工程开发工作中已经成为主流参数配置方式。现有的基于FPGA技术的图形化组态方法就是把所有模块图形化,其中由于接口模块要具备通用性(适用于各种组态情况),所以接口模块的所有接口需要全部罗列在图形化界面上,这样就导致组态算法部分与外部变量的接口非常多,占用了大量的资源、软件运行缓慢、增加了额外工作量。
技术实现思路
为了解决现有技术在进行图形化组态的输入方法中存在的对占用资源大、软件运行慢、增加工作量的技术问题,本专利技术提供一种基于FPGA的图形化组态方法和装置,能够将外部变量接口变成参数可配,通过配置文件的设置,选择打开哪些接口或关闭哪些接口,让图形化接口图只显示打开的接口,便于使用。为了实现上述目的,本专利技术提供的技术方案包括:一种基于FPGA的图形化组态方法,其特征在于,所述方法包括:有选择性地配置数据输入接口和/或数据输出接口,使得只有已经被选择的数据输入接口和/或数据输出接口对应的图形化接口图被显示;通过被显示出来的图形化接口,进行组态算法的绘制,使得所述FPGA能够按照所述绘制后的组态算法进行逻辑运算。优选地,有选择性地配置数据输入接口的方式为:当预定的数据输入接口需要作为被选择的数据输入接口时,被选择的数据输入接口按原来定义不变;当其他的数据输入接口不需要作为被选择的数据输入接口时,未被选择的数据输入接口在原定义基础上增加符号注释。优选地,有选择性地配置数据输出接口的方式为:当预定的数据输出接口需要作为被选择的数据输出接口时,被选择的数据输出接口按原来定义不变;当其他的数据输出接口不需要作为被选择的数据输出接口时,未被选择的数据输出接口在原定义基础上增加符号注释。优选地,配置所述输入参数接口用Verilog语言实现,并采用宏定义的方式,对需要选择的数据输入接口端口进行宏定义的配置。另一方面,本专利技术还提供一种基于FPGA的图形化组态装置,其特征在于,所述装置包括:数据接口配置单元,设置成对预定的数据输入接口和/或数据输出接口进行配置,使得只有已经被选择的数据输入接口和/或数据输出接口对应的图形化接口图被显示;组态算法编辑单元,将所述被显示出来的图形化接口,按照自定义进行组态算法的绘制,使得所述FPGA能够按照所述绘制后的组态算法进行逻辑运算。优选地,所述数据输入接口配置单元对数据输入接口的配置方式为:当预定的数据输入接口需要作为被选择的数据输入接口时,被选择的数据输入接口按原来定义不变;当其他的数据输入接口不需要作为被选择的数据输入接口时,未被选择的数据输入接口在原定义基础上增加符号注释。优选地,所述数据输出接口配置单元对数据输出接口的配置方式为:当预定的数据输出接口需要作为被选择的数据输出接口时,被选择的数据输出接口按原来定义不变;当其他的数据输出接口不需要作为被选择的数据输出接口时,未被选择的数据输出接口在原定义基础上增加符号注释。优选地,所述数据输入接口配置单元配置所述输入参数接口用Verilog语言实现,并采用宏定义的方式,对需要选择的数据输入接口端口进行宏定义的配置。采用本专利技术提供的上述实施方式,至少可以获得以下有益效果中的一种:1、可以对数据输入接口和/或数据输出接口通过参数进行配置,选择打开哪些接口或关闭哪些接口,让图形化接口只显示打开的接口,使接口图简单、清晰、占用更少的资源、减少额外的工作量等。2、对数据输入接口和/或数据输出接口通过参数进行配置方式,通过注释来区分,能让非FPGA开发人员快速掌握并理解。专利技术的其它特征和优点将在随后的说明书中阐述,并且,部分地从说明书变得显而易见,或者通过实施本专利技术的技术方案而了解。本专利技术的目的和其他优点可通过在说明书、权利要求书以及附图中所特别指出的结构和/或流程来实现和获得。附图说明图1为本专利技术实施例一提供的一种基于FPGA的图形化组态方法的流程图;图2为本专利技术实施例一提供的一种基于FPGA的图形化组态装置的结构框图;图3为本专利技术实施例二提供的一种基于FPGA的图形化组态方法的流程图;图4为本专利技术实施例二提供的一种基于FPGA的图形化组态装置的结构框图;图5为本专利技术实施例二提供的另一种基于FPGA的图形化组态装置的结构框图;图6为本专利技术实施例二提供的一种输入输出数据接口配置的示意图;图7为本专利技术实施例二提供的另一种输入输出数据接口配置的示意图。具体实施方式以下将结合附图及实施例来详细说明本专利技术的实施方式,借此对本专利技术如何应用技术手段来解决技术问题,并达成技术效果的实现过程能充分理解并据以实施。需要说明的是,这些具体的说明只是让本领域普通技术人员更加容易、清晰理解本专利技术,而非对本专利技术的限定性解释;并且只要不构成冲突,本专利技术中的各个实施例以及各实施例中的各个特征可以相互结合,所形成的技术方案均在本专利技术的保护范围之内。另外,在附图的流程图示出的步骤可以在诸如一组控制器可执行指令的控制系统中执行,并且,虽然在流程图中示出了逻辑顺序,但是在某些情况下,可以以不同于此处的顺序执行所示出或描述的步骤。下面通过附图和具体实施例,对本专利技术的技术方案进行详细描述:实施例一如图1所示,本专利技术提供一种基于FPGA的图形化组态方法,该方法包括:S101、配置需要打开的数据输入接口:有选择性地配置数据输入接口,使得只有已经被选择的数据输入接口对应的图形化接口图被显示,即用户可以预先想好需要哪几种接口图,然后配置与预计需要接口图对应的通道打开,打开的方式就是通过将需要打开通道的参数配置成与不需要打开通道的参数配置成不同,这样只有之前想好需要用到的算法对应的接口图被显示;S102、通过输入接口对应的显示界面,进行组态算法的绘制:通过被显示出来的图形化接口,进行组态算法的绘制,使得FPGA能够按照绘制后的组态算法进行逻辑运算;需要说明的是本实施例中的算法可以是软件、也可以是通过硬件的,还可以是部分用软件,部分用硬件来实现,并且多种算法中还可以有相同的算法出现;本实施例中的组态(Configure)”的含义是“配置”、“设定”、“设置”等意思,是指用户通过类似“搭积木”的简单方式来完成自己所需要的软件功能,而不需要编写计算机程序,也就是所谓的“组态”,所以它有时候也称为“二次开发”,组态软件就称为“二次开发平台”;S103、通过预定的输出接口输出组态算法结果:即可以通过预定设计好的通道将结果输出。当然本实施例提供中的基于FPGA的图形化组态方法的输出接口可以不限于次,还可以设置成也让用户进行自定义配置。如图2所示,本本文档来自技高网...
基于FPGA的图形化组态方法和装置

【技术保护点】
一种基于FPGA的图形化组态方法,其特征在于,所述方法包括:有选择性地配置数据输入接口和/或数据输出接口,使得只有已经被选择的数据输入接口和/或数据输出接口对应的图形化接口图被显示;通过被显示出来的图形化接口,进行组态算法的绘制,使得所述FPGA能够按照所述绘制后的组态算法进行逻辑运算。

【技术特征摘要】
1.一种基于FPGA的图形化组态方法,其特征在于,所述方法包括:有选择性地配置数据输入接口和/或数据输出接口,使得只有已经被选择的数据输入接口和/或数据输出接口对应的图形化接口图被显示;通过被显示出来的图形化接口,进行组态算法的绘制,使得所述FPGA能够按照所述绘制后的组态算法进行逻辑运算。2.根据权利要求1所述的方法,其特征在于,有选择性地配置数据输入接口的方式为:当预定的数据输入接口需要作为被选择的数据输入接口时,被选择的数据输入接口按原来定义不变;当其他的数据输入接口不需要作为被选择的数据输入接口时,未被选择的数据输入接口在原定义基础上增加符号注释。3.根据权利要求1所述的方法,其特征在于,有选择性地配置数据输出接口的方式为:当预定的数据输出接口需要作为被选择的数据输出接口时,被选择的数据输出接口按原来定义不变;当其他的数据输出接口不需要作为被选择的数据输出接口时,未被选择的数据输出接口在原定义基础上增加符号注释。4.根据权利要求1至3中任意一种所述的方法,其特征在于,配置所述输入参数接口用Verilog语言实现,并采用宏定义的方式,对需要选择的数据输入接口端口进行宏定义的配置。5.一种基于FPGA的图形化组态装置,其特征在于,所述装...

【专利技术属性】
技术研发人员:王成张春雷江国进白涛陈乃奎陈银杰史雄伟张峰
申请(专利权)人:北京广利核系统工程有限公司中国广核集团有限公司
类型:发明
国别省市:北京;11

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