【技术实现步骤摘要】
本公开涉及处理器和编译器。
技术介绍
1、日本未审查专利申请公开号2003-99409(在下文中，专利文献1)公开了在将动态可重配置处理器和运算合成器组合的系统中，多态电路被折叠成时间序列以重复使用计算器和路由资源。为此，在这种系统中，可以通过增加具有精细粒度的可重配置设备的面积效率来执行程序，可重配置设备诸如是继续使用已经被写过一次的电路的fpga(现场可编程门阵列)。
2、日本未审查专利申请公开号2008-71089(在下文中，专利文献2)公开了将以诸如c语言的运动描述语言编写的程序组合到用于诸如动态可重配置处理器的可重写可编程设备的电路装置中。在该运动合成中，生成状态转变机(fsm)和数据路径，并且生成用于根据相应状态按时间序列切换数据路径的电路装置。作为该运动合成中的并行化技术中的一种技术，已知将循环描述合成为流水线电路的方法。
3、日本未审查专利申请公开号2014-6650(在下文中，专利文献3)公开了在合成流水线电路装置的运动合成中，用于控制流水线的每个阶段的执行的方法。
技术实现思路
1、当通过可编程逻辑来配置对循环变量、累加器变量等进行重复计数的计数器电路时，存在处理中出现延迟的问题。
2、根据本说明书的描述和附图，其他目的和新颖特征将变得明显。
3、一个实施例的处理器包括多个可编程逻辑的阵列和至少一个专用计数器电路，该至少一个专用计数器电路用于对被重复修改的变量进行计数。
4、根据本实施例的处理器，由于计
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1.一种处理器，包括：
2.根据权利要求1所述的处理器，
3.根据权利要求1所述的处理器，
4.根据权利要求1所述的处理器，
5.根据权利要求2所述的处理器，
6.根据权利要求5所述的处理器，
7.根据权利要求2所述的处理器，
8.根据权利要求2所述的处理器，
9.根据权利要求1所述的处理器，
10.根据权利要求2所述的处理器，
11.根据权利要求2所述的处理器，
12.根据权利要求11所述的处理器，
13.根据权利要求1所述的处理器，
14.根据权利要求4所述的处理器，
15.一种编译器，所述编译器生成要由动态可重配置处理器执行的代码，包括：
【技术特征摘要】
1.一种处理器，包括：
2.根据权利要求1所述的处理器，
3.根据权利要求1所述的处理器，
4.根据权利要求1所述的处理器，
5.根据权利要求2所述的处理器，
6.根据权利要求5所述的处理器，
7.根据权利要求2所述的处理器，
8.根据权利要求2所述的处理器，
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【专利技术属性】
技术研发人员：户井崇雄，西野贤悟，林大悟，
申请(专利权)人：瑞萨电子株式会社，
类型：发明
国别省市：
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