本申请涉及一种预制阵列基板、显示面板及其制作方法、显示装置。预制阵列基板包括预制区、第一区以及像素驱动电路，像素驱动电路位于第一区。预制阵列基板包括第一静电防护组件。第一静电防护组件设置于预制区，第一静电防护组件包括第一静电防护电路、连接件以及虚拟像素电路，第一静电防护电路和虚拟像素电路通过连接件相连接，第一静电防护电路沿预制区的周向设置。本申请能够有效增强阵列基板的抗静电能力，提升阵列基板的良率。提升阵列基板的良率。提升阵列基板的良率。
【技术实现步骤摘要】
预制阵列基板、显示面板及其制作方法、显示装置
[0001]本申请涉及显示
，尤其涉及一种预制阵列基板、显示面板及其制作方法、显示装置。
技术介绍
[0002]阵列基板在手机、平板电脑上已获得广泛应用。阵列基板制造过程复杂，阵列基板制造过程中的易受静电击伤(ESD)的影响，增强阵列基板抗静电击伤能力对于提升阵列基板良率及降低阵列基板制造成本意义重大。
技术实现思路
[0003]本申请实施例提供一种预制阵列基板、显示面板及其制作方法、显示装置，能够有效增强阵列基板的抗静电能力，提升阵列基板的良率。
[0004]本申请第一方面的实施例提供了一种预制阵列基板，包括预制区、第一区以及像素驱动电路，预制区围绕至少部分第一区设置，像素驱动电路位于第一区。预制阵列基板包括：第一静电防护组件，设置于预制区，第一静电防护组件包括第一静电防护电路、连接件以及虚拟像素电路，第一静电防护电路和虚拟像素电路通过连接件相连接，第一静电防护电路沿预制区的周向分布。
[0005]根据本申请第一方面的实施方式，虚拟像素电路包括相互绝缘设置的多层功能层，连接件与多层功能层中的至少一者同层设置。
[0006]根据本申请第一方面的实施方式，多层功能层包括有源层和两层以上的金属层，连接件与有源层和两层以上的金属层中的至少一者同层设置。
[0007]根据本申请第一方面的实施方式，第一静电防护电路与多层功能层中的至少一者同层设置。
[0008]根据本申请第一方面的实施方式，连接件包括第一部和连接部，第一静电防护电路、虚拟像素电路以及第一部通过连接部相连接，和/或，第一静电防护电路与第一部通过连接部相连接，和/或，虚拟像素电路与第一部通过连接部相连接。其中，第一部沿第一方向的尺寸大于连接部沿第一方向的尺寸，第一方向与连接部和第一部并排设置方向相交。
[0009]根据本申请第一方面的实施方式，第一部的电阻值大于所述第一静电防护电路的电阻值。
[0010]根据本申请第一方面的实施方式，预制区包括角区，虚拟像素电路至少位于角区。
[0011]根据本申请第一方面的实施方式，预制区还包括平直区，平直区与角区围合形成预制区，虚拟像素电路至少位于平直区。
[0012]根据本申请第一方面的实施方式，虚拟像素电路位于第一静电防护电路朝向第一区的一侧。
[0013]根据本申请第一方面的实施方式，还包括第二区和第二静电防护电路，第二区位于预制区和第一区之间，第二静电防护电路位于第二区，第二静电防护电路与第一静电防
护电路电连接，和/或，第二静电防护电路与虚拟像素电路电连接。
[0014]根据本申请第一方面的实施方式，虚拟像素电路包括多个虚拟电路部，像素驱动电路包括多个像素驱动电路部，沿第二方向上像素驱动电路部的尺寸大于至少部分的虚拟电路部的尺寸。和/或，相同面积内像素驱动电路部的分布密度小于至少部分的虚拟电路部的分布密度，第二方向与预制阵列基板的厚度方向相交。
[0015]根据本申请第一方面的实施方式，虚拟电路部包括第一源/漏极、第一导电连接部、有源层以及第一栅极，第一源/漏极通过第一导电连接部与有源层电连接，各虚拟电路部的第一导电连接部在预制阵列基板上的正投影与各虚拟电路部的第一栅极在预制阵列基板上的正投影沿第二方向上为第一间距。像素驱动电路部包括第二源/漏极、第二导电连接部、有源层以及第二栅极，第二源/漏极通过第二导电连接部与有源层电连接，各像素驱动电路部的第二导电连接部在预制阵列基板上的正投影与各像素驱动电路部的第二栅极在预制阵列板上的正投影沿第二方向上为第二间距，第一间距小于或等于第二间距。
[0016]本申请第二方面的实施例还提供了一种显示面板，包括如前述的预制阵列基板。非显示区在预制阵列基板上的正投影覆盖预制区。
[0017]本申请第三方面的实施例还提供了一种显示面板的制作方法，包括：提供阵列母基板，阵列母基板包括至少一个预制阵列基板，预制阵列基板包括预制区、第一区以及像素驱动电路，预制区围绕至少部分第一区设置，第一静电防护组件位于预制区，预制阵列基板包括像素驱动电路和第一静电防护组件，像素驱动电路位于第一区，第一静电防护组件包括第一静电防护电路、连接件以及虚拟像素电路。在阵列母基板一侧形成发光功能层和封装层，得到显示母基板。切割显示母基板，得到第一显示面板，第一显示面板包括显示区和非显示区，非显示区覆盖预制区。
[0018]根据本申请第三方面的实施方式，还包括：去除第一显示面板至少部分的第一静电防护组件，以得到第二显示面板。
[0019]本申请第三方面的实施例还提供了一种显示装置，包括如前述的显示面板，或由前述制作方法制备而成的显示面板。
[0020]在本申请提供的预制阵列基板、显示面板及其制作方法、显示装置中，预制阵列基板包括预制区、第一区以及像素驱动电路。预制区围绕至少部分第一区设置，像素驱动电路位于第一区，预制阵列基板包括和第一静电防护组件。第一静电防护组件设置在预制区，第一静电防护电路沿预制区的外周边缘分布，外部静电可以集聚在第一静电防护电路中，从而减小像素驱动电路在制作过程中被外部静电击伤甚至击穿的风险，并且第一静电防护电路和虚拟像素电路通过连接件相连接，第一静电防护电路中聚集的外部静电可以被连接件和虚拟像素电路分摊，从而减小第一静电防护电路自身尺寸的同时，提高第一静电防护组件的可靠性。
附图说明
[0021]通过阅读以下参照附图对非限制性实施例所作的详细描述，本申请的其它特征、目的和优点将会变得更明显，其中，相同或相似的附图标记表示相同或相似的特征。
[0022]图1是本申请实施例提供的一种预制阵列基板的俯视结构示意图；
[0023]图2是图1中Q的一种放大结构示意图；
[0024]图3是本申请实施例提供的一种预制阵列基板的剖面结构示意图；
[0025]图4是本申请实施例提供的又一种预制阵列基板的剖面结构示意图；
[0026]图5是图1中Q的另一种放大结构示意图；
[0027]图6是本申请实施例提供的另一种预制阵列基板的俯视结构示意图；
[0028]图7是本申请实施例提供的另一种预制阵列基板的俯视结构示意图；
[0029]图8是本申请实施例提供的另一种预制阵列基板的剖面结构示意图；
[0030]图9是本申请实施例提供的一种显示面板的制备方法流程示意图；
[0031]图10是本申请实施例提供的一种阵列母基板的俯视结构示意图。
[0032]附图标记说明：
[0033]100、预制阵列基板；200、阵列母基板；
[0034]SA1、预制区；SA11、角区；SA12、平直区；SA2、第一区；SA3、第二区；AA、显示区；NA、非显示区；
[0035]10、像素驱动电路；11、像素驱动电路部；11a、第二源极；11b、第二栅极；11c、第二漏极；11d、第二导电连接部；
[0036]20、第一静电防护组件；本文档来自技高网...
【技术保护点】
【技术特征摘要】
1.一种预制阵列基板，包括预制区、第一区以及像素驱动电路，所述预制区围绕至少部分所述第一区设置，所述像素驱动电路位于所述第一区，其特征在于，所述预制阵列基板包括：第一静电防护组件，设置于所述预制区，所述第一静电防护组件包括第一静电防护电路、连接件以及虚拟像素电路，所述第一静电防护电路和所述虚拟像素电路通过所述连接件相连接，所述第一静电防护电路沿所述预制区的周向设置。2.根据权利要求1所述的预制阵列基板，其特征在于，所述虚拟像素电路包括相互绝缘设置的多层功能层，所述连接件与多层所述功能层中的至少一者同层设置；优选地，所述多层功能层包括有源层和两层以上的金属层，所述连接件与所述有源层和所述两层以上的金属层中的至少一者同层设置；优选地，所述第一静电防护电路与所述多层功能层中的至少一者同层设置。3.根据权利要求1所述的预制阵列基板，其特征在于，所述连接件包括第一部和连接部，所述第一静电防护电路、所述虚拟像素电路以及所述第一部通过所述连接部相连接，和/或，所述第一静电防护电路与所述第一部通过所述连接部相连接，和/或，所述虚拟像素电路与所述第一部通过所述连接部相连接；其中，所述第一部沿第一方向的尺寸大于所述连接部沿所述第一方向的尺寸，所述第一方向与所述连接部和所述第一部并排设置方向相交；优选地，所述第一部的电阻值大于所述第一静电防护电路的电阻值。4.根据权利要求1所述的预制阵列基板，其特征在于，所述预制区包括角区，所述虚拟像素电路至少位于所述角区；优选地，所述预制区还包括平直区，所述平直区与所述角区围合形成所述预制区，所述虚拟像素电路至少位于所述平直区；优选地，所述虚拟像素电路位于所述第一静电防护电路朝向所述第一区的一侧。5.根据权利要求1所述的预制阵列基板，其特征在于，还包括第二区和第二静电防护电路，所述第二区位于所述预制区和所述第一区之间，所述第二静电防护电路位于所述第二区，所述第二静电防护电路与所述第一静电防护电路电连接，和/或，所述第二静电防护电路与所述虚拟像素电路电连接。6.根据权利要求1所述的预制阵列基板，其特征在于，所述虚拟像素电路包括多个虚拟电路部，所述像素驱动电路包括多个像素驱动电路部，沿第...
【专利技术属性】
技术研发人员：乔盼盼，高琳华，段培，田苗苗，马志丽，
申请(专利权)人：云谷固安科技有限公司，
类型：发明
国别省市：
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