【技术实现步骤摘要】
非对称决策反馈均衡
[0001]本公开的实施例总体上涉及半导体存储器装置的领域。更具体地,本公开的实施例涉及选择性地使用半导体存储器装置的决策反馈均衡器(DFE)电路来校正传输信号中的失真。
技术介绍
[0002]存储器装置的运行速率,包含存储器装置的数据速率,一直随着时间推移而提高。作为存储器装置的速度提高的副作用,由于失真所致的数据错误可能增加。例如,可能发生传输数据之间的符号间干扰,因此先前接收的数据影响目前接收的数据(例如,先前接收的数据影响并且干扰随后接收的数据)。一种用于校正这种干扰的方式是使用决策反馈均衡器(DFE)电路,所述DFE电路可以被编程为抵消(即,消除、缓解)信道对传输数据的影响。
[0003]另外,校正传输信号中的失真仍旧很重要。然而,常规的失真校正技术可能不会充分地校正信号的失真。当应用于特定环境时,由常规的失真校正技术产生的误差对最终数据造成附加失真,因此降低在存储器装置内传输的数据的可靠性。
技术实现思路
[0004]根据本公开的一个实施例,提供一种装置。所述装置包括:决策反馈均衡器(DFE)电路,所述DFE电路在操作时接收输入位并生成与所述DFE电路在接收所述输入位之前接收的第二输入位相对应的校正位,其中所述DFE电路包括:DFE。所述DFE包括:第一接收器,所述第一接收器在操作时将所述输入位的电压电平与第一参考电压进行比较以生成具有第一逻辑电平的第一结果信号;第二接收器,所述第二接收器在操作时将所述输入位的所述电压电平与第二参考电压进行比较以生成具有第二逻辑 ...
【技术保护点】
【技术特征摘要】
1.一种装置,其包括:决策反馈均衡器DFE电路,所述DFE电路在操作时接收输入位并生成与所述DFE电路在接收所述输入位之前接收的第二输入位相对应的校正位,其中所述DFE电路包括:DFE,所述DFE包括:第一接收器,所述第一接收器在操作时将所述输入位的电压电平与第一参考电压进行比较以生成具有第一逻辑电平的第一结果信号;第二接收器,所述第二接收器在操作时将所述输入位的所述电压电平与第二参考电压进行比较以生成具有第二逻辑电平的第二结果信号;选择电路,所述选择电路包括:第一输入,所述第一输入耦合到所述第一接收器以接收所述第一结果信号;第二输入,所述第二输入耦合到所述第二接收器以接收所述第二结果信号;输出,所述输出在操作时选择性地传输所述第一结果信号和所述第二结果信号中的一个;以及控制输入,所述控制输入在操作时接收控制信号以控制所述第一结果信号和所述第二结果信号中的一个从所述输出的选择性传输;以及控制电路,所述控制电路耦合到所述控制输入,其中所述控制电路在操作时基于所述第一结果信号的所述第一逻辑电平和所述校正位的第三逻辑电平或所述第二结果信号的所述第二逻辑电平和所述校正位的所述第三逻辑电平来生成所述控制信号。2.根据权利要求1所述的装置,其中所述控制电路包括:第三输入,所述第三输入在操作时接收所述校正位;第四输入,所述第四输入在操作时接收所述第一结果信号;反相器,所述反相器耦合到所述第三输入;与非门,所述与非门具有耦合到所述反相器的第五输入、耦合到所述第四输入的第六输入;以及第二输出,所述第二输出耦合到所述与非门,其中所述第二输出在操作时传输由所述与非门生成的信号作为所述控制信号。3.根据权利要求2所述的装置,其中所述DFE包括锁存器,所述锁存器在操作时从所述第一接收器接收所述第一结果信号并延迟所述第一结果信号到所述选择电路的所述第一输入和所述控制电路的所述第四输入的传输。4.根据权利要求1所述的装置,其中所述控制电路包括:第三输入,所述第三输入在操作时接收所述校正位;第四输入,所述第四输入在操作时接收所述第二结果信号;反相器,所述反相器耦合到所述第四输入;与非门,所述与非门具有耦合到所述第三输入的第五输入、耦合到所述反相器的第六输入;以及第二输出,所述第二输出耦合到所述与非门,其中所述第二输出在操作时传输由所述与非门生成的信号作为所述控制信号。5.根据权利要求4所述的装置,其中所述DFE包括锁存器,所述锁存器在操作时从所述第二接收器接收所述第二结果信号并延迟所述第二结果信号到所述选择电路的所述第二
输入和所述控制电路的所述第四输入的传输。6.根据权利要求1所述的装置,其中所述第一接收器在时钟信号的上升沿处将所述输入位的所述电压电平与所述第一参考电压进行比较,其中所述第二接收器在所述时钟信号的所述上升沿处将所述输入位的所述电压电平与所述第二参考电压进行比较。7.根据权利要求6所述的装置,其中所述DFE包括:第三接收器,所述第三接收器在操作时将第二输入位的第二电压电平与所述第一参考电压进行比较以生成具有第四逻辑电平的第三结果信号;第四接收器,所述第四接收器在操作时将所述第二输入位的所述第二电压电平与所述第二参考电压进行比较以生成具有第五逻辑电平的第四结果信号;第二选择电路,所述第二选择电路包括:第三输入,所述第三输入耦合到所述第三接收器以接收所述第三结果信号;第四输入,所述第四输入耦合到所述第四接收器以接收所述第四结果信号;第二输出,所述第二输出在操作时选择性地传输所述第三结果信号和所述第四结果信号中的一个;以及第二控制输入,所述第二控制输入在操作时接收第二控制信号以控制所述第三结果信号和所述第四结果信号中的一个从所述输出的选择性传输;以及第二控制电路,所述第二控制电路耦合到所述第二控制输入,其中所述第二控制电路在操作时基于所述第三结果信号的所述第四逻辑电平和第二校正位的第六逻辑电平或所述第四结果信号的所述第五逻辑电平和所述第二校正位的所述第六逻辑电平来生成所述第二控制信号。8.根据权利要求7所述的装置,其中所述第三接收器在所述时钟信号的所述上升沿之后的所...
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