【技术实现步骤摘要】
低压工艺的紧凑型静电保护器件及整体静电防护方法
[0001]本专利技术涉及静电保护
,特别涉及一种低压工艺的紧凑型静电保护器件及整体静电防护方法。
技术介绍
[0002]目前,静电放电(Electro
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Static Discharge,简称ESD)是集成电路可靠性领域的一个重要分支。随着半导体制造工艺的不断发展,静电放电事件所引起的芯片/印刷电路板(Printed Circuit Board,简称PCB)损伤愈发严重,这很大程度上会延长电子产品的研发周期,增大研发费用,并很有可能恶化产品最终的使用寿命。因此,为电子产品提供有效的片上(on
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chip)ESD防护,以及为PCB电路提供可靠的片外(off
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chip)防护,如瞬变电压抑制二极管(Transient Voltage Suppressor,简称TVS),均是十分必要的。
[0003]目前,工业界典型的整体静电防护架构有两种:基于电源轨的静电防护架构和基于局部输入/输出端口(Input/Output,简称I/O)的静电防护架构,如附图9所示。其中,基于电源轨的静电防护架构通常由“二极管器件+电源钳位电路”所构成,二极管器件具有单向导通能力,通过为每个I/O端口分别配置一个上管和一个下管,借助电源钳位电路的帮助,便可以实现对所有ESD泄放模式(I/O
→
VDD,简称PD模式;I/O
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GND,简称PS模式;VDD
→
I/O,简称ND模式;G ...
【技术保护点】
【技术特征摘要】
1.一种低压工艺的紧凑型静电保护器件,其特征在于,包括:衬底,所述衬底为N型衬底或P型衬底;阱环,设置于所述衬底上;其中,所述阱环内还设置有第一重掺杂有源区;深阱区,设置于所述阱环内;阱区,设置于所述深阱区内;所述阱区内还设置有第二重掺杂有源区;其中,所述第一重掺杂有源区和第二重掺杂有源区分别连接至电源端、I/O端口和接地端。2.如权利要求1所述的一种低压工艺的紧凑型静电保护器件,其特征在于,所述衬底通过如下方式进行检测,以确定其是否存在缺陷:将预设检测光线照射至衬底上,获取反射光线;其中,所述预设检测光线为紫外线、红外线、γ射线和β射线其中一种;根据所述反射光线,生成衬底待测图像;将所述衬底待测图像转换为灰度图像,在所述灰度图像上选取多个检测区域;其中,不同检测区域不重叠;不同检测区域均设置有对应的标准图像;提取不同检测区域的各个像素的灰度值;将所述灰度值与所述标准图像的灰度值进行对比,确定灰度值高于标准图像的灰度值的像素数量;当所述像素数量不高于预设值时,所述衬底不存在缺陷;当所述像素数量高于预设值时,所述衬底存在缺陷;其中,所述预设值为衬底符合标准像素的数量值。3.如权利要求2所述的一种低压工艺的紧凑型静电保护器件,其特征在于,所述衬底为P型衬底时:所述阱环为N型阱环;所述深阱区为深N阱区;所述阱区为P型阱区;所述第一重掺杂有源区包括:第一P+重掺杂有源区、第二P+重掺杂有源区和第三P+重掺杂有源区;所述第二重掺杂有源区包括:第一N+重掺杂有源区、第二N+重掺杂有源区和第三N+重掺杂有源区。4.如权利要求2所述的一种低压工艺的紧凑型静电保护器件,其特征在于,所述衬底为N型衬底时:所述阱环为P型阱环;所述深阱区为深P阱区;所述阱区为N型阱区;所述第一重掺杂有源区包括:第一N+重掺杂有源区、第二N+重掺杂有源区和第三N+重掺杂有源区;所述第二重掺杂有源区包括:第一P+重掺杂有源区、第二P+重掺杂有源区和第三P+重
掺杂有源区。5.如权利要求1所述的一种低压工艺的紧凑型静电保护器件,其特征在于,所述阱环和深阱区用于生成隔离结构,将阱区和衬底隔离开,生成第一隔离结构;任意相邻的所述第一重掺杂有源区之间、所述第一重掺杂有源区和所述第二重掺杂有源区之间或任意相邻的所述第二重掺杂有源区之间均设置有第二隔离结构;所述第二隔离结构包括以下结构的任意一种:无隔离结构、浅沟槽隔离和场氧化层。6.如权利要求5所述的一种低压工艺的紧凑型静电保护器件,其特征在于,所述无隔离结构通过如下步骤形成:步骤1:获取所述衬底的第一光刻模板,并仿真出第一无隔离结构,并在所述无隔离结构种设置测试区;其中,所述第一光刻模板设置有电流路径的路径走向标记;步骤2:根据所述测试区对所述第一无隔离结构的有源区进行模拟,并对模拟结果进行电流路径测试,获取测试结果;步骤3:根据所述测试结果,判断所述电流路径是否与所述路径走向标记一致;步骤4:当所述路径走向标记一致时,将所述第一无隔离结构作为目标无隔离结构。7.如权利要求6所述的一种低压工艺的紧凑型静电保护器件,其特征在于,所述场氧化层设置于所述沟槽的内壁;其中,所述内壁还包括一种用于调节所述内壁曲线的调节方法,包括...
【专利技术属性】
技术研发人员:高东兴,郑家强,
申请(专利权)人:深圳市晶扬电子有限公司,
类型:发明
国别省市:
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