用于动态源同步采样调整的数据总线机制制造技术

技术编号:3468788 阅读:177 留言:0更新日期:2012-04-11 18:40
一种用于采样系统总线上顺序声明的数据包的集成器件,包括用于接收总线时钟信号的时钟输入端,用于接收数据包并检测指示数据有效的至少一个数据选通信号的数据总线接口,以及动态源同步采样调整逻辑电路。动态源同步采样调整逻辑电路包括响应于数据选通选择并锁存每个数据包并提供锁存数据包的采样逻辑电路,以及根据读指针从锁存数据包中进行选择的选择逻辑电路。一种在一个或多个总线时钟周期中采样系统总线上顺序声明数据包的方法,包括检测数据选通的工作沿,对于每个所检测的工作沿选择一个数据包,以及锁存每个所选择的数据包。

【技术实现步骤摘要】

【技术保护点】
一种动态源同步采样调整系统,用于在至少一个总线时钟周期的每一个期间,采样分布在数据总线上多个序列数据拍中的多个数据包,其中提供至少一个数据选通,其指示多个数据包中每一个的有效性,所述动态源同步采样调整系统包括:多个第一多路复用器,每个具有与数据总线连接的第一输入端,接收多个锁存数据包中对应的一个的第二输入端,接收多个选择信号中对应的一个的选择输入端,以及一输出端;多个寄存器,每个具有与所述多个第一多路复用器中对应的一个输出连接的输入端,提供所述多个锁存数据包中对应的一个的输出端,以及接收至少一个数据选通的时钟输入端;至少一个第二多路复用器,具有与所述多个寄存器的对应输出连接的多个输入端,提供从所述多个锁存数据包中选择的一个的输出端,以及接收读指针的选择输入端;以及定时逻辑电路,具有接收至少一个数据选通的至少一个输入端,以及提供所述多个选择信号的多个输出端。

【技术特征摘要】
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【专利技术属性】
技术研发人员:达赖厄斯D嘉斯金斯
申请(专利权)人:威盛电子股份有限公司
类型:发明
国别省市:71[中国|台湾]

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