本申请涉及一种卷积数据处理方法、装置、卷积运算加速器、存储介质和计算机程序产品。所述方法包括：接收输入到集成电路芯片中的待处理数据；对所述待处理数据的时序进行延迟处理，得到所述待处理数据的延迟时序信息；根据所述待处理数据的延迟时序信息，将所述待处理数据发送至卷积计算单元进行卷积运算，得到对应的卷积运算结果。采用本方法能够降低了集成电路芯片的电路规模。电路芯片的电路规模。电路芯片的电路规模。
【技术实现步骤摘要】
卷积数据处理方法、装置、卷积运算加速器和存储介质
[0001]本申请涉及电子电路
，特别是涉及一种卷积数据处理方法、装置、卷积运算加速器、存储介质和计算机程序产品。
技术介绍
[0002]在数据处理
中，通常使用FPGA（Field Programmable Gate Array，现场可编程门阵列）芯片来执行的相关卷积运算，例如通过FPGA芯片来执行图像数据的卷积计算。
[0003]传统技术中，使用FPGA芯片的计算单元实现卷积运算，都需要通过触发器（Flip Flop）对数据进行打拍延迟处理，从而控制卷积数据在FPGA芯片中的时序正确性；但是，这种方式会消耗大量的触发器资源，导致电路规模增加。
技术实现思路
[0004]基于此，有必要针对上述技术问题，提供一种能够降低电路规模的卷积数据处理方法、装置、卷积运算加速器、计算机可读存储介质和计算机程序产品。
[0005]第一方面，本申请提供了一种卷积数据处理方法。所述方法包括：接收输入到集成电路芯片中的待处理数据；对所述待处理数据的时序进行延迟处理，得到所述待处理数据的延迟时序信息；根据所述待处理数据的延迟时序信息，将所述待处理数据发送至卷积计算单元进行卷积运算，得到对应的卷积运算结果。
[0006]在其中一个实施例中，所述对所述待处理数据的时序进行延迟处理，得到所述待处理数据的延迟时序信息，包括：通过前置电路对所述待处理数据的时序进行延迟处理，得到所述待处理数据的延迟时序信息。
[0007]在其中一个实施例中，所述前置电路包括延迟装置；所述延迟装置通过至少一个寄存器构成。
[0008]在其中一个实施例中，对所述待处理数据的时序进行延迟处理，得到所述待处理数据的延迟时序信息，包括：确定所述待处理数据对应的数据组；当所述待处理数据包括至少两个数据组时，将所述待处理数据中的第一数据组发送至卷积计算单元，对所述待处理数据中除所述第一数据组以外的数据组进行延迟处理，得到所述待处理数据中除所述第一数据组以外的数据组的延迟时序信息。
[0009]在其中一个实施例中，对所述待处理数据中除所述第一数据组以外的数据组进行延迟处理，得到所述待处理数据中除所述第一数据组以外的数据组的延迟时序信息，包括：对所述待处理数据中除所述第一数据组以外的数据组的时序进行延迟处理，得到所述待处理数据中除所述第一数据组以外的每个数据组的第一延迟时序信息；
根据所述第一延迟时序信息，将所述待处理数据中的第二数据组发送至所述卷积计算单元；对所述待处理数据中除所述第一数据组和所述第二数据组以外的每个数据组的第一延迟时序信息进行延迟处理，得到所述待处理数据中除所述第一数据组和所述第二数据组以外的每个数据组的第二延迟时序信息；根据所述第二延迟时序信息，将所述待处理数据的第三数据组发送到所述卷积计算单元，直到将所述待处理数据中的最后一个数据组发送到所述卷积计算单元。
[0010]在其中一个实施例中，根据所述待处理数据的延迟时序信息，将所述待处理数据发送至卷积计算单元进行卷积运算，得到对应的卷积运算结果，包括：获取所述待处理数据对应的权重；根据所述待处理数据的延迟时序信息，分别将所述待处理数据和所述待处理数据对应的权重输入到所述卷积计算单元进行卷积运算，得到所述卷积计算单元输出的所述卷积处理结果。
[0011]在其中一个实施例中，分别将所述待处理数据和所述待处理数据对应的权重输入到所述卷积计算单元进行卷积运算，得到所述卷积计算单元输出的所述卷积处理结果，包括：根据各个所述卷积计算单元，分别对所述待处理数据中各数据组和所述各数据组对应的权重进行乘加运算，得到所述各个所述卷积计算单元输出的乘加运算结果；所述各个所述卷积单元以并行方式进行乘加运算；对所述各个所述卷积计算单元输出的乘加运算结果进行相加，得到所述卷积处理结果。
[0012]在其中一个实施例中，根据各个所述卷积计算单元，分别对所述待处理数据中各数据组和所述各数据组对应的权重进行乘加运算，得到所述各个所述卷积计算单元输出的乘加运算结果，包括：在各个所述卷积计算单元中，分别对第一数据组和所述第一数据组对应的权重进行乘加运算，得到第一乘加运算结果；根据第一延迟时序信息，触发所述卷积计算单元对第二数据组、所述第二数据组对应的权重和所述第一乘加运算结果进行乘加运算，得到第二乘加运算结果；根据第二延迟时序信息，触发所述卷积计算单元对第三数据组、所述第三数据组对应的权重和所述第二乘加运算结果进行乘加运算，得到第三乘加运算结果，直到得到所述乘加运算结果。
[0013]第二方面，本申请还提供了一种卷积数据处理装置。所述装置包括：数据接收模块，用于接收输入到集成电路芯片中的待处理数据；前置电路模块，用于对所述待处理数据的时序进行延迟处理，得到所述待处理数据的延迟时序信息；卷积运算模块，用于根据所述待处理数据的延迟时序信息，将所述待处理数据发送至卷积计算单元进行卷积运算，得到对应的卷积运算结果。
[0014]第三方面，本申请还提供了一种卷积运算加速器。所述卷积运算加速器包括存储器和处理器，所述存储器存储有计算机程序，所述处理器执行所述计算机程序时实现以下
步骤：接收输入到集成电路芯片中的待处理数据；对所述待处理数据的时序进行延迟处理，得到所述待处理数据的延迟时序信息；根据所述待处理数据的延迟时序信息，将所述待处理数据发送至卷积计算单元进行卷积运算，得到对应的卷积运算结果。
[0015]第四方面，本申请还提供了一种计算机可读存储介质。所述计算机可读存储介质，其上存储有计算机程序，所述计算机程序被处理器执行时实现以下步骤：接收输入到集成电路芯片中的待处理数据；对所述待处理数据的时序进行延迟处理，得到所述待处理数据的延迟时序信息；根据所述待处理数据的延迟时序信息，将所述待处理数据发送至卷积计算单元进行卷积运算，得到对应的卷积运算结果。
[0016]第五方面，本申请还提供了一种计算机程序产品。所述计算机程序产品，包括计算机程序，该计算机程序被处理器执行时实现以下步骤：接收输入到集成电路芯片中的待处理数据；对所述待处理数据的时序进行延迟处理，得到所述待处理数据的延迟时序信息；根据所述待处理数据的延迟时序信息，将所述待处理数据发送至卷积计算单元进行卷积运算，得到对应的卷积运算结果。
[0017]上述卷积数据处理方法、装置、卷积运算加速器、存储介质和计算机程序产品，通过接收输入到集成电路芯片中的待处理数据，对待处理数据的时序进行延迟处理，得到待处理数据的延迟时序信息；根据待处理数据的延迟时序信息，将待处理数据发送至卷积计算单元进行卷积运算，得到对应的卷积运算结果。采用本方法，先对输入到集成电路芯片中的待处理数据进行延迟延迟处理，再利用卷积计算单元进行卷积处理，相较于在卷积计算单元中对待处理数据进行延迟处理，本方法消耗了更少的用于处理延迟的资源，有效地降低了集成电路芯片的电路规模。
附图说明
[0018]图1为一个实施例中卷积数据处理方法的流程示意图；图2为一个实施本文档来自技高网...
【技术保护点】
【技术特征摘要】
1.一种卷积数据处理方法，其特征在于，所述方法包括：接收输入到集成电路芯片中的待处理数据；对所述待处理数据的时序进行延迟处理，得到所述待处理数据的延迟时序信息；根据所述待处理数据的延迟时序信息，将所述待处理数据发送至卷积计算单元进行卷积运算，得到对应的卷积运算结果。2.根据权利要求1所述的方法，其特征在于，所述对所述待处理数据的时序进行延迟处理，得到所述待处理数据的延迟时序信息，包括：通过前置电路对所述待处理数据的时序进行延迟处理，得到所述待处理数据的延迟时序信息。3.根据权利要求2所述的方法，其特征在于，所述前置电路包括延迟装置；所述延迟装置通过至少一个寄存器构成。4.根据权利要求1所述的方法，其特征在于，所述对所述待处理数据的时序进行延迟处理，得到所述待处理数据的延迟时序信息，包括：确定所述待处理数据对应的数据组；当所述待处理数据包括至少两个数据组时，将所述待处理数据中的第一数据组发送至卷积计算单元，对所述待处理数据中除所述第一数据组以外的数据组进行延迟处理，得到所述待处理数据中除所述第一数据组以外的数据组的延迟时序信息。5.根据权利要求4所述的方法，其特征在于，所述对所述待处理数据中除所述第一数据组以外的数据组进行延迟处理，得到所述待处理数据中除所述第一数据组以外的数据组的延迟时序信息，包括：对所述待处理数据中除所述第一数据组以外的数据组的时序进行延迟处理，得到所述待处理数据中除所述第一数据组以外的每个数据组的第一延迟时序信息；根据所述第一延迟时序信息，将所述待处理数据中的第二数据组发送至所述卷积计算单元；对所述待处理数据中除所述第一数据组和所述第二数据组以外的每个数据组的第一延迟时序信息进行延迟处理，得到所述待处理数据中除所述第一数据组和所述第二数据组以外的每个数据组的第二延迟时序信息；根据所述第二延迟时序信息，将所述待处理数据的第三数据组发送到所述卷积计算单元，直到将所述待处理数据中的最后一个数据组发送到所述卷积计算单元。6.根据权利要求1所述的方法，其特征在于，所述根据所述待处理数据的延迟时序信息，将所述待处理数据发送至卷积计算单元进行卷积运算，得到对应的卷积运算结果，包括：获取所述待处理数据对应的权重...
【专利技术属性】
技术研发人员：梁猷强，张斌，刘钊含，沈小勇，吕江波，
申请(专利权)人：北京思谋智能科技有限公司，
类型：发明
国别省市：
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