抗干扰的打印机并行接口控制系统技术方案

一种抗干扰的打印机并行接口控制系统，包括ＩＥＥＥ１２８４协议模块，打印机控制器模块，其特征在于打印机并行接口的控制线回路中加入数字化干扰防护模块，该数字化干扰防护模块包括参数寄存器Ａ，输入比较器Ａ，延迟计数器Ａ，延迟比较器Ａ，取样锁存器Ａ和取样锁存器Ｃ，其中输入比较器Ａ接入控制线和取样锁存器Ａ信号，延迟计数器Ａ和取样锁存器Ａ接入输入比较器Ａ输出的计数控制信号，参数寄存器Ａ接ＣＰＵ接口，延迟比较器Ａ接延迟计数器Ａ和参数寄存器Ａ的输出，取样锁存器Ｃ接取样锁存器Ａ和延迟比较器Ａ的输出，通过控制线向ＩＥＥＥ１２８４协议模块输出控制信号。（*该技术在2013年保护过期，可自由使用*）

【技术实现步骤摘要】
抗干扰的打印机并行接口控制系统
：本技术涉及计算机
，尤其涉及一种抗干扰的打印机并行接口控制系统。
技术介绍
：IEEE1284高速并行接口是目前最为广泛使用的打印机接口标准之一。在高速打印机的接口设计中，抗干扰能力和数据传输速率方面的设计质量，对打印机产品的用户环境适应性、工作稳定性和打印速度有着重要的影响。随着PC主机软硬件性能的高速发展，目前比较复杂的打印作业，如汉字激光打印和图形图象输出应用领域，几乎全部或越来越多地采用传输数据量较大的光栅图象压缩方式，因而对打印机并行口的数据传输速率的要求越来越高。为了满足数据传输速率方面的要求，人们往往不得不牺牲干扰防护方面的性能，因而对主机接口控制器的性能或接口电气环境的要求随之提高。另一方面，为了不过分降低干扰防护能力，目前多数产品设计中一般又不得不把数据传输速率限定在500K Byte/S之内，因而对充分发挥高速激光打印机的性能很不利。图1所示的是一种典型的打印机并行接口抗干扰解决方案。xCtrol[3..0]表示打印机并行口的4条输入控制线：nInit，nSelectIn，nAutoFd，nStrobe，；XD[7..0]表示8条双向数据线；xStatus[4..0]表示5条输出状态线：Perror，nAck，Busy，nFault，Select。图2a和图2b是常规打印机并行接口常用的抗干扰电原理图：W为限幅保护二极管，Rup为逻辑上拉电阻，T为schmitt反相整形器。在实际电路设计中，一般满足条件：R＜＜Rup，R＜＜Rsr(反相器输入电阻)，所以R和C的参数选择和schmitt整形器的V+和V-参数，基本上决定了该电路的抗干扰能力和可能达到的数据传输速率。典型的RC低通滤波网络具有电路简单和硬件成本低等优点，但在提高干扰防护能力和数据速率方面存在一些难以兼顾的矛盾。例如：选择较大的RC时间常数对提高干扰防护能力有利，但数据传输速率方面的性能很容易变劣。例如：-->根据IEEE1284并行接口规范，在高速ECP工作模式下的nStrobe信号线的信号脉冲宽度可能小到500ns(参见图3)以下。根据脉冲电路的暂态分析知识，我们知道为了满足较大数据传输速率的要求，RC参数的选择一般需要满足3RC＜500ns。进一步工程估算表明，为了满足1Mbyte/S左右数据速率的要求，该电路可有效滤除的干扰脉冲的最大宽度不容易超过40ns，所以如果在非信号区间(本例中40ns..500ns)内出现脉冲干扰，那么只要幅度突破schmitt整形器的门槛电压V+(约1.6V)和V-(约0.8V)，就很可能导致打印误码或其他稳定性问题。在主机和打印机的并行口接驳方式中，在设备端观察到的干扰多以单脉冲“毛刺”形式出现，但跳变振铃和随机序列脉冲也偶有发生实例。如果干扰出现在数据线，容易引起打印误码问题；如果干扰出现在控制线，除了误码之外还往往导致IEEE1284接口协议状态机的混乱。考察上述常规的解决方法，在于扰有效防护区(＝＜40ns)和信号区(＞＝500ns)之间存在一个很宽的过渡区域，是限制干扰防护和数据速率性能提升的外在表现。换言之，如果设法把该过渡区域的下限提高，但上限保持不变甚至下移，那么等效于同时提升打印机并行接口的上述两个主要的性能指标，对高速打印机应用很有意义。就目前常见的产品设计应用技术而言，传统的模拟干扰防护技术很难有效和高性能价格比地解决这类问题。
技术实现思路
：本技术的目的在于针对打印机的控制线干扰问题，提供一种简单实用的抗干扰系统。本技术的抗干扰的打印机并行接口控制系统，包括IEEE1284协议模块，打印机控制器模块，其特征在于打印机并行接口的控制线回路中加入数字化干扰防护模块，该数字化干扰防护模块包括参数寄存器A，输入比较器A，延迟计数器A，延迟比较器A，取样锁存器A和取样锁存器C，其中输入比较器A接入控制线和取样锁存器A信号，延迟计数器A和取样锁存器A接入输入比较器A输出的计数控制信号，参数寄存器A接CPU接口，延迟比较器A接延迟计数器A和参数寄存器A的输出，取样锁存器C接取样锁存器A和延迟比较器A的输出，通过控制线向IEEE1284协议模块输出控制信号。本技术中的控制线输入可通过RC低通滤波网络和schmitt整形器与外部-->接口隔离。如果对数据速率有较高的要求，应注意选择适当的RC参数值，以免对设计期望值产生明显的影响。本技术的原理是在打印机并行接口的控制线回路中插入附加的数字化干扰防护模块，去除干扰信号之后，再输出给后继的IEEE1284逻辑模块；本技术去除干扰信号的模式是：1)由参数寄存器A根据经验数据，设定干扰信号的计数阈值X的值；2)输入比较器A通过比较取样锁存器A和控制线信号输入Ctrol[3..0]，实时监视控制线信号输入的各种跳变；当两组对应信号线的逻辑电平完全相同时，输入比较器A将输出正有效的计数控制信号CountA，对延迟计数器A执行“同步计数”的操作，对取样锁存器A执行“数据保持”的操作；当两组对应信号线的逻辑电平不同时，输入比较器A将输出无效的计数控制信号CountA，对延迟计数器A执行“复位清0”的操作，对取样锁存器A执行“取样更新”的操作；3)当延迟计数器A的计数值等于或大于参数寄存器A的预设限值计数阈值X的值时，延迟比较器A将产生正有效的取样控制信号SampleC，对取样锁存器C执行“取样更新”的操作，取样更新数据来自取样锁存器A的输出；4)取样锁存器C的输出CtrolQ[3..0]就是去除了干扰信号的控制线信号。本技术适合如下苛刻的干扰模型：1)在1条或多条控制线上可同时出现脉冲干扰；2)单脉冲干扰的最大宽度Tnoise_p不大于设计限值Tnoise；3)序列脉冲干扰的最大持续时间Tnoise_c在协议限制范围内没有限制。本技术方法的特点在于：1)在保持较高数据传输速率前提条件下，可有效抑制控制线上出现的宽度不大于Tnoise的单脉冲干扰；2)在保持较高数据传输速率前提条件下，可有效抑制控制线上出现的序列脉冲干扰，干扰持续时间在协议允许范围内没有限制；3)当序列脉冲干扰出现时，本技术具有自动动态调整数据速率的能力；4)在并行口控制线的抗干扰能力和数据速率之间确立了一种准定量的关系-->式和简单可行的数字化转换途径。通过可编程参数寄存器引入的CPU控制接口，不但可以增加工程设计的灵活性(如时钟频率选择)，而且可以根据实际需要进一步优化控制参数，使这种数字化转换途径在更大范围内灵活切换；5)本技术亦可施加在部分控制线组合上面；6)本技术适合采用FPGA或者ASIC的产品设计工艺。附图说明：图1：典型的打印机并行接口抗干扰原理块图图2a、2b：基于RC模拟滤波技术的抗干扰原理图(nStrobe信号线为例)图3：ECP工作模式下高速并行口的部分信号线的时序图示例图4：打印机并行口的数字化抗干扰模块的引入位置说明图图5：数字化抗干扰模块的基本构成形式图6：脉冲干扰消除和自动数据传输速率动态调整的波形示意图具体实施方式：参见图5，本技术数字化干扰防护模块由输入比较器A、延迟计数器A、延迟比较器A、可编程参数寄存器A、取样锁存器A和取样锁存器C等本文档来自技高网...

【技术保护点】

【技术特征摘要】
1、一种抗干扰的打印机并行接口控制系统，包括IEEE1284协议模块，打印机控制器模块，其特征在于打印机并行接口的控制线回路中加入数字化干扰防护模块，该数字化干扰防护模块包括参数寄存器A，输入比较器A，延迟计数器A，延迟比较器A，取样锁存器A和取样锁存器C，其中输入比较器A接入控制线和取样锁存器A信号，延迟计数器A和取样锁存器A接入...

【专利技术属性】
技术研发人员：陈文先，徐忠良，
申请(专利权)人：上海北大方正科技电脑系统有限公司，
类型：实用新型
国别省市：