【技术实现步骤摘要】
【技术保护点】
通过把具有ｎ／２位宽度数据总线的存储器与／或Ｉ／Ｏ装置连接到具有ｎ位宽度数据总线的微处理机而构成的微处理机系统，包括：上述的微处理机；在存取ｎ位存储器与／或Ｉ／Ｏ装置的状态下，用于产生控制信号的时间发生器；用于向上述的存储器与／ 或Ｉ／Ｏ装置发送读／写控制信号，并向地址锁存计数器装置发送由上述微处理机产生的状态数据所得到的地址锁存控制信号的读／写控制器装置；用于响应来自上述读／写控制器装置的控制信号从上述微处理机取出地址，并将此地址传送到上述存储器与／或Ｉ／Ｏ装 置的地址锁存计数器；用于响应来自上述时间发生器装置的控制信号，将总线设置为存取上述有ｎ位宽度数据总线的存储器与／或Ｉ／Ｏ装置状态的总线转换器；其特征在于：上述时间发生器装置包括以下装置：用于检测出上述微处理机当前执行的指令是 对上述存储器与／或Ｉ／Ｏ装置的需要两个存取周期的字传送指令，并确定该指令存取的起始地址是偶数地址还是奇数地址；用于当该指令被确定为定时上述存储器与／或Ｉ／Ｏ装置的字传送指令时，向上述微处理机发送控制信号，在第一个存取周期中，该控制信号将 上述...
【技术特征摘要】
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