一种总线接收器，用以接收与一并行总线连结的一芯片所产生的至少一第一信号以及一第二信号，总线接收器包含有一接收模块以及一解偏差模块。接收模块连结至并行总线，用以接收经由并行总线传送的第一信号以及第二信号；解偏差模块连接至接收模块，用以调整第一信号以及第二信号的相位，使得第一信号与第二信号的相位同步。本发明专利技术亦揭露一种总线信号相位同步方法。
【技术实现步骤摘要】
本专利技术关于一种接收器，特别关于一种应用于并行总线的接收器。
技术介绍
随着集成电路技术的持续进步，处理器数据位元处理速度也一直在往上提升，但是若要在整体的系统中维持一个最佳的效能，其它组件与芯片之间传输的位率(bit rate)也需要一直增加，好配上处理器的速度以发挥最大的功效。请参照图1所示，一印刷电路板1包含一并行总线11、两个芯片12、13，并行总线11与芯片12及芯片13电性连接。芯片12通过并行总线11接收芯片13所发送的多个数据信号131及一时钟信号132。并行总线11为一内存总线(memory bus)，芯片13为DDR-SDRAM或SDRAM，而芯片12为一与如CPU、图形显示卡(graphic card)或输入、输出端口等组件连接的系统芯片组。然而，虽然各所述数据信号131与时钟信号132是同步地由芯片13发送，但是由于并行总线11的各信号线的长度不一致、或芯片12或芯片13的封装基板上各信号线长度不一致、或芯片12与芯片13的封装接合点不同等因素，使得芯片12与芯片13之间传输所述数据信号131及时钟信号132的各信号线的传输路径长度不一致，因而各数据信号131彼此之间以及各数据信号131与时钟信号132之间容易产生信号偏差(skew)，因而降低系统效能。公知技术中虽然依靠布线工程师将印刷电路板1、芯片12与芯片13的封装基板上各信号线的长度调整为一致以降低各数据信号之间的偏差，但是这种做法必须要主机板1、芯片12与芯片13皆经由良好的布线设计方能够避免各信号线的传输路径长度不一致。因此，如何在接收器中减少各数据信号之间的偏差，以适应主机板或封装基板因布线而导致各信号线传输路径长度不一致的情况，进而提高接收器数据传输的效能，实属当前重要课题之一。
技术实现思路
有鉴于上述课题，本专利技术提供一种可以除去信号间的相位偏差的。依本专利技术的一种总线接收器，用以接收与一并行总线连结的一芯片所产生的至少一第一信号以及一第二信号，接收器包含有一接收模块以及一解偏差模块。接收模块连结至并行总线，用以接收经由并行总线传送的第一信号以及第二信号；解偏差模块连接至接收模块，用以调整第一信号以及第二信号的相位，使得第一信号与第二信号的相位同步。本专利技术另提供一种总线信号相位同步方法，应用于连结于一并行总线的一芯片上，使得并行总线接收芯片发出的至少一第一信号以及一第二信号的相位同步，该方法包含有比较第一信号以及第二信号的相位，致能一第一相位偏移信号或一第二相位偏移信号；以及根据第一相位偏移信号或第二相位偏移信号调整发送第一信号以及第二信号的延迟时间。承上所述，因依本专利技术的比较第一信号及第二信号的相位，并藉此调整第一信号以及第二信号的相位，使第一信号与第二信号的相位彼此接近，因此第一信号与第二信号间的偏差得以消除，进而提高接收器的传输速率及数据传输的效能。附图说明图1为公知印刷电路板的一区块图；图2为依据本专利技术较佳实施例的总线接收器的一区块图；图3为依据本专利技术较佳实施例的总线接收器的另一区块图；图4为依据本专利技术较佳实施例的总线接收器，其中过滤单元与相位偏移信号的一示意图；图5为依据本专利技术较佳实施例的总线接收器，其中解偏差模块的一区块图； 图6为依据本专利技术较佳实施例的总线接收器，其中信号解偏差后的一示意图；图7为依据本专利技术较佳实施例的总线接收器，其中信号解偏差后的另一示意图；图8为依据本专利技术另一较佳实施例的总线接收器的一区块图；图9为依据本专利技术另一较佳实施例的总线接收器，其中解偏差模块的一区块图；图10为依据本专利技术另一较佳实施例的总线接收器，其中信号解偏差后的一示意图；图11为显示依据本专利技术另一较佳实施例的总线接收器，其中信号解偏差后的另一示意图；以及图12为依据本专利技术较佳实施例的一种总线信号相位同步方法的一流程图。组件符号说明1印刷电路板11并行总线12芯片13芯片131数据信号132时钟信号2并行总线3芯片4接收器41接收模块42解偏差模块421延迟单元4211延迟控制器4212计数器422比较单元423过滤单元 4231-4236D型正反器4237、4238与门424极限计数器425调整单元Clk时钟信号Cv计数值Dv延迟值Data0-Datan+1数据信号Mup第一解偏差极限信号Mdn第二解偏差极限信号P01、P02总线信号相位同步方法的步骤S10-S1n第一信号S20第二信号UP第一相位偏移信号UP’第三相位偏移信号DN第二相位偏移信号DN’第四相位偏移信号具体实施方式以下将参照相关图式，说明依据本专利技术较佳实施例的，其中相同的组件将以相同的参照符号加以说明。请参照图2所示，本专利技术较佳实施例的一接收器4与一并行总线2的一端电性连接，并行总线2的另一端电性连接一芯片3，其中芯片3产生多个第一信号S10-S1n与一第二信号S20。接收器4包含一接收模块41及一解偏差模块42，接收模块41与并行总线2电性连接，并通过并行总线2接收芯片3所发送的第一信号S10-S1n与第二信号S20；解偏差模块42与接收模块41电性连接以分别接收第一信号S10-S1n与第二信号S20，并调整第二信号S20及第一信号S10-S1n的相位，使第二信号S20及第一信号S10-S1n同步。第二信号S20可为一数据信号或一时钟信号，第一信号S10-S1n可为数据信号，若第一信号S10-S1n与第二信号S20同步地自芯片3发送却不同步地到达接收模块41，解偏差模块42可调整第一信号S10-S1n及第二信号S20的相位以同步第一信号S10-S1n与第二信号S20。请参照图3所示，以下将以第一信号S10-S1n为数据信号Data0-Datan，第二信号S20为一时钟信号Clk说明本实施例的接收器4。解偏差模块42与接收模块41电性连接以接收数据信号Data0-Datan与时钟信号Clk。解偏差模块42包含多个延迟单元421及多个比较单元422，为简化说明起见，以下将举数据信号Datan来说明信号解偏差过程，其余数据信号亦具有相同的信号解偏差过程。延迟单元421与接收模块41电性连接以接收数据信号Datan，比较单元422可为一相位检测器，且与延迟单元421及接收模块41电性连接以分别接收数据信号Datan与时钟信号Clk，并比较数据信号Datan与时钟信号Clk的相位差。在本实施例中，当数据信号Datan落后于时钟信号Clk时，比较单元422致能一第一相位偏移信号UP，若数据信号Datan较严重地落后于时钟信号Clk时，比较单元422会在连续的时钟周期不间断地致能第一相位偏移信号UP；反之，当数据信号Datan领先于时钟信号Clk时，比较单元422致能一第二相位偏移信号DN，若数据信号Datan较严重地领先于时钟信号Clk时，比较单元422会在连续的时钟周期不间断地致能第二相位偏移信号DN。延迟单元421接收第一相位偏移信号UP及第二位偏移信号DN，并当第一相位偏移信号UP致能时减少发送数据信号Datan的延迟时间，当第二相位偏移信号DN致能时增加发送数据信号Datan的延迟时间，因此数据信号Datan的延迟发送时间得以控制，数据信号Datan与时钟信号Clk同步化。另外，如图4所示，解偏差模块42更包含一过滤单元423，过滤单元本文档来自技高网...
【技术保护点】
一种总线接收器，用以接收与一并行总线连结的一芯片所产生的至少一第一信号以及一第二信号，该接收器包含：一接收模块，连结至所述并行总线，用以接收经由所述并行总线送的所述第一信号以及所述第二信号；以及一解偏差模块，连接至所述接收模 块，用以调整所述第一信号以及所述第二信号的相位，使得所述第一信号与所述第二信号的相位同步。
【技术特征摘要】
US 2005-9-1 60/712,8501.一种总线接收器，用以接收与一并行总线连结的一芯片所产生的至少一第一信号以及一第二信号，该接收器包含一接收模块，连结至所述并行总线，用以接收经由所述并行总线送的所述第一信号以及所述第二信号；；以及一解偏差模块，连接至所述接收模块，用以调整所述第一信号以及所述第二信号的相位，使得所述第一信号与所述第二信号的相位同步。2.如权利要求1的总线接收器，其中所述解偏差模块包含至少一延迟单元，连结至所述接收模块；以及至少一比较单元，用以比较所述第一信号以及所述第二信号的相位；其中根据所述比较单元比较相位的结果，致能一第一相位偏移信号或一第二相位偏移信号至所述延迟单元，所述延迟单元根据所述第一相位偏移信号或所述第二相位偏移信号减少或增加发送所述第一信号的延迟时间，使得所述第一信号以及所述第二信号相位同步。3.如权利要求2的总线接收器，其中当所述第一信号的相位落后所述第二信号时，所述比较单元致能所述第一相位偏移信号，用以减少发送所述第一信号的延迟时间，当所述第一信号的相位领先所述第二信号时，所述比较单元致能所述第二相位偏移信号，用以增加发送所述第一信号的延迟时间。4.如权利要求2的总线接收器，其中所述解偏差模块更包含至少一过滤单元，连结于所述延迟单元以及所述比较单元之间，用以当有连续的所述第一相位偏移信号或所述第二相位偏移信号致能时，致能一第三相位偏移信号或致能一第四相位偏移信号。5.如权利要求4的总线接收器，所述延迟单元更包含一计数器，连接至所述过滤单元，用以接收所述第...
【专利技术属性】
技术研发人员：林明德，张棋，
申请(专利权)人：威盛电子股份有限公司，
类型：发明
国别省市：71[中国|台湾]
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