【技术实现步骤摘要】
具有导电柱的半导体封装及其制造方法相关申请的交叉引用本专利申请要求于2019年2月22日向韩国知识产权局(KIPO)递交的韩国专利申请No.10-2019-0021100的优先权,其公开内容通过全文引用合并于此。
本专利技术构思涉及一种具有导电柱的半导体封装及其制造方法。
技术介绍
随着半导体器件变得高度集成,正在凸显对半导体芯片和其上安装有半导体芯片的半导体封装进行集成和小型化的技术。为了制造薄半导体封装,已经开发了扇出型晶片级封装技术,在该技术中在半导体芯片而不是印刷电路板下方形成再分布层。同时,随着半导体芯片变得小型化,焊球之间的间隔减小,从而存在处理焊球变得困难的问题。为了解决这个问题,已经提出了扇出型晶片级封装。
技术实现思路
本专利技术构思旨在提供一种制造半导体封装的方法。该工艺可以帮助去除在研磨工艺中产生的残留物。根据本专利技术构思的示例性实施例的半导体封装包括:第一再分布结构;第一半导体芯片,设置在第一再分布结构上;导电柱,设置在第一再分布结构上,并与第一半导体芯片相邻;第一密封物,覆盖第一再分布结构的上表面、第一半导体芯片的下表面和侧表面以及导电柱的侧表面,第一密封物的上表面中形成有开口,开口暴露出导电柱的上表面;以及第二再分布结构,设置在第一密封物上并连接至导电柱,其中,第二再分布结构包括布线图案和连接过孔,连接过孔填充开口的至少一部分并连接至导电柱。根据本专利技术构思的示例性实施例的半导体封装包括:第一再分布结构;第一半导体芯片,设置在第一再分 ...
【技术保护点】
1.一种半导体封装,包括:/n第一再分布结构;/n第一半导体芯片,设置在所述第一再分布结构上;/n导电柱,设置在所述第一再分布结构上,并与所述第一半导体芯片相邻;/n第一密封物,覆盖所述第一再分布结构的上表面、所述第一半导体芯片的下表面和侧表面、以及所述导电柱的侧表面,所述第一密封物的上表面中形成有开口,所述开口暴露出所述导电柱的上表面;和/n第二再分布结构,设置在所述第一密封物上并连接至所述导电柱,其中,所述第二再分布结构包括布线图案和连接过孔,所述连接过孔填充所述开口的至少一部分并连接至所述导电柱。/n
【技术特征摘要】
20190222 KR 10-2019-00211001.一种半导体封装,包括:
第一再分布结构;
第一半导体芯片,设置在所述第一再分布结构上;
导电柱,设置在所述第一再分布结构上,并与所述第一半导体芯片相邻;
第一密封物,覆盖所述第一再分布结构的上表面、所述第一半导体芯片的下表面和侧表面、以及所述导电柱的侧表面,所述第一密封物的上表面中形成有开口,所述开口暴露出所述导电柱的上表面;和
第二再分布结构,设置在所述第一密封物上并连接至所述导电柱,其中,所述第二再分布结构包括布线图案和连接过孔,所述连接过孔填充所述开口的至少一部分并连接至所述导电柱。
2.根据权利要求1所述的半导体封装,其中,从所述第一再分布结构的上表面到所述导电柱的上表面的高度小于从所述第一再分布结构的上表面到所述第一半导体芯片的上表面的高度。
3.根据权利要求1所述的半导体封装,其中,所述导电柱具有凹入的上表面。
4.根据权利要求1所述的半导体封装,其中,所述导电柱具有凸出的上表面。
5.根据权利要求1所述的半导体封装,还包括第二半导体芯片,所述第二半导体芯片设置在所述第二再分布结构上,
其中,所述第二半导体芯片电连接至所述导电柱。
6.根据权利要求1所述的半导体封装,其中,所述第二再分布结构包括连接至所述导电柱的连接过孔以及设置在所述连接过孔上的布线图案。
7.根据权利要求6所述的半导体封装,其中,所述连接过孔包括下表面,该下表面的宽度等于所述导电柱的宽度。
8.根据权利要求7所述的半导体封装,其中,所述连接过孔包括上表面,该上表面的宽度大于所述导电柱的宽度。
9.根据权利要求1所述的半导体封装,还包括设置在所述第一半导体芯片的下表面上的多个凸块,其中,所述第一密封物覆盖所述多个凸块中的每一个的侧表面。
10.根据权利要求1所述的半导体封装,还包括形成在所述第二再分布结构上的第二半导体芯片。
11.根据权利要求1所述的半导体封装,还包括形成在所述第二再分布结构上的上封装以及所述上封装的下表面上的连接构件,所述连接构件将所述上封装和所述第二再分布结构电连接,并且
其中,所述上封装包括第二半导体芯片以及覆盖所述第二半导体芯片的上表面和侧表面的第二密封物,并且所述上封装的下表面与所述第二再分布结构的上表面间隔开。
12.一种半导体封装,包括:
第一再分布结构;
第一半导体芯片,设置在所述第一再分布结构上;
多个导电柱,设置在所...
【专利技术属性】
技术研发人员:全光宰,金东奎,朴正镐,张延镐,
申请(专利权)人:三星电子株式会社,
类型:发明
国别省市:韩国;KR
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