The invention discloses an operation method of flash memory, which comprises a transversely arranged leak area, a first gate structure, a second gate structure, a third gate structure and a source area; a first gate structure is superimposed by a first gate dielectric layer and a polycrystalline silicon selective gate; and a second gate structure is composed of a second gate dielectric layer and a plurality of multiple gates. Crystalline silicon floating gate is superimposed, and the third gate structure is superimposed by the third gate dielectric layer and the polycrystalline silicon erasing gate. The reading operation includes: adding a first positive voltage on the polysilicon selective gate to make the channel of the area covered by the first gate structure turn on; increasing the voltage in the drain area over the source area to make the channel on the surface of the channel area turn on so as to form the source leakage current; adding a second positive voltage less than the erasing voltage on the polysilicon erasing gate and coupling the second positive voltage. Regional coupling reduces the influence of trapped electrons in the tunneling dielectric layer and the second gate dielectric layer on the read current window. The invention can increase the reading current window and the voltage stabilizing capacitance of the power supply.
【技术实现步骤摘要】
闪存的操作方法
本专利技术涉及一种半导体集成电路的操作方法,特别是涉及一种闪存的操作方法。
技术介绍
如图1所示,是现有闪存的结构示意图,现有闪存的存储单元包括:第一栅极结构、第二栅极结构、第三栅极结构、源区10和漏区11。所述第一栅极结构由形成于半导体衬底1表面的第一栅介质层2和多晶硅选择栅3叠加而成。所述第二栅极结构由形成于半导体衬底1表面的第二栅介质层4和多晶硅浮栅5叠加而成。所述第三栅极结构由形成于半导体衬底1表面的第三栅介质层6和多晶硅擦除栅7叠加而成。所述多晶硅浮栅5的第二侧面和所述多晶硅擦除栅7的第一侧面之间具有耦合区域,在所述耦合区域中设置有隔离所述多晶硅浮栅5和所述多晶硅擦除栅7的隧穿介质层8,所述多晶硅擦除栅7通过所述耦合区域擦除所述多晶硅浮栅5中的电子。所述源区10位于所述第三栅极结构的底部,所述漏区11位于所述第一栅极结构的第一侧面外的所述半导体衬底1表面上且所述漏区11和所述第一栅极结构的第一侧面自对准。由位于所述源区10和所述漏区11之间的所述半导体衬底1组成沟道区。两个所述存储单元组成一个存储单元组合,所述存储单元组合中所述第三栅极结构和所述源区10为两个对应的所述存储单元共用。在所述耦合区域处,所述多晶硅浮栅5的顶部具有尖端结构。所述多晶硅浮栅5的顶部覆盖有第四介质层9。所述第一栅极结构的第一侧面形成有侧墙12。所述第一栅介质层2、所述第二栅介质层4、所述第三栅介质层6和所述隧穿介质层8的材料都为氧化物。所述侧墙12的材料包括氧化物或氮化物。所述第四介质层9的材料为氧化物。所述源区10连接到源极线,所述漏区11连接到位线,所 ...
【技术保护点】
1.一种闪存的操作方法,其特征在于:闪存的存储单元包括:第一栅极结构、第二栅极结构、第三栅极结构、源区和漏区;所述第一栅极结构由形成于半导体衬底表面的第一栅介质层和多晶硅选择栅叠加而成;所述第二栅极结构由形成于半导体衬底表面的第二栅介质层和多晶硅浮栅叠加而成;所述第三栅极结构由形成于半导体衬底表面的第三栅介质层和多晶硅擦除栅叠加而成;所述多晶硅浮栅的第二侧面和所述多晶硅擦除栅的第一侧面之间具有耦合区域,在所述耦合区域中设置有隔离所述多晶硅浮栅和所述多晶硅擦除栅的隧穿介质层,所述多晶硅擦除栅通过所述耦合区域擦除所述多晶硅浮栅中的电子;所述源区位于所述第三栅极结构的底部,所述漏区位于所述第一栅极结构的第一侧面外的所述半导体衬底表面上且所述漏区和所述第一栅极结构的第一侧面自对准;由位于所述源区和所述漏区之间的所述半导体衬底组成沟道区;所述闪存的操作方法中的读操作的步骤包括:在所述多晶硅选择栅上加第一正电压使所述第一栅极结构所覆盖的区域的沟道导通;所述漏区加大于所述源区的电压使所述沟道区表面的沟道导通使形成源漏电流;所述多晶硅擦除栅上加第二正电压,所述第二正电压小于擦除电压,所述第二正电压通过 ...
【技术特征摘要】
1.一种闪存的操作方法,其特征在于:闪存的存储单元包括:第一栅极结构、第二栅极结构、第三栅极结构、源区和漏区;所述第一栅极结构由形成于半导体衬底表面的第一栅介质层和多晶硅选择栅叠加而成;所述第二栅极结构由形成于半导体衬底表面的第二栅介质层和多晶硅浮栅叠加而成;所述第三栅极结构由形成于半导体衬底表面的第三栅介质层和多晶硅擦除栅叠加而成;所述多晶硅浮栅的第二侧面和所述多晶硅擦除栅的第一侧面之间具有耦合区域,在所述耦合区域中设置有隔离所述多晶硅浮栅和所述多晶硅擦除栅的隧穿介质层,所述多晶硅擦除栅通过所述耦合区域擦除所述多晶硅浮栅中的电子;所述源区位于所述第三栅极结构的底部,所述漏区位于所述第一栅极结构的第一侧面外的所述半导体衬底表面上且所述漏区和所述第一栅极结构的第一侧面自对准;由位于所述源区和所述漏区之间的所述半导体衬底组成沟道区;所述闪存的操作方法中的读操作的步骤包括:在所述多晶硅选择栅上加第一正电压使所述第一栅极结构所覆盖的区域的沟道导通;所述漏区加大于所述源区的电压使所述沟道区表面的沟道导通使形成源漏电流;所述多晶硅擦除栅上加第二正电压,所述第二正电压小于擦除电压,所述第二正电压通过所述耦合区域的耦合减少所述隧穿介质层和所述第二栅介质层中俘获电子对读取电流窗口的影响,从而增加读取电流窗口。2.如权利要求1所述的闪存的操作方法,其特征在于:两个所述存储单元组成一个存储单元组合,所述存储单元组合中所述第三栅极结构和所述源区为两个对应的所述存储单元共用。3.如权利要求1所述的闪存的操作方法,其特征在于:在所述耦合区域处,所述多晶硅浮栅的顶部具有尖端结构。4.如权利要求1所述的闪存的操作方法,其特征在于:所述多晶硅浮栅的顶部覆盖有第四介质层。5.如权利要求2所述的闪存的操作方法,其特征在于:所述第一栅极结构的第一侧面形成有侧...
【专利技术属性】
技术研发人员:杨光军,
申请(专利权)人:上海华虹宏力半导体制造有限公司,
类型:发明
国别省市:上海,31
还没有人留言评论。发表了对其他浏览者有用的留言会获得科技券。