The invention provides a shift register unit, a driving method, a grid driving circuit and a display device. The shift register unit comprises a first pull-up node control circuit, a second pull-up node control circuit, a pull-down node control circuit, an output pull-up circuit and an output pull-down circuit; the first pull-up node control circuit controls the first pull-up node to be connected to the second voltage terminal under the control of the input signal and/or the reset signal Under the control of the voltage signal of the pull-up node, the first pull-up node is connected with the first voltage terminal; under the control of the input signal, the second pull-up node control circuit controls the second pull-up node to be connected with the input terminal; under the control of the reset signal, the second pull-up node is connected with the first voltage terminal; and the pull-down node control circuit is connected with the first voltage terminal. The circuit is connected with the drop-down node, the second pull-up node, the second voltage terminal and the third voltage terminal respectively. The invention solves the problem of the wrong output of the gate drive signal.
【技术实现步骤摘要】
移位寄存器单元、驱动方法、栅极驱动电路和显示装置
本专利技术涉及显示驱动
,尤其涉及一种移位寄存器单元、驱动方法、栅极驱动电路和显示装置。
技术介绍
Incell(内嵌式)触摸显示装置在工作时,触控时间段持续的时间较长(毫秒量级),在每个触控时间段后的第1行GOA(GateOnArray,设置于阵列基板上的栅极驱动)单元中的上拉节点PU的电位在所述触控时间段内会出现漏电现象,使得所述上拉节点PU的电压降低,会导致该行GOA单元的栅极驱动信号输出端输出的电压下降,甚至相应行栅线无法开启,使得像素充电受到影响。
技术实现思路
本专利技术的主要目的在于提供一种移位寄存器单元、驱动方法、栅极驱动电路和显示装置,解决现有的触控显示装置中的栅极驱动电路包括的移位寄存器单元中的上拉节点的电位在触控时间段由于漏电而降低,从而导致栅极驱动信号误输出的问题。为了达到上述目的,本专利技术提供了一种移位寄存器单元,包括第一上拉节点控制电路、第二上拉节点控制电路、下拉节点控制电路、输出上拉电路和输出下拉电路,其中,所述第一上拉节点控制电路分别与所述第一上拉节点、第一电压端、输入端、复位端、下拉节点和第二电压端连接,用于在所述输入端接入的输入信号的控制下,控制所述第一上拉节点与所述第二电压端连接,并用于在所述复位端输出的复位信号和/或所述下拉节点的电压信号的控制下,控制所述第一上拉节点与所述第一电压端连接;所述第二上拉节点控制电路分别与所述第二上拉节点、所述第一电压端、所述输入端、所述复位端、所述下拉节点和第二电压端连接,用于在所述输入信号的控制下,控制所述第二上拉节点与所述输入端 ...
【技术保护点】
1.一种移位寄存器单元,其特征在于,包括第一上拉节点控制电路、第二上拉节点控制电路、下拉节点控制电路、输出上拉电路和输出下拉电路,其中,所述第一上拉节点控制电路分别与所述第一上拉节点、第一电压端、输入端、复位端、下拉节点和第二电压端连接,用于在所述输入端接入的输入信号的控制下,控制所述第一上拉节点与所述第二电压端连接,并用于在所述复位端输出的复位信号和/或所述下拉节点的电压信号的控制下,控制所述第一上拉节点与所述第一电压端连接;所述第二上拉节点控制电路分别与所述第二上拉节点、所述第一电压端、所述输入端、所述复位端、所述下拉节点和第二电压端连接,用于在所述输入信号的控制下,控制所述第二上拉节点与所述输入端连接,在所述复位信号的控制下,控制所述第二上拉节点与所述第一电压端连接;所述下拉节点控制电路分别与所述下拉节点、所述第二上拉节点、所述第二电压端和第三电压端连接,用于在所述第二上拉节点的电压信号的控制下控制所述下拉节点的电位;所述输出上拉电路分别与所述第一上拉节点、时钟信号端、栅极驱动信号输出端连接,用于在所述第一上拉节点的电压信号的控制下,控制所述栅极驱动信号输出端与所述时钟信号端连接 ...
【技术特征摘要】
1.一种移位寄存器单元,其特征在于,包括第一上拉节点控制电路、第二上拉节点控制电路、下拉节点控制电路、输出上拉电路和输出下拉电路,其中,所述第一上拉节点控制电路分别与所述第一上拉节点、第一电压端、输入端、复位端、下拉节点和第二电压端连接,用于在所述输入端接入的输入信号的控制下,控制所述第一上拉节点与所述第二电压端连接,并用于在所述复位端输出的复位信号和/或所述下拉节点的电压信号的控制下,控制所述第一上拉节点与所述第一电压端连接;所述第二上拉节点控制电路分别与所述第二上拉节点、所述第一电压端、所述输入端、所述复位端、所述下拉节点和第二电压端连接,用于在所述输入信号的控制下,控制所述第二上拉节点与所述输入端连接,在所述复位信号的控制下,控制所述第二上拉节点与所述第一电压端连接;所述下拉节点控制电路分别与所述下拉节点、所述第二上拉节点、所述第二电压端和第三电压端连接,用于在所述第二上拉节点的电压信号的控制下控制所述下拉节点的电位;所述输出上拉电路分别与所述第一上拉节点、时钟信号端、栅极驱动信号输出端连接,用于在所述第一上拉节点的电压信号的控制下,控制所述栅极驱动信号输出端与所述时钟信号端连接;所述输出下拉电路分别与所述下拉节点、所述第三电压端和所述栅极驱动信号输出端连接,用于在所述下拉节点的电压信号的控制下,控制所述栅极驱动信号输出端与所述第三电压端连接。2.如权利要求1所述的移位寄存器单元,其特征在于,所述第一上拉节点控制电路包括:第一上拉节点控制晶体管,栅极与所述输入端连接,第一极与所述第二电压端连接,第二极与所述第一上拉节点连接;第二上拉节点控制晶体管,栅极与所述复位端连接,第一极与所述第一上拉节点连接,第二极与所述第一电压端连接;以及,第三上拉节点控制晶体管,栅极与所述下拉节点连接,第一极与所述第一上拉节点连接,第二极与所述第一电压端连接。3.如权利要求1所述的移位寄存器单元,其特征在于,所述第二上拉节点控制电路包括:第五上拉节点控制晶体管,栅极与所述输入端连接,第一极与所述第二电压端连接,第二极与所述第二上拉节点连接;以及,第六上拉节点控制晶体管,栅极与所述复位端连接,第一极与所述第二上拉节点连接,第二极与所述第一电压端连接。4.如权利要求1至3中任一权利要求所述的移位寄存器单元,其特征在于,所述下拉节点控制电路包括:第一下拉节点控制晶体管,栅极和第一极都与第二电压端连接,第二极与下拉控制节点连接;第二下拉节点控制晶体管,栅极与所述第二上拉节点连接,第一极与所述下拉控制节点连接,第二极与所述第三电压端连接;第三下拉节点控制晶体管,栅极与所述下拉控制节点连接,第一极与所述第二电压端连接,第二极与所述下拉节点连接;以及,第四下拉节点控制晶体管,栅极与所述第二上拉节点连接,第一极与所述下拉节点连接,第二极与所述第三电压端连接。5.如权利要求1至3中任一权利要求所述的移位寄存器单元,其特征在于,输出上拉电路包括:输出上拉晶体管,栅极与所述第一上拉节点连接,第一极与所述时钟信号端连接,第二极与所述栅极驱动信号输出端连接;以及,存储电容,第一端与所述第一上拉节点连接,第二端与所述栅...
【专利技术属性】
技术研发人员:苏秋杰,
申请(专利权)人:京东方科技集团股份有限公司,北京京东方显示技术有限公司,
类型:发明
国别省市:北京,11
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