【技术实现步骤摘要】
具有使用定标常数的可变节点更新器的解码方法和解码系统相关申请的交叉引用本申请要求2013年2月4日提交的标题为MODIFIEDLDPCDECODERFORHARD-READNANDDEVICES的美国临时专利申请No.61/760,519(代理人案号No.LINKP131+)的优先权,其通过引用结合在本文中以用于所有目的。
技术介绍
低密度奇偶校验(LDPC)码被用来写入固态储存器并且从固态储存器读取,所述固态储存器(转而)被用在移动设备中。自然地,当移动设备从电池操作时,功率消耗对于包括LDPC解码器的所有部件来说是一个重要问题。节约功率的直截了当的方式是降低用来表示被LDPC解码器输入的软信息的位的数目。这直接地译成转而降低功率消耗的操作的数目的降低。遗憾的是,简单地降低位的数目能够引起显著的性能退化(例如,因为数值误差、舍入误差和/或饱和误差)。已降低了性能退化(尤其是在其中用来表示软信息的位的数目是相对小的系统中)的新的LDPC解码技术将是所希望的。例如,这将使得功率能够被节约而不牺牲太多性能。附图说明在以下具体实施方式和附图中公开了本专利技术的各种实施例。图1是图示了由低密度奇偶校验(LDPC)解码过程所使用的消息更新过程的实施例的流程图。图2是图示了具有使用定标常数的可变节点更新器的LDPC解码器的实施例的图。图3是图示了从可变节点发送到校验节点的消息的计算的数值示例的图。图4是图示了从校验节点发送到可变节点的消息的计算的数值示例的图。图5是图示了其中在可变节点更新状态期间更新的消息使用定标常数被更新的LDPC解码过程的实施例的流程图。图6是图示了包 ...
【技术保护点】
一种系统,包括:可变节点更新器,其被配置成计算与从多个可变节点中的一个转向多个校验节点中的一个相关联的第一消息,其中:(1)所述多个可变节点与所述多个校验节点之间的一个或多个连接被LDPC奇偶校验矩阵规定并且(2)定标常数被用来计算所述第一消息;以及校验节点更新器,其被配置成计算与从所述多个校验节点中的一个转向所述多个可变节点中的一个相关联的第二消息,其中所述定标常数未被用来计算所述第二消息。
【技术特征摘要】
2013.02.04 US 61/760,519;2013.11.18 US 14/083,1861.一种解码系统,包括:可变节点更新器,其被配置成计算与从多个可变节点中的一个转向多个校验节点中的一个相关联的第一消息,其中:(1)所述多个可变节点与所述多个校验节点之间的一个或多个连接被LDPC奇偶校验矩阵规定并且(2)定标常数被用来计算所述第一消息;以及校验节点更新器,其被配置成计算与从所述多个校验节点中的一个转向所述多个可变节点中的一个相关联的第二消息,其中所述定标常数未被用来计算所述第二消息,其中,所述可变节点更新器被配置成计算所述第一消息,包括通过:确定在计算所述第一消息时使用的所有对数似然比(LLR)值是否被保证为具有相同的幅度;以及在确定所有LLR值被保证为具有相同的幅度情况下:获得与所有LLR值被保证为具有相同的幅度相关联的存储的幅度;并且计算所述第一消息,包括通过选择适当的符号并且使用所存储的幅度。2.根据权利要求1所述的解码系统,其中所述解码系统使用半导体器件来实现,所述半导体器件包括下列中的一个或多个:现场可编程门阵列(FPGA)或专用集成电路(ASIC)。3.根据权利要求1所述的解码系统,其中所述解码系统被包括在下列中的一个或多个中:通信系统、固态存储系统、NANDFlash存储系统或3DNAND存储系统。4.根据权利要求1所述的解码系统,其进一步包括:码字更新器,其被配置成计算码字;以及校正子更新器,其被配置成至少部分地基于所述码字和奇偶校验矩阵来确定解码是否是成功的,其中在确定解码是成功的情况下,输出所述码字。5.根据权利要求1所述的解码系统,其进一步包括:读取阈值生成器,其被配置成生成与读取固态储存器相关联的一个或多个读取阈值;以及对数似然比(LLR)值生成器,其被配置成生成多个LLR值,其中所述可变节点更新器被进一步配置成基于所述多个LLR值中的至少一个来计算所述第一消息。6.一种解码方法,包括:使用处理器来计算与从多个可变节点中的一个转向多个校验节点中的一个相关联的第一消息,其中:(1)所述多个可变节点与所述多个校验节点之间的一个或多个连接被LDPC奇偶校验矩阵规定并且(2)定标常数被用来计算所述第一消息;以及使用处理器来计算与从所述多个校验节点中的一个转向所述多个可变节点中的一个相关联的第二消息,其中所述定标常数未被用来计算所述第二消息,其中使用所述处理器来计算所述第一消息包括:确定在计算所述第一消息时...
【专利技术属性】
技术研发人员:曾令琪,Q刁,J贝罗拉多,
申请(专利权)人:SK海尼克斯存储技术公司,
类型:发明
国别省市:美国;US
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