扫描驱动电路及显示装置制造方法及图纸

本发明专利技术公开了一种扫描驱动电路，包括级连的N个GOA单元，第N级GOA单元包括：上拉模块、控制上拉模块打开时间的上拉驱动模块、下拉维持模块及下拉模块；上拉模块分别与节点(Q(N))和第N级栅极信号输出端(G(N))连接；上拉驱动模块与第N级栅极信号输出端(G(N))连接；下拉维持模块用于分别接收第一直流电压(VSS1)和第二直流电压(VSS2)；下拉模块连接第N级栅极信号输出端(G(N))且用于接收第一直流电压(VSS1)；下拉维持模块由镜像连接的第一下拉维持电路与第二下拉维持电路交替工作构成，用于将第N级栅极信号输出端(G(N))和节点(Q(N))保持在负电位。本发明专利技术的扫描驱动电路具有高可靠性。

Scanning driving circuit and display device

The invention discloses a scanning drive circuit, including the concatenated N GOA unit, N GOA unit includes a pull-up module, control module and pull open time pull drive module and maintenance module and pull-down pull-down module; pull-up module is respectively connected with the node (Q (N)) and N the gate level signal output terminal (G (N)) connected; pull driving module and the N gate signal output terminal (G (N)); drop maintain module is used for respectively receiving a first DC voltage (VSS1) and second (VSS2); DC voltage drop level N module is connected with the output end of the gate signal (G (N)) and for receiving a first DC voltage drop (VSS1); maintain the first pull-down module is connected by the mirror circuit and the second circuit to maintain the drop-down to maintain work alternately, for class N gate signal output terminal (G (N)) and node (Q (N)) maintained at negative potentials. The scanning driving circuit of the present invention has high reliability.

【技术实现步骤摘要】
扫描驱动电路及显示装置
本专利技术涉及用于显示装置的扫描驱动电路，尤其涉及到一种具有高可靠性的扫描驱动电路及具有该扫描驱动电路的显示装置。
技术介绍
GOA技术即GateDriveronArray(阵列基板栅极驱动)是直接将栅极驱动电路(GateDriverIC)制作在阵列基板上，实现对栅极线的逐行扫描的驱动方式的一项技术。现有的GOA电路，通常包括级联的多个GOA单元，每一级GOA单元对应驱动一条扫描线(或称栅极线)。GOA单元的主要结构包括上拉模块(Pull-uppart)、上拉驱动模块(Pull-upcontrolpart)、下传模块(Transferpart)、下拉模块(KeyPull-downpart)和下拉维持模块(Pull-downHoldingpart)。上拉模块主要负责将时钟信号(Clock)输出为栅极信号；上拉驱动模块负责控制上拉模块的打开时间，一般连接前级GOA电路传递过来的下传信号或者栅极信号；下拉模块负责在第一时间将栅极信号拉低为低电位；下拉维持模块则负责将栅极信号和上拉电路的栅极信号(通常称为Q点)维持(Holding)在关闭状态(即负电位)，通常有两个下拉维持模块交替作用。在现有技术的GOA电路中，下拉维持模块的稳压电路中的各个晶体管受到的压力最大，经过长时间的高温高湿操作后，各晶体管的阈值电压Vth漂移严重，会导致输出到扫描线(或称栅极线)的栅极信号出现异常，从而画面显示出现异常。
技术实现思路
为了解决上述现有的技术问题，本专利技术的目的在于提供一种扫描驱动电路，包括级连的N个GOA单元，第N级GOA单元包括：将时钟信号输出为栅极信号的上拉模块、控制所述上拉模块打开时间的上拉驱动模块、下拉维持模块及下拉模块；所述上拉模块分别与节点和第N级栅极信号输出端连接；所述上拉驱动模块与第N级栅极信号输出端连接；所述下拉维持模块用于分别接收第一直流电压和第二直流电压；所述下拉模块连接第N级栅极信号输出端且用于接收第一直流电压；所述下拉维持模块由镜像连接的第一下拉维持电路与第二下拉维持电路构成，所述第一下拉维持电路与所述第二下拉维持电路交替工作，以将第N级栅极信号输出端和节点保持在负电位。进一步地，所述第一下拉维持电路包括：第一稳压电路模块、漏极与第一稳压电路模块连接的第一晶体管和第五二晶体管、第三晶体管；第五二晶体管的源极连接第三晶体管漏极和栅极，第三晶体管的源极用于接收第一直流电压，第一晶体管的源极用于接收第二直流电压，第一晶体管的栅极用于接收控制电压，第一晶体管的漏极和第五二晶体管的漏极连接在一起并用于接收第一低频时钟信号；所述第二下拉维持电路包括：第二稳压电路模块、漏极与第二稳压电路模块连接的第二晶体管和第六二晶体管、第四晶体管；第六二晶体管的源极连接第四晶体管漏极和栅极，第四晶体管的源极用于接收第一直流电压，第二晶体管的源极用于接收第二直流电压，第二晶体管的栅极用于接收控制电压，第二晶体管的漏极和第六二晶体管的漏极连接在一起并用于接收第二低频时钟信号；所述第一稳压电路模块及所述第二稳压电路模块均连接到第N级栅极信号输出端，所述第一直流电压大于所述第二直流电压。进一步地，所述第一稳压电路模块包括：第三三晶体管和第四三晶体管；第三三晶体管的栅极和第四三晶体管的栅极连接在一起并连接到第一晶体管的漏极，第三三晶体管的源极和第四三晶体管的源极分别用于接收第一直流电压，第三三晶体管的漏极连接到第N级栅极信号输出端，第四三晶体管的漏极连接到节点。进一步地，所述第二稳压电路模块包括第三二晶体管和第四二晶体管；第三二晶体管的栅极和第四二晶体管的栅极连接在一起并连接到第一晶体管的漏极，第三二晶体管的源极和第四二晶体管的源极分别用于接收第一直流电压，第三二晶体管的漏极连接到第N级栅极信号输出端，第四二晶体管的漏极连接到节点。进一步地，所述上拉驱动模块包括第二一晶体管，第二一晶体管的栅极连接到第N-2级GOA单元的下传信号，第二一晶体管的漏极和源极分别连接到第N-4级栅极信号输出端和节点。进一步地，在第一级GOA单元中，第二一晶体管的栅极用于连接启动信号端，第二一晶体管的漏极和源极分别连接启动信号端和节点；在第二级GOA单元中，第二一晶体管的栅极和漏极都连接到启动信号端，第二一晶体管的源极连接到节点。进一步地，所述下拉模块包括第四一晶体管，第四一晶体管的栅极连接第N+2级栅极信号输出端，第四一晶体管的漏极和源极分别连接第N级栅极信号输出端和第二直流电压。进一步地，所述第二直流电压为-10V，所述控制电压为-15V。进一步地，所述第一低频时钟信号和所述第二低频时钟信号相位相反。本专利技术的另一目的还在于提供一种显示装置，其包括上述的扫描驱动电路。本专利技术的有益效果：本专利技术的扫描驱动电路具体高可靠性，从而能够避免使用该扫描驱动电路的显示装置显示的画面出现异常。附图说明通过结合附图进行的以下描述，本专利技术的实施例的上述和其它方面、特点和优点将变得更加清楚，附图中：图1是根据本专利技术的实施例的第N级GOA单元的电路图；图2是根据本专利技术的实施例的。具体实施方式为了使本专利技术的目的、技术方案及优点更加清楚明白，以下结合实施例，对本专利技术进行进一步详细说明。应当理解，此处所描述的具体实施例仅仅用以解释本专利技术，并不用于限定本专利技术。图1是根据本专利技术的实施例的第N级GOA单元的电路图。通常GOA电路包括级联的N个图1所示的GOA单元。参照图1，根据本专利技术的实施例的第N级GOA单元包括：将时钟信号CK输出为栅极信号的上拉模块10、控制上拉模块10打开时间的上拉驱动模块20、下拉维持模块30及下拉模块40。上拉模块10分别与节点Q(N)和第N级栅极信号输出端G(N)连接；上拉驱动模块20与第N级栅极信号输出端G(N)连接；下拉维持模块30用于分别接收第一直流电压VSS1和第二直流电压VSS2；下拉模块40连接第N级栅极信号输出端G(N)且用于接收第一直流电压VSS1。下拉维持模块30由镜像连接的第一下拉维持电路31与第二下拉维持电路32构成，第一下拉维持电路31与第二下拉维持电路32交替工作，以将第N级栅极信号输出端G(N)和节点Q(N)保持在负电位。第一下拉维持电路31包括：第一稳压电路模块311、漏极与第一稳压电路模块311连接的第一晶体管T1和第五二晶体管T52、第三晶体管T3；第五二晶体管T52的源极连接第三晶体管T3漏极和栅极，第三晶体管T3的源极用于接收第一直流电压VSS1，第一晶体管T1的源极用于接收第二直流电压VSS2，第一晶体管T1的栅极用于接收控制电压RT，第一晶体管T1的漏极和第五二晶体管T52的漏极连接在一起并用于接收第一低频时钟信号LC1。第二下拉维持电路32包括：第二稳压电路模块321、漏极与第二稳压电路模块321连接的第二晶体管T2和第六二晶体管T62、第四晶体管T4；第六二晶体管T62的源极连接第四晶体管(T4)漏极和栅极，第四晶体管T4的源极用于接收第一直流电压VSS1，第二晶体管T2的源极用于接收第二直流电压VSS2，第二晶体管T2的栅极用于接收控制电压RT，第二晶体管T2的漏极和第六二晶体管T62的漏极连接在一起并用于接收第二低频时钟信号LC2。第一稳压电路模块311及第二稳压电路模块321均本文档来自技高网...

【技术保护点】
一种扫描驱动电路，包括级连的N个GOA单元，其特征在于，第N级GOA单元包括：将时钟信号(CK)输出为栅极信号的上拉模块、控制所述上拉模块打开时间的上拉驱动模块、下拉维持模块及下拉模块；所述上拉模块分别与节点(Q(N))和第N级栅极信号输出端(G(N))连接；所述上拉驱动模块与第N级栅极信号输出端(G(N))连接；所述下拉维持模块用于分别接收第一直流电压(VSS1)和第二直流电压(VSS2)；所述下拉模块连接第N级栅极信号输出端(G(N))且用于接收第一直流电压(VSS1)；所述下拉维持模块由镜像连接的第一下拉维持电路与第二下拉维持电路构成，所述第一下拉维持电路与所述第二下拉维持电路交替工作，以将第N级栅极信号输出端(G(N))和节点(Q(N))保持在负电位。

【技术特征摘要】
1.一种扫描驱动电路，包括级连的N个GOA单元，其特征在于，第N级GOA单元包括：将时钟信号(CK)输出为栅极信号的上拉模块、控制所述上拉模块打开时间的上拉驱动模块、下拉维持模块及下拉模块；所述上拉模块分别与节点(Q(N))和第N级栅极信号输出端(G(N))连接；所述上拉驱动模块与第N级栅极信号输出端(G(N))连接；所述下拉维持模块用于分别接收第一直流电压(VSS1)和第二直流电压(VSS2)；所述下拉模块连接第N级栅极信号输出端(G(N))且用于接收第一直流电压(VSS1)；所述下拉维持模块由镜像连接的第一下拉维持电路与第二下拉维持电路构成，所述第一下拉维持电路与所述第二下拉维持电路交替工作，以将第N级栅极信号输出端(G(N))和节点(Q(N))保持在负电位。2.根据权利要求1所述的扫描驱动电路，其特征在于，所述第一下拉维持电路包括：第一稳压电路模块、漏极与第一稳压电路模块连接的第一晶体管(T1)和第五二晶体管(T52)、第三晶体管(T3)；第五二晶体管(T52)的源极连接第三晶体管(T3)漏极和栅极，第三晶体管(T3)的源极用于接收第一直流电压(VSS1)，第一晶体管(T1)的源极用于接收第二直流电压(VSS2)，第一晶体管(T1)的栅极用于接收控制电压(RT)，第一晶体管(T1)的漏极和第五二晶体管(T52)的漏极连接在一起并用于接收第一低频时钟信号(LC1)；所述第二下拉维持电路包括：第二稳压电路模块、漏极与第二稳压电路模块连接的第二晶体管(T2)和第六二晶体管(T62)、第四晶体管(T4)；第六二晶体管(T62)的源极连接第四晶体管(T4)漏极和栅极，第四晶体管(T4)的源极用于接收第一直流电压(VSS1)，第二晶体管(T2)的源极用于接收第二直流电压(VSS2)，第二晶体管(T2)的栅极用于接收控制电压(RT)，第二晶体管(T2)的漏极和第六二晶体管(T62)的漏极连接在一起并用于接收第二低频时钟信号(LC2)；所述第一稳压电路模块及所述第二稳压电路模块均连接到第N级栅极信号输出端(G(N))，所述第一直流电压(VSS1)大于所述第二直流电压(VSS2)。3.根据权利要求2所述的扫描驱动电路，其特征在于，所述第一稳压电路模块包括：第三三晶体管(M33)和第四三晶体管(M43)；第三三晶体管(M33)的栅...

【专利技术属性】
技术研发人员：王添鸿，郭平昇，
申请(专利权)人：深圳市华星光电技术有限公司，
类型：发明
国别省市：广东,44