【技术实现步骤摘要】
本公开涉及时间数字装换器,具体地涉及低功率双极型360度时间数字转换器。
技术介绍
锁相环(PLL)能够为各种各样的应用提供时序的精确生成和对齐。数字锁相环(DPLL)是对传统PLL的可行替换,其中能够采用数字环路滤波器来替代模拟组件。另外,时间数字转换器(TDC)能够操作以对参考和分频器输出之间的相位误差进行数字编码。在基于环形振荡器的TDC中,功率消耗和相位噪声随测量时间而增加。全数字锁相环(ADPLL)的测量时间因此被保持为尽可能地小以避免功率消耗和相位噪声代价。因为TDC通常测量正向时间,所以一般要在ADPLL的数字环路滤波器的前端引入额外的TDC偏移,其中该TDC偏移被选择成为多模分频器(MMD)引发的边沿变化给出裕度。因此在实现方式中存在利用低功率和小面积来克服测量时间引起的功率和相位噪声代价,同时寻求TDC时间数字映射特性中的高精度和高线性度的需求。
技术实现思路
根据本公开的一个方面,提供了一种时间数字转换器,包括:延迟线,该延迟线包括包含第一延迟链和第二延迟链的多个延迟级以生成锁相环的数字振荡器的细时间测量;粗时间计算组件,该粗时间计算组件被配置为基于锁相环的数字振荡器的等距周期和非等距周期来生成粗时间测量,其中细时间测量和粗时间测量形成被传送至数字振荡器的锁相环的相位差测量。根据本公开的另一方面,提供了一种移动设备,包括:天线端口;RF前端;数字基带 ...
【技术保护点】
一种时间数字转换器,包括:延迟线,该延迟线包括包含第一延迟链和第二延迟链的多个延迟级以生成锁相环的数字振荡器的细时间测量;粗时间计算组件,该粗时间计算组件被配置为基于所述锁相环的数字振荡器的等距周期和非等距周期来生成粗时间测量,其中所述细时间测量和所述粗时间测量形成被传送至所述数字振荡器的所述锁相环的相位差测量。
【技术特征摘要】 【专利技术属性】
2014.11.17 US 14/542,8021.一种时间数字转换器,包括:
延迟线,该延迟线包括包含第一延迟链和第二延迟链的多个延迟级以
生成锁相环的数字振荡器的细时间测量;
粗时间计算组件,该粗时间计算组件被配置为基于所述锁相环的数字
振荡器的等距周期和非等距周期来生成粗时间测量,其中所述细时间测量
和所述粗时间测量形成被传送至所述数字振荡器的所述锁相环的相位差测
量。
2.如权利要求1所述的时间数字转换器,还包括边沿选择器,该边沿
选择器被配置为通过生成开始边沿、停止边沿和标志值来使能双极型时间
测量,其中所述开始边沿和所述停止边沿是基于参考信号和分频器信号生
成的,并且所述标志值是基于分别接收所述参考信号的边沿和所述分频器
信号的边沿的接收次序生成的。
3.如权利要求1所述的时间数字转换器,其中所述粗时间计算组件还
被配置为从数字振荡器计数器接收数字振荡器计数器值并且基于所述数字
振荡器计数器值和来自频率调制器的经调制的数字振荡器频率来生成所述
数字振荡器的粗时间测量。
4.如权利要求1所述的时间数字转换器,其中所述粗时间计算组件还
被配置为向求和组件提供所述粗时间测量以生成最终时间测量作为所述相
位差,其中所述最终时间测量是从以下项中导出的:所述粗时间测量、基
于所述延迟线的多个第一比较器的第一二进制转换和基于所述延迟线的多
个第二比较器的第二二进制转换。
5.如权利要求1所述的时间数字转换器,其中所述粗时间计算组件还
被配置为基于数字振荡器计数器值递归地生成数字振荡器计算以生成最终
时间测量作为相位测量,其中所述延迟线被配置为生成与不同极性相对应
的时间测量以用于生成双极型时间测量并且消除由工艺依赖、温度依赖或
电压依赖中的至少一者导致的偏移。
6.如权利要求1所述的时间数字转换器,其中所述粗时间计算组件还
\t被配置为基于来自极化调制器的一组经调制的频率值、数字振荡器计数器
值和边沿选择器生成的标志值来生成所述粗时间测量,其中所述粗时间计
算组件利用所述标志值来计算非恒定的数字振荡器周期的时间。
7.如权利要求1所述的时间数字转换器,还包括:
边沿选择器,该边沿选择器被配置为将参考时钟的参考信号与分频器
时钟的分频器信号相比较并基于其生成到相位生成器的开始信号和停止信
号,并且还被配置为生成标志值并将所述标志值提供给所述粗时间计算组
件,其中所述标志值是基于分别接收所述参考信号的边沿和所述分频器信
号的边沿的接收次序生成的。
8.如权利要求7所述的时间数字转换器,还包括被耦合至所述多个延
迟级的第一组比较器和第二组比较器,该第一组比较器和第二组比较器被
配置为基于由所述相位生成器提供的开始边沿和停止边沿来控制所述多个
延迟级的不同状态。
9.如权利要求1所述的时间数字转换器,还包括数字振荡器计数器,
该数字振荡器计数器被配置为对所述数字振荡器的周期进行计数并向所述
振荡器提供对于所述周期的计数以确定所述粗时间测量。
10.如权利要求1所述的时间数字转换器,还包括相位生成器,该相
位生成器被配置为基于对接收的开始信号和接收的停止信号到开始边沿和
停止边沿的转换来控制所述多个延迟级的第一延迟元件和第二延迟元件的
延迟线状态的锁存和传播,该开始边沿和停止边沿沿所述多个延迟级传
播,其中所述延迟线被配置为生成没有内部偏移的双极型时间测量。
11.如权利要求10所述的时间数字转换器,其中所述相位生成器和所
述延迟线还被配置为消除在根据至少两个数字振荡器周期和所述双极型时
间测量处理参考时钟路径的参考信号和分频器时钟路径的分频器信号之间
技术研发人员:马库斯·席姆佩尔,
申请(专利权)人:英特尔德国有限责任公司,
类型:发明
国别省市:德国;DE
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