【技术实现步骤摘要】
本专利技术涉及一种基于FPGA搭建的增强型串口及其工作方法,以FPGA为硬件基础, 用Verilog HDL编写代码实现。
技术介绍
RS232通信时,数据以字节为单位,在接收数据时,单片机、DSP等内部集成的硬件 串口具有收完一个(或多个)字节置位相应标志位的功能,当数据量较大的时候,主程序需 要频繁进行中断响应或进行标志位查询操作,控制接收流程并缓存收到的数据,这将占用 主程序的时间以及进行流程控制花费硬件资源;在发送数据时,需要查询当前串口状态,进 行发送流程控制,这也将占用自身资源和处理时间。
技术实现思路
本专利技术的目的是提供一种基于FPGA搭建的增强型串口及其工作方法,以FPGA为 硬件基础,用Verilog HDL编写代码实现。基于FPGA搭建的增强型串口,其特征在于,包括以下模块发送数据FIFO模块、 接收数据双口 RAM模块、接收缓存模块、发送缓存模块、参数配置逻辑模块、接收超时判断 逻辑模块、接收逻辑模块、发送逻辑模块。本工作方法,其步骤为(1)参数配置步骤工作之前,需要由外部控制器对所述的参数配置逻辑模块写入参 数配置数据,该参数配置数据包括 ...
【技术保护点】
一种基于FPGA搭建的增强型串口,其特征在于,包括以下模块:发送数据FIFO模块、接收数据双口RAM模块、接收缓存模块、发送缓存模块、参数配置逻辑模块、接收超时判断逻辑模块、接收逻辑模块、发送逻辑模块。
【技术特征摘要】
【专利技术属性】
技术研发人员:江勇,杨杰,
申请(专利权)人:四川九洲电器集团有限责任公司,
类型:发明
国别省市:51[中国|四川]
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