【技术实现步骤摘要】
一种级联氮化镓功率电路模块封装结构
[0001]本专利技术属于氮化镓功率器件
,具体涉及一种级联氮化镓功率电路模块封装结构。
技术介绍
[0002]近年来,氮化镓(GaN)功率器件以其宽带隙、高电子迁移率和高电子速度的优势特性,在新能源发电和电动汽车等高频、高效和高功率密度应用领域受到广泛的关注。然而,现有氮化镓高电子迁移率晶体管(HEMT)电流等级比较低,限制了氮化镓HEMT器件在高功率应用中的使用。通过GaN Cascode器件模块并联连接可以提高电流处理能力,满足高功率密度、高频率、集成化的发展需求。
[0003]传统氮化镓级联(GaN Cascode)器件封装存在两个问题。第一,传统封装通过引线键合将Si MOSFET的漏极、源极分别与耗尽型GaN HEMT的源极、栅极连接。引线键合会带来较大的寄生参数,尤其并联GaN器件之间寄生参数不对称问题可能导致器件之间电流不平衡和环路电流,在功率器件关断时,寄生电感会造成关断电压尖峰和振荡,并增加器件损耗,甚至可能导致低压Si MOSFET雪崩击穿失效。第二,传统封装的散热方式为单面散热,通过将GaN芯片焊接在覆铜基板上,通过覆铜基板进行散热,而器件顶部受塑封材料约束,热阻较大,导致器件散热能力差。。
技术实现思路
[0004]为了解决现有技术中存在的上述问题,本专利技术提供了一种级联氮化镓功率电路模块封装结构。本专利技术要解决的技术问题通过以下技术方案实现:
[0005]一种级联氮化镓功率电路模块封装结构,包括:形成封装体的两个 ...
【技术保护点】
【技术特征摘要】
1.一种级联氮化镓功率电路模块封装结构,其特征在于,包括:形成封装体的两个双面覆铜陶瓷基板、至少一个第一级联氮化镓功率电路和至少一个第二级联氮化镓功率电路;所述两个双面覆铜陶瓷基板的板面相对;所述第一级联氮化镓功率电路,包括:四个耗尽型第一氮化镓芯片(110)和一个增强型第一MOSFET芯片(120);所述第一级联氮化镓功率电路与两个双面覆铜陶瓷基板的焊盘和铜柱采用银烧结连接;所述第二级联氮化镓功率电路,包括四个耗尽型第二氮化镓芯片(210)和一个增强型第二MOSFET芯片(220);所述第二级联氮化镓功率电路与两个双面覆铜陶瓷基板的焊盘和铜柱采用银烧结连接;所述两个双面覆铜陶瓷基板的焊盘通过所述铜柱连接。2.根据权利要求1所述的一种级联氮化镓功率电路模块封装结构,其特征在于,所述四个第一氮化镓芯片(110)并联且与所述第一MOSFET芯片(120)互连;所述第一氮化镓芯片(110)与两个双面覆铜陶瓷基板的焊盘和铜柱采用银烧结连接;所述第一MOSFET芯片(120)与两个双面覆铜陶瓷基板的焊盘和铜柱采用银烧结连接;所述四个第二氮化镓芯片(210)并联且与所述第二MOSFET芯片(220)互连;所述第二氮化镓芯片(210)与两个双面覆铜陶瓷基板的焊盘和铜柱采用银烧结连接;所述第二MOSFET芯片(220)与两个双面覆铜陶瓷基板的焊盘和铜柱采用银烧结连接。3.根据权利要求1所述的一种级联氮化镓功率电路模块封装结构,其特征在于,所述两个双面覆铜陶瓷基板为第一双面覆铜陶瓷基板(100)和第二双面覆铜陶瓷基板(200);所述铜柱包括:第一子铜柱(a)和第二子铜柱(b);所述第一氮化镓芯片(110)的衬底和所述第一MOSFET芯片的源极(121)及栅极均与所述第一双面覆铜陶瓷基板(100)的焊盘连接;所述第一氮化镓芯片的源极(112)、栅极和漏极以及所述第一MOSFET芯片的漏极(123)均与所述第二双面覆铜陶瓷基板(200)的焊盘连接;所述第一子铜柱(a)与所述第一双面覆铜陶瓷基板(100)的焊盘和所述第二双面覆铜陶瓷基板(200)的焊盘连接;所述第二子铜柱(b)与所述第一双面覆铜陶瓷基板(100)的焊盘和所述第二双面覆铜陶瓷基板(200)的焊盘连接。4.根据权利要求3所述的一种级联氮化镓功率电路模块封装结构,其特征在于,所述第一双面覆铜陶瓷基板(100)的焊盘,包括:第一焊盘(1)、第三焊盘(3)和第四焊盘(4);所述第一氮化镓芯片(110)的衬底与所述第一焊盘(1)连接;所述第一MOSFET芯片的源极(121)与所述第一焊盘(1)连接,所述第一MOSFET芯片的栅极(122)与所述第四焊盘(4)连接;所述第三焊盘(3)与所述第一子铜柱(a)连接,所述第一焊盘(1)与所述第二子铜柱(b)连接。5.根据权利要求4所述的一种级联氮化镓功率电路模块封装结构,其特征在于,所述第二双面覆铜陶瓷基板(200)的焊盘,包括:第六焊盘(6)、第八焊盘(8)、第十焊盘(10)、第十
一焊盘(11)和第十二焊盘(12);...
【专利技术属性】
技术研发人员:江希,吴越,袁嵩,何艳静,弓小武,
申请(专利权)人:西安电子科技大学,
类型:发明
国别省市:
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