【技术实现步骤摘要】
凹入式存取装置及形成凹入式存取装置的方法
[0001]本文中所公开的实施例涉及凹入式存取装置及形成凹入式存取装置的方法。
技术介绍
[0002]凹入式存取装置是具有掩埋在半导电材料中形成的沟槽内的栅极构造的场效应晶体管。栅极构造包含栅极绝缘体,所述栅极绝缘体加衬垫于沟槽及所述沟槽内的所述栅极绝缘体的横向内侧的导电栅极材料。在沟槽的相对侧中的每一者上的半导电材料的最外区中形成源极/漏极区。当两个源极/漏极区处于不同电压且将合适电压施加到导电栅极材料时,电流(I
on
)沿着沟槽侧壁并围绕沟槽的基底在源极/漏极区之间流动通过半导电材料(即,形成导电沟道,电流通过所述导电沟道在两个源极/漏极区之间流动)。凹入式存取装置通常缺少非易失性电荷存储装置(但可被制造成包含此非易失性电荷存储装置),且无论如何均可用于存储器电路系统,例如DRAM电路系统中。可期望在凹入式存取装置中获得高装置导通电流(I
on
)及低装置关断电流(例如,泄漏电流I
off
)。
技术实现思路
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【技术保护点】
【技术特征摘要】
1.一种凹入式存取装置,其包括:导电栅极,其在半导体材料中的沟槽中;栅极绝缘体,其在所述导电栅极与所述半导体材料之间沿着所述导电栅极的侧壁并围绕所述导电栅极的底部延伸;一对源极/漏极区,其在所述沟槽的相对横向侧上的所述半导体材料的上部分中;沟道区,其在所述一对源极/漏极区下方的所述半导体材料中,沿着所述沟槽的侧壁并围绕所述沟槽的底部延伸;且所述栅极绝缘体包括低k材料及高k材料,所述低k材料以其介电常数k不大于4.0为特征,所述高k材料以其介电常数k大于4.0为特征,所述低k材料完全沿着所述导电栅极的所有所述侧壁延伸且直接在所述导电栅极的所述底部之下,所述高k材料在所述低k材料的横向内侧且是(a)及(b)中的至少一者,其中:(a):不完全沿着所述导电栅极的所有所述侧壁延伸;及(b):不直接在所述导电栅极的所述底部之下。2.根据权利要求1所述的凹入式存取装置,其包括所述(a)。3.根据权利要求2所述的凹入式存取装置,其中所述高k材料直接在所述导电栅极的所述底部之下。4.根据权利要求2所述的凹入式存取装置,其中所述高k材料覆盖所述导电栅极的所述侧壁的10%到95%。5.根据权利要求4所述的凹入式存取装置,其中所述高k材料覆盖不足所述导电栅极的所述侧壁的50%。6.根据权利要求5所述的凹入式存取装置,其中所述高k材料覆盖所述导电栅极的所述侧壁的10%到25%。7.根据权利要求4所述的凹入式存取装置,其中所述高k材料覆盖超过所述导电栅极的所述侧壁的50%。8.根据权利要求7所述的凹入式存取装置,其中所述高k材料覆盖所述导电栅极的所述侧壁的60%到85%。9.根据权利要求1所述的凹入式存取装置,其包括所述(b)。10.根据权利要求9所述的凹入式存取装置,其中所述高k材料完全沿着所述导电栅极的所有所述侧壁延伸。11.根据权利要求1所述的凹入式存取装置,其包括所述(a)及所述(b)。12.根据权利要求1所述的凹入式存取装置,其包括所述(a),所述高k材料在所述导电栅极的两个横向侧上从所述导电栅极的顶部竖直凹入。13.根据权利要求1所述的凹入式存取装置,其中所述高k材料在所述导电栅极的顶部旁边,在所述导电栅极的所述顶部的高度处。14.根据权利要求13所述的凹入式存取装置,其中所述高k材料具有在所述导电栅极的所述顶部的所述高度处的顶部。15.根据权利要求14所述的凹入式存取装置,其中所述导电栅极的所述顶部及所述高k材料的所述顶部是平面且共同共面的。16.根据权利要求13所述的凹入式存取装置,其中所述高k材料具有高于所述导电栅极
的所述顶部的所述高度的顶部。17.根据权利要求16所述的凹入式存取装置,其中所述低k材料具有高于所述导电栅极的所述顶部的所述高度的顶部。18.根据权利要求1所述的凹入式存取装置,其中所述低k材料具有3.0到4.0的介电常数k且所述高k材料具有10.0到40.0的介电常数k。19.根据权利要求1所述的凹入式存取装置,其中所述高k材料薄于所述低k材料。20.根据权利要求19所述的凹入式存取装置,其中所述高k材料具有为所述低k材料的最大横向厚度的1%到60%的最大横向厚度。21.根据权利要求20所述的凹入式存取装置,其中所述高k材料具有不超过所述低k材料的最大横向厚度的50%的最大横向厚度。22.根据权利要求21所述的凹入式存取装置,其中所述高k材料具有不超过所述低k材料的最大横向厚度的10%的最大横向厚度。23.根据权利要求1所述的凹入...
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