本发明专利技术公开一种显示面板及一种显示装置，所述显示面板包括显示透光区及位于所述显示透光区外围的过渡显示区，所述显示面板包括位于所述过渡显示区内的多个辅像素驱动电路，以及位于所述显示透光区内且电性连接于所述辅像素驱动电路的多个辅子像素。每一所述辅像素驱动电路包括晶体管，所述晶体管包括有源层以及位于所述有源层上的绝缘层。其中，所述显示面板在所述过渡显示区内设有第一虚拟孔，所述第一虚拟孔贯穿所述绝缘层的远离所述有源层的部分，以通过所述第一虚拟孔降低多个辅像素驱动电路之间出现的电性差异，改善所述辅像素驱动电路的电性的均一性，从而实现所述显示面板的均一显示。板的均一显示。板的均一显示。
【技术实现步骤摘要】
显示面板及显示装置
[0001]本专利技术涉及显示
，尤其涉及一种显示面板及一种显示装置。
技术介绍
[0002]在显示面板中采用屏下摄像头(Camera Under Panel,CUP)技术，可以兼顾摄像头的成像效果及全面屏显示设计。但驱动CUP区像素发光的驱动电路被放置在CUP区外围，驱动电路设置的密度差异及各驱动电路中所采用的晶体管的电性差异，会导致CUP区像素在接收相同的驱动信号时出现不同的亮度差异，引起CUP区出现显示不均的问题。
技术实现思路
[0003]本专利技术实施例提供一种显示面板及一种显示装置，可以降低辅像素驱动电路之间出现的电性差异，进而改善显示面板的显示的均一性。
[0004]本专利技术的实施例提供一种显示面板，所述显示面板包括显示透光区及位于所述显示透光区外围的过渡显示区，所述显示面板包括多个辅像素驱动电路及多个辅子像素。多个所述辅像素驱动电路位于所述过渡显示区内，多个所述辅子像素位于所述显示透光区内，且电性连接于所述辅像素驱动电路。每一所述辅像素驱动电路包括晶体管，所述晶体管包括有源层以及位于所述有源层上的绝缘层。
[0005]其中，所述显示面板在所述过渡显示区内设有第一虚拟孔，所述第一虚拟孔贯穿所述绝缘层的远离所述有源层的部分。
[0006]在一些实施例中，所述显示面板还包括位于所述过渡显示区内的多个像素电路驱动岛，每一所述像素电路驱动岛包括多个所述辅像素驱动电路，所述第一虚拟孔包括多个第一子虚拟孔，每一所述第一子虚拟孔位于对应的相邻两所述像素电路驱动岛之间。
[0007]在一些实施例中，每一所述像素电路驱动岛具有长度方向，每一辅像素驱动电路在所述长度方向上具有第一长度，位于相邻两所述像素电路驱动岛之间的多个所述第一子虚拟孔具有第二长度；其中，所述第二长度大于所述第一长度，所述第二长度等于多个所述第一子虚拟孔中位于首端的所述第一子虚拟孔与位于末端的所述第一子虚拟孔在所述长度方向上的距离。
[0008]在一些实施例中，所述第二长度大于或等于所述第一长度的2倍。
[0009]在一些实施例中，所述第一虚拟孔包括位于所述像素电路驱动岛的靠近所述显示透光区一侧的多个第二子虚拟孔。
[0010]在一些实施例中，多个所述第二子虚拟孔的行数和/或列数大于或等于4。
[0011]在一些实施例中，所述显示面板还包括位于所述过渡显示区远离所述显示透光区的一侧的主显示区，所述第一虚拟孔包括位于所述像素电路驱动岛的靠近所述主显示区一侧的多个第三子虚拟孔。
[0012]在一些实施例中，所述显示面板还包括位于所述主显示区的多个主子像素及驱动多个所述主子像素发光的多个主像素驱动电路；其中，每一所述主像素驱动电路设有多个
过孔，在俯视视角下，多个所述第一虚拟孔的排列方式与多个所述过孔的排列方式相同，或多个所述第一虚拟孔呈矩阵排列。
[0013]在一些实施例中，所述显示面板还设有位于所述过渡显示区内的第二虚拟孔，所述第二虚拟孔位于所述像素电路驱动岛靠近所述显示透光区的一侧，所述第二虚拟孔贯穿所述绝缘层，所述第二虚拟孔的孔径大于所述第一虚拟孔的孔径。
[0014]在一些实施例中，所述显示面板还设有位于所述过渡显示区内的第三虚拟孔，所述第三虚拟孔贯穿所述绝缘层，所述第三虚拟孔的深度大于或小于所述第一虚拟孔的深度。
[0015]在一些实施例中，所述晶体管还包括：第一绝缘层、第一电极层、第二绝缘层、第二电极层。
[0016]所述第一绝缘层位于所述有源层上；所述第一电极层位于所述第一绝缘层上，所述第一电极层包括第一走线部和与所述有源层对位设置的第一电极部；所述第二绝缘层位于所述第一电极层上；所述第二电极层位于所述第二绝缘层上，所述第二电极层包括第二走线部和与所述有源层电性连接的第二电极部。
[0017]其中，所述绝缘层包括所述第一绝缘层和所述第二绝缘层，所述第一虚拟孔不贯穿所述有源层、所述第一电极层和所述第二电极层。
[0018]在一些实施例中，所述显示面板还包括位于所述绝缘层远离所述有源层一侧的平坦层，所述平坦层包括位于所述第一虚拟孔内的填充部。
[0019]在一些实施例中，所述第一虚拟孔的孔径大于或等于2微米且小于或等于3.5微米，相邻的两个所述虚拟孔之间的距离大于或等于2微米且小于或等于5微米。
[0020]在一些实施例中，所述第二虚拟孔的孔径大于或等于4微米且小于或等于7微米，所述第二虚拟孔与所述第一虚拟孔的孔径之差大于或等于1微米且小于或等于4.5微米。
[0021]本专利技术的实施例还提供一种显示装置，包括任一上述的显示面板。
[0022]本专利技术实施例提供一种显示面板及一种显示装置，所述显示面板包括显示透光区和位于所述显示透光区外围的过渡显示区，所述显示面板包括多个辅像素驱动电路及多个辅子像素。多个所述辅像素驱动电路位于所述过渡显示区内，多个所述辅子像素位于所述显示透光区内，且电性连接于所述辅像素驱动电路。每一所述辅像素驱动电路包括晶体管，所述晶体管包括有源层以及位于所述有源层上的绝缘层。其中，所述显示面板在所述过渡显示区内设有第一虚拟孔，所述第一虚拟孔贯穿所述绝缘层的远离所述有源层的部分，以通过所述第一虚拟孔降低多个辅像素驱动电路之间出现的电性差异，改善所述辅像素驱动电路的电性的均一性，从而实现所述显示面板的均一显示。
附图说明
[0023]下面结合附图，通过对本专利技术的具体实施方式详细描述，将使本专利技术的技术方案及其它有益效果显而易见。
[0024]图1A～图1C为本专利技术的实施例提供的显示面板的结构示意图；
[0025]图1D为图1A中A处的局部放大图；
[0026]图1E为本专利技术的实施例提供的像素电路驱动岛的结构示意图；
[0027]图1F～图1G为本专利技术的实施例提供的第一子虚拟孔与像素电路驱动岛的结构示
意图；
[0028]图1H为本专利技术的实施例提供的第一子虚拟孔与辅像素驱动电路的结构示意图；
[0029]图2A～图2C为本专利技术的实施例提供的虚拟孔的排布示意图；
[0030]图3为本专利技术的实施例提供的仿真结果图；
[0031]图4为本专利技术的实施例提供的设置虚拟孔改善晶体管电性能的原理图。
[0032]表1为本专利技术的实施例提供的设置虚拟孔的结果验证表。
具体实施方式
[0033]下面将结合本专利技术实施例中的附图，对本专利技术实施例中的技术方案进行清楚、完整地描述。显然，所描述的实施例仅仅是本专利技术一部分实施例，而不是全部的实施例。基于本专利技术中的实施例，本领域技术人员在没有作出创造性劳动前提下所获得的所有其他实施例，都属于本专利技术保护的范围。
[0034]具体地，请参阅图1A～图1C，其为本专利技术的实施例提供的显示面板的结构示意图；如图1D，其为图1A中A处的局部放大图。
[0035]本专利技术的实施例提供一种显示面板，所述显示面板包括显示透光区100b及位于所述显示透光区100本文档来自技高网...
【技术保护点】
【技术特征摘要】
1.一种显示面板，其特征在于，所述显示面板包括显示透光区及位于所述显示透光区外围的过渡显示区，所述显示面板包括：多个辅像素驱动电路，位于所述过渡显示区内，每一所述辅像素驱动电路包括晶体管，所述晶体管包括有源层以及位于所述有源层上的绝缘层；多个辅子像素，位于所述显示透光区内，所述辅子像素电性连接于所述辅像素驱动电路；其中，所述显示面板在所述过渡显示区内设有第一虚拟孔，所述第一虚拟孔贯穿所述绝缘层的远离所述有源层的部分。2.根据权利要求1所述的显示面板，其特征在于，还包括位于所述过渡显示区内的多个像素电路驱动岛，每一所述像素电路驱动岛包括多个所述辅像素驱动电路，所述第一虚拟孔包括多个第一子虚拟孔，每一所述第一子虚拟孔位于对应的相邻两所述像素电路驱动岛之间。3.根据权利要求2所述的显示面板，其特征在于，每一所述像素电路驱动岛具有长度方向，每一辅像素驱动电路在所述长度方向上具有第一长度，位于相邻两所述像素电路驱动岛之间的多个所述第一子虚拟孔具有第二长度；其中，所述第二长度大于所述第一长度，所述第二长度等于多个所述第一子虚拟孔中位于首端的所述第一子虚拟孔与位于末端的所述第一子虚拟孔在所述长度方向上的距离。4.根据权利要求3所述的显示面板，其特征在于，所述第二长度大于或等于所述第一长度的2倍。5.根据权利要求2所述的显示面板，其特征在于，所述第一虚拟孔包括位于所述像素电路驱动岛的靠近所述显示透光区一侧的多个第二子虚拟孔。6.根据权利要求5所述的显示面板，其特征在于，多个所述第二子虚拟孔的行数和/或列数大于或等于4。7.根据权利要求2所述的显示面板，其特征在于，还包括位于所述过渡显示区远离所述显示透光区的一侧的主显示区，所述第一虚拟孔包括位于所述像素电路驱动岛的靠近所述主显示区一侧的多个第三子虚拟孔。8.根据权利要求7所述的显示面板，其特征在于，还包括位于所述主显示区的多个主子像素及驱动多个所述主子...
【专利技术属性】
技术研发人员：杨程，
申请(专利权)人：武汉华星光电半导体显示技术有限公司，
类型：发明
国别省市：
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