【技术实现步骤摘要】
【国外来华专利技术】用于存储器装置中的命令同步的技术
本文中所描述的实施例大体上涉及存储器装置的领域。更确切地说，当前实施例包含用于存储器装置中的命令同步的一或多个系统、装置和方法。
技术介绍
此章节意图向读者介绍可能涉及本专利技术的各种方面的技术的各种方面，这些方面在下文中有所描述和/或主张。相信此论述有助于向读者提供背景信息以促进对本专利技术的各种方面的更好的理解。因此，应理解，应鉴于此来阅读这些陈述，而不是作为对现有技术的认可。在半导体存储器中，存储器装置的恰当的操作是基于各种内部命令和时钟信号的正确的计时的。举例来说，在从存储器装置读取数据中，对数据路径电路系统进行计时以提供(例如输出)读取数据的内部时钟信号应该与内部读取命令信号基本上同时地提供以恰当地使得数据路径电路系统能够输出读取数据。如果内部读取命令信号的计时并不使得数据路径电路系统在内部时钟信号对数据路径电路系统进行计时以在预期的时间输出读取数据时启用，那么读取命令可以被无意地忽略或者由存储器提供的读取数据可能并不正确(例如，数据与另一读取命令相关联)。类似地，在将数据...
【技术保护点】
1.一种设备，其包括：/n电路节点，其经配置以接收时钟信号；/n延迟锁定环路DLL电路；以及/n时钟启用控制电路，其耦合在所述电路节点与所述DLL电路之间并且经配置以在第一和第二状态中的选定一者中操作；/n其中所述第一状态使得响应于读取命令以及写入命令中的至少一个的发布允许所述时钟信号到达所述DLL电路，并且所述第二状态使得早于所述读取命令以及所述写入命令中的任一个的发布允许所述时钟信号到达所述DLL电路。/n
【技术特征摘要】 【专利技术属性】
【国外来华专利技术】20180207 US 15/890,9431.一种设备，其包括：
电路节点，其经配置以接收时钟信号；
延迟锁定环路DLL电路；以及
时钟启用控制电路，其耦合在所述电路节点与所述DLL电路之间并且经配置以在第一和第二状态中的选定一者中操作；
其中所述第一状态使得响应于读取命令以及写入命令中的至少一个的发布允许所述时钟信号到达所述DLL电路，并且所述第二状态使得早于所述读取命令以及所述写入命令中的任一个的发布允许所述时钟信号到达所述DLL电路。
2.根据权利要求1所述的设备，其中所述第二状态使得响应于早于所述读取命令以及所述写入命令中的任一个的所述发布而发布的有效命令允许所述时钟信号到达所述DLL电路。
3.根据权利要求1所述的设备，其中所述时钟启用控制电路进一步经配置以接收控制信号，当所述控制信号在第一电平时选择所述第一状态，并且当所述控制信号在第二电平时选择所述第二状态。
4.根据权利要求3所述的设备，其进一步包括经配置以提供所述控制信号的控制电路系统，所述控制电路系统进一步经配置以至少部分地基于所述DLL电路的延迟信息以及时延信息控制所述控制信号的电平。
5.根据权利要求4所述的设备，其中所述时延信息包括CAS时延以及CAS写入时延。
6.根据权利要求1所述的设备，其进一步包括命令解码器以及计时电路，
其中所述命令解码器经配置以对所述读取命令以及所述写入命令中的每一个进行解码并且提供经解码命令；以及
其中所述计时电路经配置以使所述经解码命令与所述时钟信号同步。
7.根据权利要求6所述的设备，其中所述计时电路进一步经配置以改变使所述经解码命令的计时与所述时钟信号同步。
8.一种设备，其包括：
控制电路系统，其经配置以产生第一控制信号以及第二控制信号，其中所述第一控制信号以及所述第二控制信号经配置以将所述设备置于多个操作模式中的一个中；
时钟启用控制电路，其经配置以接收对应于读取命令或写入命令的RWD信号、对应于激活命令的ACTD信号、时钟信号以及所述第一控制信号，其中至少部分地基于所述第一控制信号的状态产生所述时钟启用控制电路的输出；以及
计时电路，经配置以接收命令信号、所述时钟信号以及所述第二控制信号，其中至少部分地基于所述第二控制信号的状态产生来自所述计时电路的输出。
9.根据权利要求8所述的设备，其中至少部分地基于一或多个时延信号以及延迟指示信号产生所述第一控制信号以及所述第二控制信号。
10.根据权利要求9所述的设备，其中所述控制电路系统包括：
第一计算器电路，其经配置以基于所述一或多个时延信号中的第一个与所述延迟指示信号之间的差异提供第一输出；以及
第二计算器电路，其经配置以基于所述一或多个时延信号中的第二中的差异提供第二输出。
11.根据权利要求10所述的设备，其中所述控制电路系统包括判断电路，所述判断电路经配置以接收所述第一输出、所述第二输出以及所述延迟指示信号作为输入信号以基于所述输入信号提供所述第一控制信号以及所述第二控制信号。
技术研发人员：小松与志也，宫野和孝，门马敦子，
申请(专利权)人：美光科技公司，
类型：发明
国别省市：美国;US
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