一种用于5G基站通信的电荷泵锁相环CPPLL制造技术

一种用于5G基站通信的电荷泵锁相环CPPLL，包括：鉴相鉴频器(PFD)，采用双反相器增加脉冲宽度，采用大尺寸电流源晶体管来减小电流不匹配，采用串联连接的常通传输门消除相位差；电荷泵(CP)，采用差分电荷泵解决电荷共享问题；低通滤波器(LPF)，采用高阶低通滤波器，减小稳态误差；压控振荡器(VCO)，通过采用NMOS开关控制的单位面积电容，合并采用双VCO结构。分频器(Divider)，采用双模预分频技术。本PLL实现方法，可满足5G基站通信电路在24.75‑42.5GHz频段性能要求，相位噪声、功耗指标优于标准规范要求。

A Charge Pump Phase-Locked Loop CPPLL for 5G Base Station Communication

【技术实现步骤摘要】
一种用于5G基站通信的电荷泵锁相环CPPLL
本技术涉及集成电路
，尤其涉及一种可用于5G基站间通信用的，宽频带、低功耗、低相位噪声的电荷泵锁相环(CPPLL)。
技术介绍
锁相环(PhaseLockedLoop，PLL)是一种相位负反馈控制系统，使受控振荡器的频率和相位与输入信号保持确定关系，并抑制输入信号中的噪声以及压控振荡器的相位噪声。电荷泵锁相环(ChargePumpPLL，CPPLL)具有频率获取能力强、理论上无限大的频率牵引范围零静态相位误差，因此电荷泵锁相环成为现代流行的锁相环设计结构。电荷泵锁相环的基本结构如图1所示，由图可见，电荷泵锁相环主要由鉴频鉴相器(PhaseFrequencyDetector，PFD)，电荷泵(ChargePump，CP)，低通滤波器(Low-PassFilter，LPF)，压控振荡器(VoltageControlOscillator，VCO)和分频器(Divider)组成。随着无线通信飞速发展，低成本、低功耗CMOS工艺技术得到不断进步。无线收发器的大部分单元电路都能够单片实现，但高速、低功耗射频CMOS锁相环的设计仍然是难点。衡量锁相环性能的标准是频域的相位噪声的大小，而锁相环系统的相位噪声几乎在其组成的每个模块都有贡献，影响较大的低频相位噪声主要来源于工作频率相对较低的模拟电路模块，即PFD、CP和LPF等。而现有的锁相环设计还存在功耗高、噪声大等缺点。
技术实现思路
本技术要解决的技术问题是通过对PFD、CP、LPF、VCO、Divider等各个模块的设计以及对电荷泵锁相环CPPLL电路的综合设计，提供一种宽频带、低功耗、低相位噪声的电荷泵锁相环。为达到上述技术要求，本技术针对上述各模块都采用相应设计以得到明显的整体性能提升。对鉴相鉴频器(PFD)设计，当两个输入信号之间存在微小相位差异时，由于电路各节点存在寄生电容，会限制脉冲上升和下降的速度，这些脉冲没有足够的时间达到逻辑高电平，最终导致电荷泵的开关不能正常导通，VCO的输出相位不能锁定到输入的参考频率上，恶化锁相环的相位噪声性能和抖动性能，本技术采用双反相器增加脉冲宽度，采用大尺寸电流源晶体管来减小电流不匹配，采用与PFD输出端串联连接的常通传输门消除相位差，最终达到PLL的稳定性要求。对电荷泵(CP)设计，电流源漏端寄生电容会引起电荷共享问题，采用差分电荷泵方案解决。低通滤波器(LPF)，滤除电荷泵输出信号中的高频噪声，通常采用一、二阶滤波器方案，本技术采用高阶低通滤波器，可大幅度减小稳态误差，给VCO提供平稳的控制电压。压控振荡器(VCO)，通过采用NMOS开关控制的单位面积电容，合并采用双VCO结构，避免谐振电路死区，保证谐振电路的噪声性能、工作频率稳定性、整个锁相环的频率调谐服务。分频器(Divider)，对VCO的输出信号进行可调节的分频，采用双模预分频技术，并采用划分单元功能模块实现电路整体功能的技术实现高频操作、小面积、低功耗。本技术采用上述PFD、CP、LPF、VCO、Divider模块的定制设计和PLL的综合设计，可满足24.75-42.5GHz宽频带电荷泵锁相环CPPLL的相位裕度指标要求，在45nm的CMOS工艺条件，达到低相位噪声和低功耗，满足5G基站通信电路要求。附图说明图1是表示电荷泵锁相环基本结构的图。图2是表示传统鉴相鉴频器原理结构的图。图3是表示理想PFD的输出信号。图4是表示存在微小相位差时PFD的输出信号。图5是表示实际PFD输出的信号。图6是表示实际存在微小差异时PFD的输出信号。图7是表示加入双反向器结构的图。图8是表示电流大小不匹配时信号的图。图9是表示串联接入常通传输门结构的图。图10是表示本实施方式鉴相鉴频器原理结构的图。图11是表示传统电荷泵原理结构的图。图12是表示本差分电荷泵原理结构的图。图13是表示本实施方式电荷泵原理结构的图。图14是表示本实施方式低通滤波器原理结构的图。图15是表示传统MOS容抗管作为调谐元件的压控振荡器原理结构的图。图16是表示顶部电流偏置型LC振荡器原理结构的图。图17是表示本实现方式低频VCO原理结构的图。图18是表示本实现方式高频VCO原理结构的图。图19是表示本实现方式双模预分频原理结构的图。图20是表示本实现方式分频器原理结构的图。图21是表示本实现方式分频器4/5分频模块原理结构的图。图22是表示本实现方式分频器Maincounter模块原理结构的图。图23是表示本实现方式分频器Lsbcounter模块原理结构的图。图24是本实现方式电荷泵锁相环CPPLL电路相位裕度的图。图25是本实现方式电荷泵锁相环CPPLL电路整体相位噪声的图。图26是本实现方式电荷泵锁相环CPPLL电路整体功耗的图。具体实施方式下面根据附图对本技术进行详细描述，其为本技术多种实施方式中的一种优选实施例。图2表示传统鉴相鉴频器结构设计。理想情况下，当两个输入信号频率、相位均相同时，PFD的输出UP，DN均不会有脉冲，如图3所示。当两个相同输入信号之间存在微小相位差异时，PFD输出UP或DN会产生非常窄的脉冲，如图4虚线所示，但实际中，由于电路各节点存在寄生电容，会限制脉冲上升和下降的速度，这些脉冲没有足够的时间达到逻辑高电平，如图4实线所示，最终导致电荷泵的开关不能正常导通，VCO的输出相位不能锁定到输入的参考频率上，只能在输入的参考信号相位附近微小范围内随机变化，恶化锁相环的相位噪声性能和抖动性能。同时，由于PFD电路的各部分存在时间延迟，即使PFD两个输入信号是同频同相的，UP和DN上也会输出窄脉冲如图5所示，这些脉冲持续时间相同，故电荷泵不产生输出电流，净的输出电流为0。将上述的两个问题综合来看，如果脉冲的宽度足够大，即使两个输入信号的相位差为0，UP和DN输出的窄脉冲也可以使电荷泵中的开关导通，当两个频率相同的输入信号相位存在微小差异时，PFD某一个输出脉冲的宽度会成比例增加，导致电荷泵输出的净电流和相位差成比例，从而达到相位的精确锁定，如图6所示。如果门延迟产生的脉冲如果不够大，需要在产生复位信号的与非门后串联偶数级反相器来实现，如图7所示。上电流源和下电流源之间的电流大小要匹配，否则即使两个信号同频同相，电荷泵也会有净输出电流，如图8所示。导致在每一个相位比较时刻，都会使得环路滤波器的输出电压增加或者降低。而在环路锁定时，其输出电压平均值应该是一个常数。本实现方式通过采用大尺寸的电流源晶体管来减小电流不匹配问题。最终的输出UP(DN)与UPN(DNN)相位存在一个门延迟的差距，故我们在UP(DN)前串联一个常通的传输门消除此差距，如图9所示。图10表示本实施方式的鉴相鉴频器结构设计。图11表示传统的电荷泵结构设计。电流源M1，M2漏端寄生电容会引起电荷共享问题。如果M3和M4断开，M1对节点B放电到0，M2对节点A充电到VDD。在下一个鉴相时刻，M3和M4都导通，B节点电压上升，A节点电压下降，VA≈VB≈uf，A节点上电压变化为VDD-uf，B节点上电压变化量为uf，如果uf≠VDD/2，则节点A、B上电压变化量不相等，电容上的变化量随之不相等，净的电荷量变化会流入或流出本文档来自技高网...

【技术保护点】
1.一种用于5G基站通信的电荷泵锁相环CPPLL，其特征在于，包括：鉴相鉴频器PFD，采用双反相器增加脉冲宽度，采用大尺寸电流源晶体管来减小电流不匹配，采用与PFD输出端串联连接的常通传输门以用于消除相位差，其输出相应的方波信号作为电荷泵的输入以控制电荷泵充放电；电荷泵CP，采用差分电荷泵以解决电荷共享问题；低通滤波器LPF，滤除电荷泵输出信号中的高频噪声，采用高阶低通滤波器，减小稳态误差，其输出作为给VCO的输入以提供平稳的控制电压；压控振荡器VCO，通过采用NMOS开关控制的单位面积电容，合并采用双VCO结构；分频器Divider，接收所述低通滤波器的输出对VCO的输出信号进行可调节的分频，采用双模预分频技术。

【技术特征摘要】
1.一种用于5G基站通信的电荷泵锁相环CPPLL，其特征在于，包括：鉴相鉴频器PFD，采用双反相器增加脉冲宽度，采用大尺寸电流源晶体管来减小电流不匹配，采用与PFD输出端串联连接的常通传输门以用于消除相位差，其输出相应的方波信号作为电荷泵的输入以控制电荷泵充放电；电荷泵CP，采用差分电荷泵以解决电荷共享问题；低通滤波器LPF，滤除电荷泵输出信号中的高频噪声，采用高阶低通滤波器，减小稳态误差，其输出作为给VCO的输入以提供平稳的控制电压...

【专利技术属性】
技术研发人员：王川恺，郭继泽，李昱辰，陈志杰，
申请(专利权)人：郭继泽，王川恺，李昱辰，陈志杰，
类型：新型
国别省市：北京,11